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1. 项目概述：为什么BUCK电路无法实现100%占空比

在电源设计，尤其是电池充电管理、嵌入式系统供电这些场景里，我们经常会遇到一个看似简单却让人头疼的需求：希望BUCK（降压）DC-DC转换器能在输入电压非常接近输出电压时，依然能稳定高效地工作，最好能像LDO（低压差线性稳压器）那样，实现近乎零压差的“直通”效果。很多工程师在项目初期都抱有这样的期望，比如用一节4.2V的锂电池给一个3.3V的系统供电，当电池电压降到3.5V时，还希望BUCK电路能继续输出稳定的3.3V。理论上，如果开关管的占空比能达到100%，即开关管一直导通，那么输入电压减去开关管和电感的压降，不就几乎等于输出电压了吗？这不就实现了低压差？

但现实很骨感，你几乎找不到一款宣称能实现100%占空比工作的通用同步或非同步BUCK控制器或转换器。这并不是芯片厂商故意留一手，而是由BUCK电路最经典、最主流的拓扑结构内在的物理限制所决定的。这个限制的核心，就藏在高边开关管的驱动电路里。今天，我们就来彻底拆解这个问题，从最基础的N沟道MOSFET（NMOS）作为高边开关的驱动原理讲起，看看为什么100%占空比是个“不可能的任务”，并探讨一下理论上可能的替代方案及其背后的代价。

2. 核心原理：高边NMOS开关的驱动困境

要理解为什么占空比不能是100%，我们必须先回到BUCK电路最基本的结构。一个典型的非同步BUCK（使用二极管续流）或同步BUCK（使用另一个MOSFET续流）拓扑中，核心的功率开关管（我们称之为高边开关或上管）是连接在输入电压（VIN）和开关节点（SW，连接电感的一端）之间的。

2.1 为什么NMOS是高边开关的主流选择？

在绝大多数中低压、大电流的BUCK应用中，这个高边开关都会选择N沟道增强型MOSFET（NMOS），而不是P沟道（PMOS）。原因非常实际，主要基于性能和成本：

1. 性能优势：对于相同的芯片面积和工艺，NMOS的导通电阻（Rds(on)）通常比PMOS低得多。这意味着在导通时，NMOS的损耗更小，转换效率更高。在大电流应用中，这直接关系到温升和散热设计。
2. 成本优势：同样规格的NMOS比PMOS更便宜，这是由半导体制造工艺决定的。在追求极致性价比的消费电子和工业领域，这一点至关重要。
3. 开关速度：NMOS的开关速度通常更快，这有助于提高开关频率，从而允许使用更小体积的电感和电容。

因此，选择NMOS作为高边开关，几乎是工程师在性能、成本和效率权衡下的必然选择。然而，这个选择带来了一个经典的驱动难题。

2.2 NMOS导通的“门槛”问题

一个增强型NMOS要完全导通，其栅极（G）相对于源极（S）的电压（Vgs）必须大于一个阈值电压（Vth，通常为2-5V，具体看器件型号）。在导通状态下，我们希望MOSFET的漏极（D）和源极（S）之间电阻极小，近似于一根导线。

现在，我们把这个NMOS放在高边位置：它的漏极（D）接输入电压VIN（比如12V），源极（S）接开关节点SW。当MOSFET导通时，SW点的电压会被迅速拉高到接近VIN（忽略导通压降）。关键点来了：此时，MOSFET的源极（S）电压就等于SW点电压，接近VIN。为了让这个MOSFET保持导通，栅极（G）的电压必须比源极（S）电压还要高出一个Vth。也就是说，栅极驱动电压需要高于VIN + Vth。

如果VIN是12V，Vth是3V，那么栅极就需要至少15V的驱动电压。这个电压从哪里来？芯片本身的VCC供电（比如5V或3.3V）是远远不够的。这就是高边NMOS驱动的核心矛盾：需要一个比输入电源电压还高的电压来驱动它。

3. 解决方案：自举（Bootstrap）电路的诞生与限制

为了解决这个“驱动电压比电源还高”的问题，电源管理IC的设计者们发明了“自举”（Bootstrap）电路。这是理解100%占空比限制的关键。

3.1 自举电路的工作原理

自举电路的核心是一个被称为“自举电容”（Cboot）的小电容和一个“自举二极管”（Dboot）。它的工作原理巧妙地利用了BUCK电路自身的开关动作来“泵”出一个高压。

让我们一步步拆解一个典型同步BUCK控制器的工作循环：

1. 阶段一：高边管关闭，低边管导通（续流阶段）

   • 此时，高边NMOS（Q1）关闭，低边NMOS（Q2，同步整流管）导通。
   • 开关节点SW的电压被低边管Q2拉低到接近地（GND），可能只有几十毫伏。
   • 芯片内部的栅极驱动电路，其供电端（我们称之为“驱动器电源”，比如VDRV=5V）通过自举二极管Dboot，给自举电容Cboot充电。Cboot的一端（我们称为“BST”端）接Dboot的阴极和Q1的栅极驱动电路，另一端（我们称为“SW”端）直接连接到开关节点SW。
   • 由于SW点此时接近0V，VDRV（5V）通过Dboot给Cboot充电。最终，电容Cboot两端的电压差（VBST - VSW）会被充电到接近VDRV（减去二极管的压降，约4.3V）。也就是说，VBST点的电压被“举”到了比SW点高约VDRV的水平。

2. 阶段二：高边管导通，低边管关闭（功率传输阶段）

   • 控制器需要打开高边管Q1。它控制内部的高边栅极驱动器，这个驱动器的电源正端就是VBST，负端就是SW。
   • 此时，驱动器以VBST为“天”，以SW为“地”，输出一个驱动信号给Q1的栅极。由于在阶段一结束时，VBST - VSW ≈ VDRV（例如4.3V）。当Q1开始导通，SW点的电压从0V迅速上升到接近VIN（12V）。
   • 这里发生了“自举”的魔法：电容两端的电压不能突变。当SW点电压从0V跳变到12V时，由于Cboot上已经充有4.3V的电压，VBST点的电压也会随之被“抬举”上去，变成 VSW + (VBST - VSW) ≈ 12V + 4.3V = 16.3V。
   • 于是，高边驱动器以16.3V为“天”，以12V（SW点）为“地”，它输出给Q1栅极的电压，相对于Q1的源极（SW点，12V）来说，正好是那个4.3V左右的驱动电压（16.3V - 12V = 4.3V），足以让Q1完全导通。

这个过程周而复始。自举电容Cboot在每个开关周期的续流阶段（低边管导通时）被充电，在功率传输阶段（高边管导通时）作为高压电源为高边驱动器供电。

3.2 自举电路对占空比的致命限制

理解了自举原理，100%占空比的限制就一目了然了。

自举电容充电的必要条件是：存在一个“续流阶段”，即低边管导通、SW点电压被拉低的阶段。只有在这个阶段，自举电容的SW端（接开关节点）是低电压，VDRV电源才能通过二极管给电容充电，补充上一个周期消耗的能量。

如果占空比达到100%，意味着高边管Q1永远导通，低边管Q2永远关闭。开关节点SW的电压将一直维持在接近VIN的高电平。自举电容的SW端始终是高电压，自举二极管Dboot的阳极（接VDRV，如5V）电压将始终低于阴极（接VBST，接近VIN+？）。二极管处于反偏截止状态，自举电容完全失去了充电通路。

在最初的几个开关周期，自举电容内储存的电荷会随着驱动高边管而逐渐耗尽。一旦电容电压（VBST - VSW）下降到低于MOSFET的阈值电压Vth，高边管就无法完全导通，导通电阻急剧增大，导致巨大的导通损耗和发热，输出电压崩溃，整个电路失效。

因此，为了保证自举电容能定期充电，高边管的导通时间必须被限制，必须留出足够的时间让低边管导通（续流）。这就是所有采用自举电路架构的BUCK控制器其最大占空比存在一个上限（例如95%、98%）的根本原因。这个上限为自举电容的刷新留出了最小的“充电窗口时间”。

注意：这个限制与开关频率有关。频率越高，每个开关周期的时间越短，为保证同样的充电时间，允许的最大占空比理论上可以更高（比如从95%提升到98%），但永远无法达到100%，因为总需要一段非零的时间来让SW点变低以完成充电。

4. 替代方案与权衡：PMOS与电荷泵

既然NMOS+自举的方案有占空比限制，那有没有办法突破呢？理论上和实际上都存在一些方案，但它们都引入了新的权衡。

4.1 使用PMOS作为高边开关

这是原文中提到的一种思路。P沟道增强型MOSFET（PMOS）的导通条件是栅极（G）电压低于源极（S）电压一个阈值（|Vgs| > |Vth|）。对于高边PMOS，其源极（S）接VIN。要让它导通，只需要将栅极（G）电压拉低到低于VIN一个阈值即可。这个驱动电压可以很容易地从芯片的VCC（比如5V）或一个更低的电压产生，完全不需要比VIN更高的电压。

因此，使用PMOS作为高边开关的BUCK控制器，理论上可以实现100%占空比，因为其驱动电路不依赖自举电容的周期性充电。

但是，为什么这个方案不主流呢？原因正是我们之前选择NMOS的理由：

1. 性能劣势：相同尺寸和成本下，PMOS的Rds(on)远高于NMOS。这意味着在导通状态下，PMOS的损耗更大，整个电源的峰值效率会下降，尤其是在大电流应用中，发热会非常严重。
2. 成本劣势：高性能、低Rds(on)的PMOS价格非常昂贵，会显著增加BOM成本。
3. 驱动细节：虽然驱动电压需求低，但驱动PMOS需要能够将栅极电压从VIN（关断时）快速下拉到地（导通时），这个下拉电流路径的设计也需要考虑。

所以，只有在一些对低压差需求极其苛刻、而对效率和成本相对不敏感的特定场合，才会考虑使用PMOS方案。例如，某些线性稳压器（LDO）或非常特殊的负载开关会采用PMOS。

4.2 集成电荷泵（Charge Pump）

另一种方案是在芯片内部集成一个电荷泵电路。这个电荷泵可以持续地从输入电压VIN或内部VCC“泵”出一个高于VIN的电压（比如VIN+5V），专门用来给高边NMOS的栅极驱动器供电。

由于这个高压电源是独立、持续产生的，不依赖于开关节点的状态，因此理论上也可以支持100%占空比。

然而，这个方案同样有代价：

1. 复杂度与成本：集成电荷泵会增加芯片设计的复杂度和硅片面积，从而提高芯片成本。
2. 效率影响：电荷泵本身也有转换效率（通常低于90%），它消耗的功率会成为系统的静态损耗，特别是在轻载时，这会拉低整个电源系统的轻载效率。
3. 噪声：电荷泵的开关动作会引入额外的高频噪声，可能对系统内敏感的模拟电路造成干扰。

因此，集成电荷泵的方案通常见于一些高端、对性能有特殊要求的电源管理芯片中，并非通用选择。

5. 工程实践：如何应对低压差场景？

明白了原理和限制，我们在实际项目中遇到输入输出电压差（Vdrop = VIN - VOUT）很小的场景时，应该如何应对呢？

5.1 正确理解规格书中的“最大占空比”

首先，在选择BUCK控制器或转换器时，一定要仔细阅读数据手册（Datasheet）中关于“Maximum Duty Cycle”的参数。这个值通常在90%到98%之间。它定义了芯片在保证自举电容正常充电的前提下，所能支持的理论最大占空比。

关键计算：这个最大占空比决定了该芯片所能支持的最小输入输出电压差。

• 对于理想BUCK（忽略所有损耗）：VOUT = D * VIN。因此，最小输入电压 VIN_min = VOUT / D_max。
• 举例：若VOUT=3.3V，芯片D_max=95%，则理论最小输入电压 VIN_min = 3.3V / 0.95 ≈ 3.47V。
• 这意味着，当电池电压从4.2V放电到3.47V时，这个BUCK芯片还能勉强维持3.3V输出。一旦电池电压低于3.47V，即使芯片试图将占空比调到最大（95%），输出电压也会开始跟随输入电压下降，无法再稳压。

实操心得：这个计算值是理想情况。实际电路中，高边MOSFET的导通压降（Iout * Rds(on)）、电感的直流电阻（DCR）压降、PCB走线电阻等都会产生额外的压降。因此，实际可用的最小压差（VIN_min - VOUT）会比理论值更大。在关键应用中，必须留出足够的裕量（比如200-300mV），并进行实际测试验证。

5.2 方案选型策略

根据不同的压差和电流需求，可以有以下策略：

1. 常规压差（>500mV）：优先选择高性能的同步BUCK控制器（NMOS高边+自举），这是性价比和效率最高的方案。
2. 小压差（200mV ~ 500mV）：
   • 选择高D_max的芯片：寻找标称最大占空比在98%甚至99%的型号。这类芯片通常通过优化内部驱动和自举刷新逻辑，缩短了必需的续流时间。
   • 关注MOSFET的Rds(on)：选择导通电阻极低的高边和低边MOSFET，以减小导通压降。
   • 优化布局与布线：使用宽、短的功率回路走线，选用低DCR的电感，尽可能减少所有串联电阻带来的压降。
3. 极低压差或需100%占空比（<200mV或要求“直通”）：
   • 使用PMOS高边方案的芯片：专门搜索支持100%占空比的BUCK控制器，这类芯片通常会在特性中明确写明。
   • 采用Buck-Boost拓扑：如果输入电压可能低于也可能高于输出电压，四开关Buck-Boost是终极解决方案。它本质上是由BUCK和BOOST组合而成，在任何压差下都能稳压，但成本、复杂度和损耗都更高。
   • 最后的选择：LDO：如果电流不大（比如<1A），且对噪声敏感，直接使用低压差LDO可能是最简单、最安静、成本最低的方案。虽然LDO效率低（效率≈VOUT/VIN），但在小电流、小压差下，其总损耗和发热是可接受的。

5.3 自举电路设计注意事项

即使不追求100%占空比，自举电路的设计也直接影响BUCK的可靠性和最大占空比能力。

1. 自举二极管选择：

   • 必须使用快恢复二极管或肖特基二极管。普通PN结二极管反向恢复时间慢，在高速开关时会产生很大的反向恢复电流尖峰和损耗，可能导致芯片损坏或效率下降。
   • 耐压要足够：二极管需要承受VBST的高压，通常选择耐压高于VIN_max + VDRV的型号。
   • 正向压降要小：二极管压降（Vf）越小，最终充到自举电容上的电压就越高，对高边管的驱动能力就越强。肖特基二极管是首选。

2. 自举电容计算：

   • 电容值需要足够大，以储存驱动高边管栅极所需的电荷（Qg）而不会导致电压跌落过多。一个经验公式是：Cboot > (Qg * 10) / ΔV。其中Qg是高边MOSFET的总栅极电荷（可从器件手册查得），ΔV是允许的自举电容电压纹波（通常取0.5V~1V）。
   • 电容类型：必须使用低ESR的陶瓷电容（如X7R， X5R），并紧靠芯片的BST和SW引脚放置，以提供低阻抗的充放电路径。
   • 耐压值：自举电容的耐压值必须高于可能出现的最大VBST电压（VIN_max + VDRV）。

常见设计错误：使用容量过小或ESR过大的电容，导致在高占空比或高频工作时，自举电容电压不足，高边管驱动不良，引起发热和效率下降。或者使用耐压不足的电容，存在长期可靠性风险。

6. 实测与调试：如何判断自举电路工作正常？

在实验室调试BUCK电路时，如何验证自举电路是否健康，是否限制了最大占空比？

1. 波形观测：使用示波器，同时测量开关节点SW的波形和自举电容两端（即BST引脚对SW引脚）的电压波形。

   • 正常情况：在低边管导通（SW为低）期间，你应该能看到BST-SW之间的电压被充电到一个稳定的值（接近VDRV - Vf_diode）。在高边管导通期间，BST-SW之间的电压应基本保持稳定，仅有小幅纹波。这个电压值应始终高于你所使用MOSFET的栅极阈值电压Vth（最好有2-3V裕量）。
   • 异常情况：如果BST-SW电压在高边管导通期间持续缓慢下降，或者在下一个周期开始前无法恢复到足够高的水平，说明自举电容充电不足。这可能是因为电容值太小、二极管压降太大、或者低边管导通时间（1-D）太短。

2. 极限压差测试：逐步降低输入电压VIN，同时监测输出电压VOUT的稳定性。

   • 当VIN降低到某个临界值时，VOUT会开始跌落，或者输出纹波会急剧增大。此时用示波器观察SW波形，可能会发现高边管的导通时间（高电平）已经达到极限，波形开始变形（如上升沿变缓，平台不平）。记录下此时的VIN和占空比，与芯片手册的D_max进行对比。
   • 这个测试可以验证你在特定负载、特定频率下，实际能实现的最小压差，是评估电源系统工作边界的重要方法。

3. 热成像检查：在接近最大占空比工作的条件下，用热成像仪观察高边MOSFET和电源芯片的温度。如果自举充电不足导致高边管驱动电压偏低，使其工作在线性区（而非饱和区），其导通损耗会急剧增加，导致异常发热。这是一个非常直观的判断依据。

7. 总结与个人体会

回过头来看，BUCK电路无法实现100%占空比，根本不是一个设计缺陷，而是在追求高效率、低成本、高性能（NMOS）的道路上，所必须接受的一个物理架构上的折衷。自举电路是一个极其巧妙、低成本地解决高边NMOS驱动问题的方案，而它的代价就是必须存在一个非零的续流时间来为自己“充电”。

在多年的电源设计经历中，我见过不少工程师在项目后期才被这个“最小压差”问题卡住，不得不更换芯片或修改方案。我的建议是，在项目架构选型的最早期，就要把输入电压的变化范围、所需的最小压差作为一个核心参数来考量。不要想当然地认为BUCK可以像LDO一样工作。仔细计算理论最小输入电压，并预留充足的裕量，同时关注芯片手册中关于最大占空比、自举二极管和电容选型的说明。

对于那些确实需要极低压差甚至“直通”能力的应用，现在市面上也已经有一些集成了电荷泵或采用特殊架构支持近100%占空比的“Buck-Boost in Buck’s Clothing”型芯片，它们在设计上更复杂，价格也更高，但为这类需求提供了可行的解决方案。最终，工程没有银弹，一切都是在性能、成本、复杂度之间寻找最佳平衡点。理解清楚像“占空比不能100%”这样的底层限制，正是我们做出正确权衡的基础。