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1. 项目概述：为什么MPC860的JTAG与字节序是嵌入式开发的基石

在嵌入式系统开发，尤其是基于PowerPC架构的MPC860 PowerQUICC这类经典处理器的项目中，硬件调试与数据一致性是两个绕不开的核心议题。很多工程师在项目初期可能更关注应用逻辑和驱动开发，往往把JTAG（边界扫描）和字节序（Endianness）视为手册里“知道就行”的背景知识。但根据我十多年的经验，恰恰是这两个“背景板”，在硬件调试、生产测试以及跨平台数据交互时，会成为决定项目成败的关键。当你的板子第一次上电，串口没有任何输出，或者从网络接收的数据总是错位时，深入理解JTAG和字节序机制，就是你手中最锋利的“手术刀”。

MPC860作为一款高度集成的通信处理器，其复杂性不仅体现在强大的通信外设上，更在于其内部精密的调试与测试架构。它完整实现了IEEE 1149.1标准，即我们常说的JTAG边界扫描。这项技术的本质，是在芯片的I/O引脚和内部核心逻辑之间，插入一系列可串行访问的边界扫描单元（Boundary Scan Cell），形成一个环绕芯片的“观察环”和“控制环”。这让你能在不焊接飞线、不破坏电路的前提下，直接控制或读取任何一个引脚的电平状态，这对于验证PCB走线连通性、排查焊接短路/开路故障、甚至进行有限的在线功能测试，具有不可替代的价值。

与此同时，MPC860提供了三种字节序模式：大端序（Big-Endian, BE）、真小端序（True Little-Endian, TLE）和PowerPC小端序（PPC-LE）。这并非简单的软件配置，而是涉及到CPU核心、缓存、系统接口单元（SIU）和DMA控制器等多个模块的协同地址变换与数据重排机制。选择错误的模式，或者没有在系统初始化时正确配置，会导致从内存加载的数据、通过DMA传输的数据，其字节顺序完全错乱，引发各种玄学般的bug。理解这三种模式的工作原理和配置方法，是确保你的系统能与外部大端或小端设备（如某些网络设备、外设控制器）正确对话的前提。

本文将结合MPC860用户手册的原始资料，深入拆解JTAG边界扫描的硬件逻辑、TAP控制器状态机、核心指令功能，并详细剖析三种字节序模式下的地址“变换”（Munging）与数据交换机制。我会分享在实际硬件调试和驱动开发中，如何配置和使用这些功能，以及我踩过的那些“坑”和总结出的实用技巧。无论你是正在调试一块全新的MPC860板卡，还是在为现有系统增加生产测试功能，这篇文章都能提供从原理到实操的完整参考。

2. JTAG边界扫描：硬件调试的“透视眼”与“遥控器”

JTAG边界扫描对于硬件工程师而言，就像给电路板装上了“透视眼”和“遥控器”。在MPC860这类高引脚数、BGA封装的芯片上，用万用表或示波器直接测量每一个引脚几乎是不可能的。边界扫描技术通过芯片内部预先设计好的扫描链，非侵入式地解决了这个难题。

2.1 TAP控制器：JTAG逻辑的“大脑”

一切JTAG操作都始于TAP（Test Access Port）控制器。它是一个由TCK（测试时钟）同步、TMS（测试模式选择）信号驱动的16状态有限状态机。很多初学者觉得状态机复杂，其实它的核心逻辑很简单：TMS信号在TCK上升沿的值，决定了状态跳转的方向。手册中的状态图是权威参考，但我的经验是，在编写调试脚本或使用调试器时，你通常不需要手动驱动这个状态机，工具软件（如OpenOCD、Dediprog等）会封装好这些底层操作。但你必须要理解几个关键状态：

• Test-Logic-Reset：这是上电或TRST信号有效后的状态。在此状态下，测试逻辑被禁用，芯片功能正常。这是确保JTAG操作不影响系统正常运行的起点和终点。
• Run-Test/Idle：一个“休息”状态，在发送不同测试指令间过渡。
• Shift-DR和Shift-IR：这是数据吞吐的核心状态。在Shift-DR状态，数据在选定的数据寄存器（如边界扫描寄存器或旁路寄存器）中移位；在Shift-IR状态，指令在指令寄存器中移位。
• Update-DR：这是一个关键动作。在移位完成后，进入此状态，才会将移位到边界扫描寄存器输出单元的数据，真正锁存并驱动到芯片引脚上。很多“为什么我移了数据但引脚没变化”的问题，就是因为没有成功进入并经过Update-DR状态。

实操心得：TAP信号连接要点手册第45.6节给出了TAP配置的推荐方案，这不仅仅是建议，而是稳定性的保障。尤其注意TCK引脚内部没有上拉或下拉电阻，必须外部通过一个电阻（通常4.7kΩ或10kΩ）下拉到地，以避免在上电期间或悬空时产生振荡，导致TAP控制器状态不可预测。TMS、TDI、TRST内部有上拉电阻，通常直接连接即可，但若使用，TRST建议通过一个二极管连接至PORESET，以实现可靠的上下电复位。

2.2 边界扫描寄存器：475位的“数字探针阵列”

MPC860的边界扫描链长达475位，涵盖了除XTAL、EXTAL、XFC这几个模拟引脚外的几乎所有信号。你可以把它想象成环绕芯片核心的475个数字探针和开关。每个引脚都关联着一个或多个扫描单元，其结构根据引脚类型（输入、输出、双向）略有不同。

• 输出单元：包含一个捕获触发器（Capture Flip-Flop）和一个更新触发器（Update Flip-Flop）。在Capture-DR状态，可以采样从芯片核心逻辑输出的数据；在Update-DR状态，可以将从TDI移位进来的数据驱动到引脚上。
• 输入单元：通常只有一个捕获触发器，用于采样输入引脚上的逻辑电平。
• 双向单元：最为复杂，包含数据单元和控制单元。控制单元的值决定了该引脚当前是作为输入还是输出。

手册中的图45-3至45-6清晰地展示了这些单元的结构。理解这些结构的意义在于，当你想通过JTAG强制某个输出引脚为高电平时，你需要：1）通过指令选择边界扫描寄存器；2）在Shift-DR状态，将对应比特位的值（根据BSDL文件映射）移位到该引脚对应的更新触发器中；3）经过Update-DR状态，锁存该值。这里的一个关键点是EXTEST指令，它会使能边界扫描寄存器对输出缓冲器的控制，并同时向MPC860系统逻辑发出一个内部软复位，使其进入一个已知的静止状态，避免内部逻辑与JTAG强制输出产生冲突。

2.3 核心指令解析：EXTEST, SAMPLE/PRELOAD, BYPASS

MPC860的JTAG指令寄存器是4位的，支持几条核心指令：

1. EXTEST (0000)：外部测试指令。这是进行电路板连通性测试的主力指令。它启用边界扫描寄存器，并复位芯片核心。在此指令下，你可以：

   • 控制输出：将特定数据移位到输出单元的更新触发器，然后驱动到引脚。
   • 捕获输入：将输入引脚上的电平采样到捕获触发器，然后移位出来检查。
   • 控制方向：对于双向引脚，通过控制单元设置其输入/输出方向。

   注意事项：EXTEST的“破坏性”使用EXTEST指令会复位芯片核心，这意味着正在运行的程序会停止，外设状态可能丢失。因此，EXTEST通常只用于裸板测试或深度硬件调试，不能用于在线调试运行中的系统。手册45.5节也警告，要避免使能输出到 actively driven networks（多个输出短接在一起），这可能损坏器件。

2. SAMPLE/PRELOAD (0001)：采样/预加载指令。这是一个极其有用且安全的指令。它有两个主要功能：

   • PRELOAD（预加载）：在进入EXTEST模式之前，必须先用此指令将已知的安全值（通常是当前输出值或高阻态）预加载到边界扫描寄存器的输出单元。如果不做这一步，直接进入EXTEST，输出引脚会进入随机状态，可能产生总线冲突。
   • SAMPLE（采样）：在芯片正常运行时（即非EXTEST状态），执行此指令可以“偷窥”芯片引脚上的实时信号状态，而不干扰系统运行。这对于诊断总线活动、中断信号等非常有用。

   重要提示：TCK与系统时钟不同步手册在45.4.2节特别用NOTE强调：TCK和系统时钟CLKOUT内部没有同步。因此，当你使用SAMPLE指令捕获动态信号时，你得到的是一个异步采样的“快照”，可能存在亚稳态问题。对于测量精确时序，这不是可靠方法，但对于观察静态电平或低频变化信号是足够的。

3. BYPASS (0X1X)：旁路指令。它将TDI和TDO之间路径缩短为一个1位的寄存器。当你的目标不是当前芯片，而是扫描链上的其他芯片时，使用此指令可以大幅提高测试效率。选中BYPASS后，在Capture-DR状态，这个1位寄存器会被清零，所以移出的第一位总是0，这是一个识别特征。

4. CLAMP (0101)：钳位指令。它选择旁路寄存器，但同时将边界扫描寄存器中当前锁存的值持续驱动到输出引脚上。这用于在测试其他器件时，将MPC860的输出固定在一个安全、已知的状态。

5. HI-Z (0100)：高阻指令。这是厂商可选指令，MPC860支持。它将所有输出驱动器（包括两态输出）置于高阻态。在板级测试中，当你想隔离MPC860，测试其他驱动同一网络的器件时，这个指令非常关键。

2.4 BSDL文件：扫描链的“地图”

手册提到BSDL（Boundary Scan Description Language）文件可在飞思卡尔（现NXP）网站获取。这个文件是进行JTAG编程的必备文件。它用标准语言描述了：

• 扫描链的总长度（475）。
• 每一位（Bit）对应哪个引脚。
• 每个引脚对应的扫描单元是输入、输出还是双向控制。
• 在EXTEST等指令下，每个单元的控制和数据类型。

没有BSDL文件，你就不知道移位进去的475位数据，哪一位对应着ADDR0，哪一位对应着DATA31。所有专业的JTAG测试软件（如Goepel， XJTAG）或开源工具链，都需要加载BSDL文件来解析扫描链。在项目开始阶段，务必找到并确认与你的MPC860具体型号和封装完全匹配的BSDL文件版本。

3. 字节序模式详解：数据世界的“语言翻译官”

如果说JTAG是硬件层的调试工具，那么字节序就是确保软件数据读写正确的基石。MPC860对字节序的支持非常灵活，但也因此带来了配置的复杂性。

3.1 三种模式的核心区别与硬件支持

MPC860支持的三种模式，其本质区别在于地址变换（Munging）发生的位置和方式，以及数据字节交换（Byte Swapping）是否发生。

大端序（BE）模式：这是PowerPC的“母语”，也是MPC860上电后的默认模式。数据在内存中的存储顺序与人类的书写顺序（高位在前）一致，且不进行任何地址或数据变换。所有内部模块（核心、缓存、U-Bus、外部总线）都使用大端序。

真小端序（TLE）模式：这是MPC860提供的一个非常实用的特性。在此模式下，外部总线呈现真小端序。这意味着，如果你将MPC860的内存总线连接到一个x86处理器或一个小端格式的存储设备，它们看到的数据排列顺序就是标准的x86小端格式。这是如何实现的呢？关键在于SIU（系统接口单元）的“解变换+字节交换”。

• 核心侧：当DC_CST[LES]=1时，核心对数据访问（Load/Store）的有效地址会进行“2-bit Munging”（与操作数长度有关，见手册表A-2）。例如，对于一个字（4字节）访问，地址不变；对于一个半字（2字节）访问，地址A[1]位取反（XOR 0b10）。这个变换后的地址被发送到U-Bus和缓存。注意，此时U-Bus和缓存上的数据字节顺序仍然是大端的。
• SIU侧：当访问来自MPC8xx核心时，SIU会进行逆向操作：对地址进行“2-bit Unmunging”，并对从U-Bus读取或要写入U-Bus的数据，在字（32位）边界内进行字节交换（Byte0<->Byte3, Byte1<->Byte2）。经过这一套组合拳，最终在外部总线上，数据就以小端格式呈现了。对于SDMA发起的访问（如外设DMA），SIU不做任何处理，因此外设的FCR[BO]需要设置为1x，SDMA控制器会处理地址变换。

PowerPC小端序（PPC-LE）模式：这是一种“模拟”的小端模式，旨在兼容某些为小端PowerPC环境编译的软件。它的特点是外部总线仍然是大端序。核心通过“3-bit Munging”（见手册表A-6）修改有效地址，使得对一个“逻辑上”小端对齐的标量数据的访问，被映射到物理内存中正确的大端存储位置。这种方式没有数据字节交换，只有地址重映射。因此，内存子系统（如SDRAM控制器）看到的数据依然是大端格式。这种模式会降低缓存效率，因为连续的逻辑地址访问可能映射到不连续的物理缓存行。

3.2 模式设置与初始化：一个容易出错的环节

手册附录A.6节详细说明了模式设置方法，但其中有些细节极易被忽略，导致系统启动异常。

1. 设置时机：必须在初始化例程的早期设置，并且一旦设置，在系统运行期间不应更改。切换模式需要核心运行在序列化模式（serialized mode），且缓存应被禁用。

2. 关键指令的地址对齐：这是最大的“坑”。

   • 从BE切换到PPC-LE：需要使用mtmsr指令设置MSR[LE]和MSR[ILE]。这条mtmsr指令本身必须位于一个奇数字边界（即地址A[29]=1）。因为一旦下一条指令开始，核心就进入了PPC-LE模式，会进行3-bit地址变换。如果mtmsr在偶数字边界，由于地址变换，它会被执行两次，可能导致不可预知后果。下一条指令将从mtmsr地址+8处获取（由于地址变换）。
   • 从PPC-LE切换回BE：同样用mtmsr清除MSR位，但该指令必须位于偶数字边界（A[29]=0）。下一条指令将从地址+12处获取。
   • 切换到TLE模式：通过mtspr指令设置DC_CST[LES]位。该指令必须位于偶数字边界。后续指令应存放在外部系统内存的小端格式中，或内部内存（如果存在）的大端格式中。

3. 外设配置：对于TLE模式，每个通信外设（SCC, SMC等）的FCR[BO]字段应设置为1x（10或11）。对于PPC-LE模式，应设置为01。这些参数位于缓冲区描述符（Buffer Descriptor）中，必须在激活相关外设��前正确设置。

踩坑实录：字节序设置导致的“幽灵”指令我曾调试一个从BE bootloader跳转到PPC-LE模式操作系统的引导过程。bootloader在BE模式下运行，最后一条指令是跳转到内核入口。跳转前，它在一个偶数字边界的地址���执行mtmsr指令试图切换到PPC-LE。结果系统跑飞。分析发现，由于mtmsr地址不对齐，指令被异常执行，MSR可能未正确设置，而随后的跳转地址也因未预期的地址变换而指向错误位置。解决方案：在bootloader中，专门编写一个位于奇数字边界的小段代码序列（通常就几条指令），专门负责模式切换，然后再长跳转到内核。确保切换代码的地址严格符合要求。

3.3 不同端口宽度下的数据访问示例

手册表A-3至A-5用具体例子展示了在TLE模式下，访问不同宽度（32位、16位、8位）内存时，数据在寄存器、内部总线（U-Bus/Cache）和外部总线上的格式变化。理解这些表格对于编写底层驱动和调试内存内容至关重要。

以TLE模式下的字（Word）加载为例：

• 逻辑（小端）地址0：存放字节11, 12, 13, 14（地址0存LSB14）。
• 核心：想访问地址0的字，经过2-bit munge（字访问不变），物理地址仍是0。它从U-Bus读到数据11, 12, 13, 14（大端格式，MSB11在低地址）。
• SIU：在外部总线上，执行字节交换，最终从内存物理地址0读取的数据是14, 13, 12, 11。
• 结果：核心寄存器最终得到值0x0b0c0d0e（假设字节11-14是0x0b-0x0e），这与小端内存布局0x0e0d0c0b在逻辑上是一致的，因为核心通过地址变换“认为”自己读到了小端数据。

对于8位端口，情况更复杂，因为一个32位访问需要拆成4个8位访问。SIU的字节交换和地址unmunging需要在这4个周期中正确完成。这要求你的内存控制器或外部总线接口能够正确处理这些拆分周期。

4. 开发调试实战：整合JTAG与字节序知识解决问题

理论最终要服务于实践。下面结合几个典型场景，展示如何运用上述知识。

4.1 场景一：新板卡上电，无任何输出

这是最令人紧张的情况。假设你已确认电源、时钟、复位基本正常。

1. 第一步：使用JTAG进行最基本的连通性测试

   • 目标：确认CPU的JTAG接口本身是连通的，并且能响应基本指令。
   • 操作：
     • 连接JTAG调试器（如FT2232H+OpenOCD）。
     • 确保TCK上有正确的时钟（通常几百kHz到几MHz开始尝试）。
     • 发送指令使TAP控制器进入Test-Logic-Reset状态。
     • 发送BYPASS指令，并尝试移位数据。如果能正确通过1位旁路寄存器移出数据（且第一位是0），说明TAP控制器和最基本的数据通路是好的。
   • 如果失败：检查TCK、TMS、TDI、TDO、TRST的焊接和连线，特别是TCK的下拉电阻。

2. 第二步：使用JTAG检查关键引脚状态

   • 目标：在不启动核心的情况下，检查配置引脚、复位信号等。
   • 操作：
     • 加载MPC860的BSDL文件到调试工具。
     • 使用SAMPLE/PRELOAD指令。注意：此时芯片未初始化，很多引脚可能是输入且状态不定，采样值可能无意义。但对于有上拉/下拉的配置引脚（如MODCK1,MODCK2用于配置时钟模式），采样值应与硬件设置匹配。
     • 更有效的方法是，在完成PRELOAD后，进入EXTEST模式。务必提前预加载安全值，比如将所有输出驱动为高阻或已知无效电平。然后你可以尝试控制一些简单的输出引脚（如某个GPIO），用万用表测量是否变化，来验证JTAG对输出的控制能力。

3. 第三步：结合字节序考虑初始化代码

   • 假设：JTAG测试通过，但串口仍无输出。你的bootloader可能因为字节序问题跑飞。
   • 分析：如果你的bootloader是用大端工具链编译的，但硬件设计或后续操作系统要求TLE模式，而你忘记在bootloader早期设置DC_CST[LES]，那么核心对内存的访问（取指令、读写数据）全部错位。
   • 使用JTAG进行内存探查：通过JTAG（如果调试器支持内存访问）直接读取内存起始地址的内容。对比你编译生成的二进制文件，看是否一致。如果不一致，很可能是字节序问题。注意：通过JTAG访问内存，其字节序取决于调试器软件和硬件的设置，通常需要明确指定。

4.2 场景二：网络数据包校验总是错误

假设MPC860的SCC2配置为以太网控制器，能收到数据包但CRC校验失败，或者应用层解析乱码。

1. 怀疑字节序问题：以太网帧数据是大端序（网络字节序）。如果MPC860系统运行在TLE或PPC-LE模式，而DMA传输或CPU访问数据时字节序处理不当，就会出错。
2. 检查点：
   • 确认系统字节序模式：检查启动代码中MSR和DC_CST寄存器的设置。
   • 检查SCC2的FCR[BO]设置：在TLE模式下，应设置为1x；在PPC-LE模式下，应设置为01。这个设置告诉SDMA控制器，在从缓冲区描述符和数据缓冲区存取数据时，如何进行地址变换。务必在激活SCC2之前，在缓冲区描述符中正确设置。
   • 检查缓冲区描述符和数据缓冲区的内存对齐：确保它们符合当前字节序模式下的访问要求。例如在TLE模式下，对16位数据的访问地址最好是2字节对齐。
3. 使用JTAG的SAMPLE功能：在系统运行时，用SAMPLE指令捕获SCC2相关引脚（如RXD、TXD、RCLK、TCLK）的状态。虽然不能测时序，但可以看是否有数据活动，初步判断物理层是否正常。

4.3 场景三：生产测试中的自动化电路板测试

JTAG边界扫描是进行PCB连通性测试（如开路、短路）的利器。

1. 编写测试向量：基于BSDL文件，为你的板卡编写测试向量。
   • 测试短路：在EXTEST模式下，将一个网络上的某个驱动引脚设置为0，将其他所有引脚设置为高阻输入或驱动为1，然后采样所有输入。如果其他引脚采样到0，则说明与驱动引脚短路。
   • 测试开路：将一个引脚设置为输出并驱动一个值（如1），然后将同一个引脚重新配置为输入并采样。如果采样到的不是驱动值，说明连接该引脚的走线可能开路（或者上拉/下拉电阻影响了结果，需要考虑）。
2. 处理双向引脚：需要小心操作控制单元，在驱动和采样间切换。
3. 集成到测试系统：使用支持IEEE 1149.1的自动化测试设备（ATE）或软件，批量执行这些测试向量，快速定位生产缺陷。

5. 常见问题与深度排查指南

在实际开发中，你会遇到各种奇怪的问题。下面是一些典型问题及其排查思路。

5.1 JTAG连接不稳定或完全失败

• 现象：调试器无法识别芯片，或时而连接时而不连。
• 排查：
  1. 电气检查：首先用示波器检查TCK、TMS波形。TCK必须干净、稳定。TMS在TCK上升沿必须稳定。特别注意TCK的毛刺和振铃，过长或畸变的边沿会导致状态机误判。
  2. 复位信号：确保TRST或PORESET在上电后有一个干净的低脉冲，将TAP控制器复位。如果使用TRST，注意其内部上拉，确保驱动能将其拉低。
  3. 电源与地：确保调试器和目标板的共地良好。MPC860的调试端口可能由VDDH供电，检查其电压是否正常。
  4. 扫描链配置：确认调试软件中设置的IR长度（4位）和DR长度（475位边界扫描或1位旁路）是否正确。

5.2 通过JTAG可以连接，但无法访问内存或内核寄存器

• 现象：能扫描到芯片，但读写内存全为0或全为1，或报错。
• 排查：
  1. 芯片是否已初始化？：通过JTAG连接时，芯片可能处于复位状态或时钟未启。一些调试器需要在连接后执行一系列初始化脚本（如设置时钟、解除复位等）。检查你的调试配置或OpenOCD脚本。
  2. 字��序影响：调试器访问内存时，需要知道目标的字节序。如果调试器配置为小端访问，而芯片实际运行在BE模式（或反之），读出的数据就是错的。在调试器设置中尝试切换字节序选项。
  3. 缓存与MMU：如果缓存或MMU已启用，通过JTAG的物理内存访问可能会绕过它们，直接访问内存，这可能导致数据不一致。在早期调试阶段，最好先确保缓存和MMU是关闭的。

5.3 系统运行中数据异常，怀疑字节序问题

• 现象：数据校验错误、指针跑飞、指令执行异常。
• 排查思路：
  1. 寄存器检查：在调试器中，直接读取MSR和DC_CST寄存器，确认LE、ILE、LES位的实际值。
  2. 内存数据对比：
     • 用调试器从某个已知地址（例如，一个已初始化的全局变量地址）读取一个字（4字节）。
     • 同时，让你的程序将这个地址的数据通过某个已确认工作正常的渠道（如一个在BE模式下初始化的串口）打印出来。
     • 对比两者。如果字节顺序相反，就是典型的字节序不匹配。
  3. 反汇编验证：查看异常地址附近的指令反汇编。如果指令本身看起来是乱码（不是有效的PowerPC指令），那很可能是取指时发生了地址或数据错位，强烈指向字节序或内存访问配置错误。
  4. 外设DMA数据检查：如果问题出现在通过SCC、SMC等外设收发数据时，重点检查该外设对应的缓冲区描述符中的FCR[BO]字段。这是最容易被忽略的地方。

5.4 使用EXTEST后系统无法恢复

• 现象：进行边界扫描测试后，重新给系统上电或复位，程序无法正常运行。
• 原因与预防：EXTEST指令会触发内部软复位，但可能不会复位所有外设寄存器。某些引脚被JTAG强制为特定电平（尤其是输出使能）后，可能在上电复位后仍然保持，造成总线冲突。
• 解决方案：
  1. 在测试序列的最后，务必使用HI-Z指令或将所有输出置为高阻态。
  2. 发送BYPASS指令，然后让TAP控制器回到Test-Logic-Reset状态。
  3. 对目标系统进行一次完整的硬件上下电复位，确保所有状态清零。

5.5 性能劣化，怀疑PPC-LE模式导致

• 现象：系统切换到PPC-LE模式后，整体运行速度变慢。
• 解释：正如手册A.5节所述，PPC-LE模式下的3-bit地址变换会导致缓存效率降低。因为连续的逻辑地址访问，经过变换后可能映射到不连续的物理缓存行，增加缓存缺失率。
• 建议：如果性能至关重要，且你主要与外部小端设备交互，应优先考虑使用TLE模式。TLE模式通过SIU在总线边界进行字节交换，核心和缓存内部仍是大端操作，对缓存性能影响较小。PPC-LE模式应仅用于需要运行遗留的小端格式PowerPC二进制代码的兼容性场景。

最后，我想强调一个贯穿始终的心得：阅读手册，但要理解其上下文。MPC860的用户手册内容浩瀚，关于JTAG和字节序的描述分散在不同章节。调试时，不要只看45章或附录A，要把它们与复位配置（第11章）、内存控制器、具体外设章节联系起来思考。例如，字节序模式会影响你如何解释内存控制器寄存器中的值，也会影响你通过JTAG读取到的内存内容。建立这种系统性的理解，才能在面对复杂问题时，快速定位到那个最关键的配置位或那个最容易出错的初始化顺序。MPC860虽然是一款有些年头的处理器，但其设计之精妙，在深入理解这些底层机制后，依然令人赞叹。掌握好JTAG和字节序这两把钥匙，你就能更自信地驾驭它，解决从硬件到软件的各种挑战。