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简介：这份资料围绕峰值电压采样保持电路展开，讲解基于采样保持器LF398与电压比较器LM311的完整设计方案。内容覆盖采样阶段与保持阶段的切换逻辑：当输入电压Ul高于输出电压Uo时，LM311输出高电平触发LF398进入采样；当Ul回落后，LF398锁定峰值电压并进入保持状态。电路还包含LM311集电极开路输出所需的上拉电阻，以及过电压检测电路对采样电容放电的控制，便于硬件设计师理解瞬态信号峰值的捕捉与存储机理。

包体为1个PDF文件，大小约23KB，虽体量精简但原理图与关键分析完整。目前已有3349人学习，适合从事模拟电路设计、硬件原理图设计或信号处理系统开发的工程师与学生参考查阅，有助于快速掌握峰值采样保持电路的器件选型、工作流程及实际调试要点。 做峰值电压采样保持电路那段时间，我几乎把采样保持的几个坑全踩了一遍。拿示波器看着保持电容上的电压慢慢往下掉，心里那个急。后来总结下来，这块电路说到底就是三件事：采样时跟得住，保持时漏得少，切换时干扰小。把这个想明白，电路就好做了。

这篇就把我的设计和调试经验完整梳理一遍。峰值电压采样保持电路是模拟信号链里的一个很实用的功能模块，常用于脉冲峰值检测、浪涌幅值捕捉、包络提取、电池脉冲电流峰值监测等场景。适合正在做信号采集、仪表放大器、电源监测、毕业设计或嵌入式采样前级的学生和工程师参考。

1. 峰值采样保持电路到底在解决什么问题

很多传感器输出的是连续模拟信号，但真正关心的可能只是某一个特征时刻的极值。比如雷击浪涌的最大电压、脉冲激光的峰值功率、电磁阀动作瞬间的电流尖峰。直接用ADC以固定速率采样，要么采样率不够错过峰值，要么为了抓到极值被迫满速采样，成本和功耗都扛不住。

峰值采样保持电路解决的就是这个矛盾：在信号达到峰值时把电压“冻结”在一个电容上，给后级ADC或比较器留出充足时间慢慢读取。对比之下它有几个不可替代的优势：

• 降低ADC采样率需求，普通低速高精度ADC也能采集高速脉冲峰值；
• 可以配合外部触发信号，只记录特定时刻后的峰值，过滤掉无效区域；
• 峰值保持结果稳定，便于后续做阈值比较、超限报警或数据记录。

这块电路的核心指标就三个：精度、速度、保持时间。精度取决于采样通路中运放失调和二极管压降的补偿程度；速度取决于充电电流对等效RC时常数的限制；保持时间则主要由电容漏电、运放输入偏置电流和开关漏电流决定。这三者互相牵制，工程上必须在面积、功耗和成本之间取舍。

2. 方案选型：三种常见结构怎么选

峰值采样保持电路的结构大体可以分成三类，设计之初就得定清楚。

2.1 二极管峰值检波：最朴素但误差大

最简单的实现是在输出端用二极管串联到电容，再通过电阻放电。信号正半周通过二极管给电容充电，峰值过后电容通过电阻缓慢放电，这样电容电压大致跟随信号峰值。这个结构优点是电路极简、成本低，但问题同样明显：

• 硅二极管正向压降0.6~0.7V，锗管也有0.2~0.3V，对弱信号来说这个误差根本“吞掉”了信号本身；
• 温漂明显，温度变化几十度，检测误差会越来越大；
• 放电电阻阻值选择很纠结，太大放电太慢跟不上连续脉冲，太小保持时间不够。

这个方案适合精度要求不高、信号幅度几伏以上、只做粗略指示的场合，比如简单的过压指示电路。

2.2 运放+二极管超结检测：经典补偿方案

把二极管放到运放的反馈回路里，就能利用运放的环路增益消除二极管正向压降。典型结构是电压跟随器的输出端串联二极管后接保持电容，同时从电容引回运放的反馈端。运放不断调整输出，直到电容电压等于输入电压，二极管压降被运放自动补偿掉。

这套方案能做到不错的精度，响应速度取决于运放的压摆率和对电容的充电电流能力。选运放时需要重点看压摆率和输出电流。实际中常用OP07、LM358这类通用运放做中低速场景，高速场景则用AD8065、OPA827这类高带宽器件。LM358虽然便宜常见，但压摆率只有0.3V/us左右，捕捉几十纳秒级窄脉冲基本不行。

2.3 专用采样保持芯片：省心但价格高

如果项目周期紧张、不想在分立电路上花时间，LF398、AD783、AD585这类专用采样保持芯片是更稳的选择。LF398内置了模拟开关和输出缓冲器，外部只需接一个保持电容就能工作，控制逻辑也很直接。

以LF398为例，工作电压典型±5V到±18V，采样建立时间约4us（0.01%精度），保持状态下电压跌落率与外部电容值直接相关：1uF电容时约每毫秒跌几毫伏，100pF时跌落就快得多了。这类芯片适合与单片机系统集成，缺点是贵、渠道假货多，需要仔细甄别。

我把三者对比整理了一下：

我的看法是，学习阶段建议用运放+二极管方案自己搭一遍，真正搞懂环路补偿原理；产品化时优先考虑专用芯片，省的天天跟电容漏电较劲。

3. 核心环节拆解：保持电容、模拟开关与缓冲输出

不管选哪种方案，有几个细节是绕不过去的，直接影响实测效果。

3.1 保持电容怎么选：容量和漏电的博弈

保持电容是整块电路的核心。容量太小，采样充电快、能跟高速信号，但保持阶段电压跌落明显；容量太大，能扛得住更多漏电流，但采样时间变长，而且电容本身介质吸收效应会影响精度。

一个工程经验是先估算可接受的电压跌落量。比如用1uF聚丙烯薄膜电容，后级是10M欧输入阻抗的缓冲放大器，再算上运放输入偏置电流约50pA（LM358，但实际更大），通过I*t/C估一下跌落速度，在要求不高的情况下足够支撑几十毫秒的保持窗口。如果用普通电解电容，漏电流可能达到微安级，保持效果会差很多。

电容类型优先顺序如下：

• 聚丙烯薄膜电容（CBB）：介质吸收小、漏电极小，高端仪器首选；
• 聚苯乙烯电容：性能好但体积大、不太常见；
• C0G/NPO贴片陶瓷电容：高频特性好、温度系数好，适合中容量场合；
• X7R陶瓷电容：容量大但压电效应和介质吸收明显，弱信号场景慎用。

3.2 模拟开关怎么接：电荷注入是个大坑

采样保持电路里的模拟开关，无论是内置的还是外接的（比如CD4066、DG419），都存在电荷注入问题。开关从导通切换到断开时，栅极控制信号会通过寄生电容向保持电容注入一个小电荷包，导致保持电压产生一个台阶跳变，这叫“馈通”。

解决办法有几招：控制信号通过一只几k欧的串联电阻再接到开关控制端，再并联一小电容到地，降低控制沿的尖锐度；或者选用低电荷注入的模拟开关，比如ADG419、DG449这类专门为采样保持设计的型号；还可以采用差分补偿结构，用两路对称开关抵消注入电荷。

实测下来，一个简单的RC整形就能把馈通毛刺降低至少一半，虽然会稍微增加开关时间，但对绝大多数应用是值得的。

3.3 输出缓冲：不能让测量设备“偷走”电荷

保持电容上的电压非常脆弱，任何连接上去的测量设备都会通过输入阻抗抽取电流，导致电压跌落。所以必须加一级高输入阻抗缓冲器，用电压跟随器隔离。这个缓冲器的输入偏置电流，直接决定了电路的最终保持能力。

这里一个小技巧是可以先把采样保持输出经过一阶RC滤波再送ADC，而不要在保持电容本身后面直接加滤波，否则会额外增加漏电路径。后级可以用仪表放大器做差分转单端或增益调整，这样能进一步抑制共模干扰。

4. 实操过程：从模块到完整的峰值检测通道

下面是我验证过的一套比较完整的电路设计方法，搭建顺序从整体框路到具体取值。

4.1 整体信号链路设计

峰值采样保持电路一般不孤立存在，它更像一个信号链模块。我习惯的接法是：输入保护 → 前置缓冲/增益 → 峰值采样保持 → 后级缓冲 → ADC。

输入保护在高电压场景必须加，可以用TVS管和串联电阻组合，防止浪涌打坏运放。前置缓冲隔离输入源并做阻抗变换。峰值采样保持是核心模块。后级缓冲给ADC提供低阻抗驱动，必要时加电压跟随器。

4.2 运放选择与关键参数计算

选择主运放时，关键的三个参数是压摆率、输出电流、输入偏置电流。假设我们要捕捉一个1us内从0V上升到5V的脉冲峰值，则最小压摆率等于5V/1us，即5V/us。如果选LM358（压摆率0.3V/us），它根本跟不上这么快的沿；此时需要至少5V/us以上的运放，比如OPA827（压摆率30V/us）、AD8065（180V/us）都可以。

充电电流的计算同样关键。假设保持电容C=10nF，电压从0V充到5V，时间1us，需要的平均充电电流是C乘以dU/dt，算出来50mA。普通运放输出电流很难达到这个值时，就需要加推挽扩流电路，或者用更大驱动能力的运放。这就是为什么很多高速峰值检测电路里普遍用同相放大器加外部缓冲管的原因。

4.3 参考电路搭建步骤

我推荐从LF398芯片搭建开始，成功率最高，适合理解完整采样保持行为。搭建步骤如下：

1. 电源部分：LF398采用双电源±5V或±12V，用LDO或者三端稳压器供电，在电源引脚就近加10uF+100nF去耦电容；
2. 保持电容：在保持电容引脚（通常标CH）接一个10nF到100nF之间的CBB电容，地回路要短；
3. 控制逻辑：采样/保持控制引脚接单片机IO，采样时给低电平或高电平（查数据手册确认逻辑电平），信号源输出阻抗压到最低状态；
4. 输入信号：信号从同相输入端接入，输入源阻抗尽量低，如果源阻抗高，前面必须加缓冲；
5. 后级输出：输出引脚直接接电压跟随器后送ADC，跟随器选JFET输入的TL082之类，输入偏置电流极低；
6. 上电测试：先用信号发生器给一个1kHz正弦波，控制脉冲给低电平足够长的时间，让电路工作在全跟踪模式，用示波器确认输出跟随输入。

在测试中逐步验证：正弦波跟踪，输出波形与输入一致；施加控制脉冲进入保持模式，输出在保持位置定格；然后观察保持电压的跌落速度，检查是否有毛刺和台阶。

4.4 分立电路版本的调试要点

如果你和我一样想用运放+二极管自己搭，建议优先级顺序为：LF353或TL082做前级缓冲，1N4148做二极管，CBB电容做保持电容，运放构成单位缓冲作为后级。

调试的时候特别要注意几个点：

• 二极管方向别接反，测量时注意极性标识；
• 环路反馈必须从保持电容正确引回反相输入端，接错就变成了比较器而不是跟随器；
• 如果出现振荡，在反馈电容两端并联几pF到几十pF的相位补偿电容，降低高频增益；
• 上电初期输出不稳是很常见的，先检查电源和地的顺序，再检查运放是否工作在闭环状态。

5. 常见问题排查与避坑速查表

踩过那么多坑之后，我把最常见的现象和对应解决方法整理成一个速查表，方便后续调试时对照。

除了这张表，我再补充几个平时容易忽略的点。

第一个是采样保持控制信号的时序。如果控制信号下降沿（进入保持）正好落在信号变化最剧烈的沿上，保持值可能正好卡在斜坡上，造成很大误差。解决方法是让保持命令错开信号突变窗口，或者用比较器自动触发保持。

第二个是保持阶段的干扰。保持状态下，任何耦合到保持电容节点的干扰，无论是数字开关噪声还是电源纹波，都会直接叠加到保持电压上。保持电容节点应该被布置成星形接地，周围用地包围，避免靠近数字信号线。

第三个是上电顺序。某些运放在电源尚未稳定时，输出可能进入不确定状态，给保持电容充上错误电压。可以在控制逻辑上加一个上电复位信号，系统复位后再进入正常采样流程。

6. 实测经验与性能提升方向

按照上面这套流程搭完电路之后，我做了一组信号链实测：信号源输出2V、100Hz正弦波，LF398保持电容选33nF，后级用TL082缓冲，控制脉冲宽度2ms。实测下来，保持状态下100us内电压跌落小于1mV，跟踪状态下输出与输入波形基本重合。后级ADC采用12位采样，采集到的峰值误差在5mV以内。这套指标对大多数嵌入式项目来说已经够用。

如果想进一步提高性能，可以从两个方向入手：

一是采用“双重采样保持”结构，前级快速采样到一个小电容上，后级再慢速搬运到大电容；前级负责跟速度，后级负责保持持久性，各自优势互补。

二是把峰值保持与比较器联动，在信号超过设定阈值后自动保持峰值并触发单片机中断。比较器输出作为控制信号接入保持芯片的逻辑端，形成闭环自动峰保系统。这个玩法在瞬态监测设备里非常实用，整机不用一直跑ADC，大幅降低功耗。

另外提一句热词搜索里常见的“Buck电路”、“Boost电路”等电源拓扑，本身跟峰值采样保持电路关系不大，但如果你的峰值检测电路用在开关电源输出纹波监测或电流峰值采样上，那电源稳定性和采样电路接地处理就变得极为重要。开关节点的高dV/dt会通过地弹和空间耦合侵入采样保持部分，这时候屏蔽和布局的价值比任何电路结构优化都更关键。

7. 经验小结

整个峰值采样保持电路的设计难点从来不在原理图本身，而在保持电容节点的漏电控制、模拟开关的电荷注入抑制，以及整体信号链路的干扰防护。把这几个地方盯住了，电路表现就不会差。

我个人最推荐的入门路径是：先用LF398搭通整个采样保持流程，再用运放+二极管方案复刻一遍核心原理，最后根据自己的项目需求优化参数。三个阶段走完，这块电路的门道基本就能摸透。后面在做高速、高精度测量项目时，你会发现这套功底特别值钱。

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