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简介：二〇二四年电赛A题AC-AC变换电路并联运行的设计方案打包分享，面向电赛参赛者、电力电子方向学生及毕业设计相关人群，重点解决并联运行电路的主功率回路、驱动与辅助电源设计问题。资源以一个PDF文件呈现，大小约一百八十三KB，集中整理了原理图、代码、仿真文件与论文等核心材料。原理图部分清晰划分了主功率回路、MOS驱动、辅助电源三个功能区域，并标注了板级间的信号引出与功率引出接口；主功率回路选用IRF540N等器件构成，驱动部分采用光耦隔离配合12V隔离电源模块，辅助电源则通过220VAC转12VDC模块单独供电，各模块连接关系在图中均有注释说明。代码与仿真描述提供了AC-AC并联运行的控制思路，论文部分还给出了调试与验证结果，整体方案经过验证；对于需要自主复现同类电路的读者，可以按原理图检查器件选型，结合仿真调整控制参数，加快设计落地。目前已有三千五百四十二人学习/下载，适合需要快速吸收完整设计思路的备赛者。

1. AC-AC变换电路并联运行：从单机可靠到并联稳定的关键一步

“AC-AC变换电路并联运行”这个题目，表面看只是把两台交流变换器的输出端接在一起，实际动起手来却常常让有经验的人翻车：单台样机带满载纹丝不动，两台一并联，轻则环流超标、一台发烫另一台空载，重则触发保护甚至炸掉晶闸管。原因是交流并联同时被电压幅值、频率、相位和回路阻抗四个变量夹击，任何一处不匹配都会转化成真实的电流应力。这篇文章以24年电赛A题为背景，从原理图设计、参数计算、PLL锁相与控制代码、仿真验证到硬件实测，梳理一条可以直接复现的AC-AC并联运行落地路径。内容同样适合做交流调压、调功或稳压电源并联扩容的工程师参考，读者可以在拿到验证过的方案后直接对照自己的设计进行修改。

2. AC-AC变换并联运行的原理：同步、环流与失稳边界

2.1 相位同步为何是并联运行的先决条件

AC-AC变换电路在电赛A题里最常见的形式是相控式交流调压器，即用双向可控硅或两只晶闸管反并联，通过改变触发角来调节输出电压。

两台同样的变换器要并联向一个负载供电，第一道门槛就是输出电压要“同频、同相、同幅”。电网频率由市电决定，两台变换器都是50Hz输入，频率天然一致；可相位却不一定一致，因为每台设备内部的触发延时、过零检测电路和软件中断响应都有微小差异，导致输出电压的过零点出现几度到十几度的偏差。这个偏差在单机运行时没有影响，一旦并联，两台设备的瞬时电压不相等，电压差会直接作用在连接回路里，产生远超负载电流的环流。

幅值不同也会引起环流，但幅值可以通过闭环调节校准；相位偏差却是动态的，必须靠锁相环持续跟踪输入电压过零点，让每台变换器的触发角都以同一个参考点为起点重新计算。理解了这一点，就会明白AC-AC并联运行的核心不是“怎么把两个变换器焊在一起”，而是“怎么让两台设备的开关时序对齐到同一个相位基准上”。

2.2 环流的物理本质与等效计算模型

并联环流的物理模型非常直观：把两台AC-AC变换器分别等效为两个交流电压源，它们的输出端通过线路阻抗和均流电感连接在一起。当两台设备输出电压存在幅值差或相位差时，回路中会出现一个不经过负载、只在两台设备之间流动的电流，这就是环流。

工程上估算环流大小常用以下公式：

import numpy as np # 两台AC-AC变换器并联的环流估算 # 参数：输出电压有效值、相位差、回路电阻、回路电感、电网频率 V1 = 220.0 # 变换器1输出电压有效值 V2 = 220.0 # 变换器2输出电压有效值 theta_deg = 2.0 # 输出相位差（度） R = 0.05 # 环流回路等效电阻（欧姆） L = 0.5e-3 # 环流回路等效电感（亨利） f = 50.0 # 电网频率 theta = np.deg2rad(theta_deg) w = 2 * np.pi * f # 将电压差分解为实部与虚部 dV_real = V1 - V2 * np.cos(theta) # 幅值差分量 dV_imag = V2 * np.sin(theta) # 相位差分量 Z = np.sqrt(R**2 + (w * L)**2) I_huan_peak = np.sqrt(dV_real**2 + dV_imag**2) / Z I_huan_rms = I_huan_peak / np.sqrt(2) print(f"相位差 {theta_deg}° 时，环流有效值约 {I_huan_rms:.1f} A")

这个计算脚本的物理意义是：把相位差换算成正交电压分量，再除以环流回路的阻抗，得到峰值环流。参数调整的要点有两个方向——改变相位差或幅值差属于控制侧，改变回路电感则属于硬件侧。我一般会先在脚本里代入期望的相位差指标，反推出均流电感的下限值，再结合成本选择饱和电流足够大的电感。

2.3 常见失稳模式与边界参数

表里的参数边界在实测中比理论值更严苛。例如相位差2度看起来不大，但按照2.2小节的模型，在0.5mH的回路电感下环流可达数十安培，足以让额定电流50A的晶闸管在几分钟内过热。因此，并联运行设计的第一步不是加大器件余量，而是把相位差压进一个可控范围里。

3. AC-AC并联运行的主电路原理图设计与参数计算

3.1 主电路拓扑选型：可控硅反并联与双向可控硅的取舍

电赛A题背景下，AC-AC变换主电路常见做法是选用双向可控硅（Triac）或两只单向晶闸管反并联。两者各有侧重：双向可控硅驱动电路简单，一路触发信号即可，但换流能力弱，在高di/dt或感性负载下容易误触发；反并联晶闸管则需要两路隔离触发信号，电路稍复杂，却拥有更高的dv/dt承受能力和更可靠的正负半周对称性。

我一般建议在并联运行的赛题方案中选反并联晶闸管，理由是并联工况下设备间的相互干扰会让触发信号更容易受环境影响，反并联结构可以用脉冲变压器实现强弱电隔离，避免控制板与主电路共地引入噪声。原理图上，两只晶闸管的门极分别接脉冲变压器二次侧，一次侧由MCU的定时器输出经驱动芯片放大。负载侧需串联均流电感，同时在每个晶闸管两端并联RC吸收网络，吸收尖峰电压，防止并联回路中的瞬态振荡击穿器件。

3.2 触发角与输出电压的计算校验

相控式调压器的输出有效值与触发角呈非线性关系，设计阶段需要先算出触发角调节范围对应的输出电压，才能确定反馈控制的目标值。下面的Python脚本用来校验触发角和输出电压的对应曲线：

import numpy as np def ac_phase_control_rms(Vin, alpha_deg): # 单相相控交流调压，阻性负载，求输出电压有效值 alpha = np.deg2rad(alpha_deg) factor = 1 - alpha / np.pi + np.sin(2 * alpha) / (2 * np.pi) return Vin * np.sqrt(max(factor, 0.0)) Vin = 220.0 for alpha in [0, 30, 60, 90, 120, 150, 170]: vout = ac_phase_control_rms(Vin, alpha) print(f"触发角 {alpha:3d}° -> 输出电压有效值 {vout:7.2f} V")

脚本输出可以看到，触发角0度时输出接近全压，90度时输出降为输入电压的70.7%，170度时几乎关断。这个非线性意味着如果控制代码直接用线性PID去调节触发角，系统在90度附近会非常敏感，在小角度区域又响应迟钝。实践中我更喜欢把控制环建立在“目标电压有效值”上，先反解出触发角，再用PID做微调，这样并联均流调节的收敛速度会快很多。

3.3 原理图绘制与器件选型表

原理图绘制时，我一般会遵循三个原则：交流主回路用粗网络标签分段标识，火线和零线从端子排到可控硅到电感再到负载一路不交叉；门极触发线远离主功率走线，避免干扰；地线采用星型接地，控制板的数字地、模拟地和驱动地单点汇合。原理图中所有关键器件标上主要参数，方便后续直接生成BOM。

原理图的网络标签和器件标号规范与否直接决定后续调试效率。芯片和连接器的位号、电源网络的正负标记、主功率走线的线宽标注，这些在绘制时多花十分钟，后面检查PCB和写论文时能省几个小时。并联运行的原理图尤其要画出两个变换器的公共连接点，确保两个功率地之间存在明确的回流路径，否则电流会通过信号地串扰。

4. AC-AC并联运行的PLL锁相与移相控制代码

4.1 PLL锁相环在AC-AC并联中的最小原理

PLL的全称是锁相环，在AC-AC并联运行中承担的是“让每一台设备的触发时刻都对齐一个公共参考点”的任务。电网电压经过过零检测电路后输出方波，MCU捕获方波的边沿，测量相邻过零点的时间间隔，从而推断出电网频率和相位。锁相环不是简单地每次过零事件就重新同步，而是要用软件维护一个“预测相位”，用捕获到的真实过零时刻去校准它，避免单次干扰导致整周期抖动。

最小PLL系统的实现是：用一个定时器连续计数，计数周期对应50Hz半周期；过零中断发生时，读取当前计数值，与理想值比较得到误差，用这个误差修正定时器的自动重载值，使计数器与电网频率保持同步。锁相稳定之后，把触发角和当前计数值关联起来，在计数达到设定值时输出触发脉冲，就实现了移相控制。热词里常搜到“pll锁相环原理图”，实际控制板上就是过零光耦、定时器输入捕获通道和一个外部中断引脚，原理图并不复杂，重点是软件中的同步算法。

4.2 基于STM32F103C8T6的过零检测与移相触发代码

STM32F103C8T6在赛题方案里出镜率极高，原因在于它自带多路高级定时器，输入捕获和输出比较可以同时工作。下面是一段经过验证的核心代码框架，完成过零捕获、锁相校正和移相脉冲输出：

// 基于STM32F103C8T6的软件PLL锁相与移相触发 // TIM2通道1捕获电网过零上升沿 // TIM3通道1产生移相后的触发脉冲 volatile uint16_t zc_capture = 0; // 本次过零计数值 volatile uint16_t zc_last = 0; // 上次过零计数值 volatile uint16_t half_cycle = 10000; // 50Hz半周期的定时器计数初值 volatile uint16_t alpha_phase = 3000; // 触发角对应的比较值，由上层PID更新 void TIM2_IRQHandler(void) { if (TIM_GetITStatus(TIM2, TIM_IT_CC1) != RESET) { TIM_ClearITPendingBit(TIM2, TIM_IT_CC1); zc_capture = TIM_GetCapture1(TIM2); // 计算实际半周期计数，平滑滤波后修正锁相周期 uint16_t measured = zc_capture - zc_last; zc_last = zc_capture; half_cycle = (half_cycle * 3 + measured) / 4; // 一阶低通，抑制过零抖动 // 根据触发角更新TIM3比较值 TIM_SetCompare1(TIM3, alpha_phase); TIM_SetAutoreload(TIM3, half_cycle); } }

这段代码的逻辑是：TIM2捕获过零边沿并计算实际半周期长度，把测量值经过一阶低通滤波后作为锁相周期；TIM3的自动重载值跟随half_cycle，当计数达到alpha_phase时输出比较匹配，触发脉冲就出现在设定的相位位置。alpha_phase是上层均流PID的输出，通过改变它就能移动触发时刻，从而调节输出电压和均流程度。

参数调节的关键点有两个：half_cycle的滤波系数“3/4”决定锁相环的动态响应，系数越大追踪越快，但对过零抖动更敏感，现场干扰明显时我会改成“7/8”；alpha_phase的取值范围必须限制在一个略小于half_cycle的区间内，防止触发角越过180度导致下一次边沿误触发。

4.3 均流调节与触发角动态修正

两台AC-AC变换器并联后，如果输出电压幅值相等但相位有偏差，环流依然会出现。工程上常用的均流策略是“电压下垂法”加“相位微调法”组合：先在每个变换器的输出回路里串联少量阻抗，让负载电流自然均衡，再根据两路电流差值微调触发角。

均流调节的代码实现在控制主循环中周期性执行，周期建议取10~20ms，即每半个或一个电网周期调节一次。调节量要加死区：电流差小于额定值5%时不动作，大于20%时限制单步调节量，防止环流振荡。

触发角调整量换算到定时器比较值时，要注意定时器计数频率和电网频率的对应关系。72MHz主频下，若定时器分频为72，则计数频率1MHz，50Hz半周期计数值为10000，1度相位对应约55.6个计数。所以代码中的alpha_phase精度至少要做到28个计数，即0.5度以内，否则并联环流会因量化误差而始终存在。

5. AC-AC并联运行仿真的最小模型与均流判据

5.1 仿真文件的最小组成与模块选择

拿到一套验证过的仿真文件，第一步不是打开就点运行，而是先检查它的模块组成是否完整。一套能说明问题的AC-AC并联仿真最小模型，必须包含四个要素：电网电压源、两台参数可调的AC-AC变换器模型、连接回路的均流电感、以及用于观测环流和均流度的测量模块。

在MATLAB/Simulink环境下，电网电压源用Sine Wave模块生成，频率50Hz、幅值311V；AC-AC变换器可以用Simulink自带的Thyristor模块搭建，触发信号由脉冲发生器控制，也可以直接用受控电压源做行为级建模。行为级建模的仿真速度快，适合调节控制参数；器件级建模能反映换流过程，适合验证触发时序。我一般会先做行为级模型验证控制逻辑，再在论文里放一组器件级模型的波形图。

热词里“仿真文件”通常指的就是这套同时包含控制算法、主电路和判据脚本的完整工程，文件内部应通过MATLAB脚本把仿真参数集中放在开头，不要散布在各个模块参数框里，否则修改一次工况要翻好几个对话框。

5.2 仿真参数的设置与同步触发配置

两个变换器的触发信号在仿真里要刻意制造一个小的初始相位差，比如2度，用来验证锁相环是否能把相位拉回一致。如果仿真结果中的环流在50ms内收敛到初始值的10%以内，说明锁相和移相控制逻辑正确；如果环流持续振荡，先检查触发信号是否与过零信号同步，再看均流调节的增益是否过大。

5.3 利用MATLAB脚本判读均流度

仿真跑完后，均流度不能靠肉眼估计，建议在模型里添加To Workspace模块，把两台设备的输出电流和母线电压导出到工作区，再用脚本计算关键指标。以下代码可以自动完成读取和均流度计算：

% 从Simulink工作区读取并联运行仿真结果 % 变量名根据实际To Workspace模块命名调整 i1 = simout_I1.Data(:, 1); % 变换器1输出电流 i2 = simout_I2.Data(:, 1); % 变换器2输出电流 t = simout_I1.Time; % 取最后3个周期的稳态数据 index = t > (t(end) - 0.06); i1_steady = rms(i1(index)); i2_steady = rms(i2(index)); % 计算均流度 share1 = i1_steady / (i1_steady + i2_steady) * 100; share2 = 100 - share1; fprintf('变换器1均流度: %.2f%%\n', share1); fprintf('变换器2均流度: %.2f%%\n', share2); % 环流通过两路电流之差得到 i_huan = i1 - i2; fprintf('环流有效值: %.2f A\n', rms(i_huan(index)));

这段脚本的输出格式适合直接放进论文作为验证表格的数据来源。均流度在50%附近对称是理想情况，工程上两台设备均流度偏差在5%以内就认为满足要求；环流有效值需要小于单台额定电流的10%，比大于20%的案例说明均流电感选取值偏小，需要回第3章的脚本重新核算。

仿真验证的意义是做“故障预演”：把电网电压跌落5%、触发角突变、负载翻倍三种场景依次加在模型上，观察环流是否超限。这些结果在竞赛评审时比单点工况波形更有说服力，因为并联运行的可靠性恰恰体现在非平衡工况下。

6. AC-AC并联运行的硬件验证与论文图表素材

6.1 示波器实测的项目与判断标准

硬件调试时，示波器同时测量两侧输出电压的过零波形和两路输出电流的波形。判断锁相是否成功的标准是：两台设备输出电压的过零点时间差恒定且小于0.2ms，对应相位差小于3.6度；在示波器上把CH1设为变换器1的电压、CH2设为变换器2的电压，用延时光标读出两个过零点的差值，这个值在几分钟内的漂移不超过50us才能说明PLL锁得足够稳。输出电流的均流度则用电流探头分别测两路电流的有效值，计算方式与仿真脚本一致，并记录触发角在30度、60度、90度三个工况下的均流度数据。

6.2 分级加载的稳定性验证流程

并联系统的稳定运行不能只在满载下看一次波形就结束，我一般采用分级加载的测试流程：先让两台设备空载并联，确认环流为零、过零检测一致；再带20%负载运行5分钟，观察环流波形是否有周期性摆动；随后分别加到50%和100%，每级记录电流有效值和设备温升。整个过程中触发角由MCU自动调节，示波器全程监测输出电流，一旦出现环流有效值超过额定值10%的情况，立刻停止加载并记录故障点。这个流程能定位到“锁相慢”还是“均流调节振荡”哪一类原因。

6.3 论文中需要呈现的验证图表与数据组织

经过验证的项目，论文里至少应包含四类图表：一是并联运行整体系统的原理框图，标明两台变换器、均流电感和负载的连接关系；二是PLL锁相环在失锁和锁定两种状态下的对比波形，直接用示波器截图；三是触发角分别为30度、60度、90度时的均流度实测数据表；四是加载到100%时的环流电流波形与热成像照片。四类图表中，数据表是评审快速判断方案可靠性最有效的形式，表格里必须给出设定触发角、实测输出电压、变换器1电流、变换器2电流、均流度和环流有效值六个字段，每行数据对应一个工况。

最后再提一个能直接提高调试效率的动作：在正式测试前，把均流电感的电流方向用标签贴好，确保两台设备的输出电流都流向同名端后再合闸。并联运行的大部分硬件端异常都发生在连线初期，名称混乱的接线比代码bug更容易造成可控硅损坏，理清电流路径之后按6.2的流程逐级加载，整机验证一般可以一次通过。

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