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每年ECOC的Post-Deadline Papers（PDP）一放出来，光通信圈子的讨论基本就定调了。我第一时间把那篇热度最高的论文翻完，标题里的几个关键词确实扎眼：硅光微环调制器MRM、90GHz带宽、8个波长×600Gbps、2公里空芯光纤。做硅光的人都很清楚，微环调制器理论上有面积小、功耗低、驱动电压小的优势，但带宽一直是短板——常规器件做到50GHz左右就非常吃力，90GHz这个数字直接把MRM推到了单波600G量级的系统舞台中央。这篇不单独聊某个孤立指标，而是把“高带宽调制器＋多波长系统＋空芯光纤”串成一个完整方案来解读，非常适合光模块、硅光芯片、数据中心互联方向的工程师参考。

1. ECOC PDP现场复盘：90GHz硅光微环调制器凭什么刷屏

1.1 为什么PDP论文比普通展台演示更值得关注

先扫盲一句：PDP不是厂商新闻稿，而是会议截稿之后递补进来的高影响力论文，审稿标准比常规投稿更严，通常只接收“确实有突破性进展、数据完整、同行无法轻易复现”的工作。所以能在PDP环节看到某个器件指标，基本等于给这项成果做了一次同行背书。

华为这篇PDP放出的信息，表面上是“90GHz带宽MRM＋8λ×600Gbps＋2km空芯光纤”三段式表演，但把三件事拼在一起看，信息量完全不同。它说明的不只是某个器件达标了，而是整套硅光集成方案已经具备支撑下一代超高速数据中心的系统级能力。而且选择空芯光纤作为传输媒介，明显是冲着“超低时延＋低非线性”这两个实芯光纤的长期痛点去的，背后藏着对应用场景的预判。

行业里对这项工作的讨论热度很高，核心原因在于MRM带宽的天花板被顶开了。以往大家讨论单波400G或600G，第一个想到的是薄膜铌酸锂或者InP外调制器。硅光MRM在成本、集成度上虽然占优，但调制带宽不足，往往只能做中短距离的次优解。90GHz这个数字一旦成立，中短距场景里硅光方案的综合性价比就会重新被估值。

1.2 拆解这条消息背后的三个关键数字

我们来逐个拆。

第一个是90GHz带宽。带宽决定了调制器能承载多高符号率的信号。按奈奎斯特和根升余弦滤波的经验公式，信号所需带宽大概是波特率的1.05到1.2倍。假设单波600Gbps线路速率采用双偏振16QAM（DP-16QAM），符号率是600÷8=75Gbaud，考虑约15%的链路开销后接近86Gbaud，那么所需带宽就要落在90GHz上下。所以90GHz不是随便刷出来的好看数字，它正好卡在单波600G这个档位的脖子上。

第二个是8个波长×600Gbps。把8个波长在C波段里做波分复用，总容量就是4.8Tbps。这里有意思的不是总容量本身，而是单芯片、多波长、高波特率三个条件同时成立。传统方案里做8波长可以用独立激光器加外调制器，体积和功耗都不小。MRM阵列天然适合波长复用场景，因为每个微环的谐振波长可以通过加热器微调，相当于把“物理层滤波＋调制”合并在一个单元里，系统集成度更高。

第三个是2km空芯光纤。很多人一看2km觉得数字不大，但空芯光纤的传输窗口和模式特性与常规单模光纤差异很大，能把高速信号跑通2km本身已经要解决耦合、模式串扰、链路插损等一系列问题。这个距离放到数据中心里也足够覆盖典型机柜间和楼栋间的互联需求。空芯光纤的意义不在长度，而在它带来的低时延和低非线性储备。

2. 微环调制器MRM的核心原理与90GHz带宽的实现难点

2.1 硅光微环是怎么工作的，为什么带宽被卡住

微环调制器的结构可以简化成“一根直波导＋一个环波导”，两者靠得很近，光可以通过倏逝波耦合。满足谐振条件时，特定波长的光会进入环内并在直通端形成陷波；改变环的有效折射率，谐振波长就会移动，工作波长处的透过率随之变化，光信号就被“写”上去了。

硅材料本身没有线性电光效应，所以硅光调制器普遍利用等离子体色散效应：通过PN结耗尽或注入改变自由载流子浓度，载流子浓度的变化会带来折射率变化和吸收变化。这个效应速度很快，但调制效率有限。为了在高效率和高带宽之间找平衡，常用耗尽型PN结设计，让结区载流子在高频下快速耗尽或恢复。

带宽上不去的原因通常有三层。第一层是电学RC限制：PN结电容和串联电阻组成低通，频率越高信号衰减越大。想要减小电阻就做宽掺杂，但掺杂变宽电容也跟着变大，这组矛盾天然存在。第二层是载流子渡越时间：耗尽区太宽，载流子扫过结区的时间变长，上限频率就会下降。第三层是微环本身的光子寿命限制：谐振峰的宽度与Q值成反比，Q值越高峰越窄，能够通过环腔调制的信号带宽就越窄。换句话说，把微环做得“非常谐振”反而会把高速信号削掉。

用一个生活化类比：微环像一口窄口径的井，Q值高相当于井壁非常光滑、井口很窄，这个波长上的光一旦掉进去就出不来；但外部信号要快速进出，并不能无限地快，井口口径限制了“流量速度”。想做高速调制，就得把井口拓宽一些，也就是压低Q值。

2.2 90GHz需要什么条件：一组可以反推的工程约束

从公开信息推断，要达到90GHz光带宽，微环品质因子Q需要控制在2000附近甚至更低。这里有个可以现场算的式子：谐振峰的3dB全宽约等于c/(λQ)。1550nm波长，Q=2000时，3×10^8除以(1550×10^-9×2000)，算出来大概是97GHz，刚好覆盖90GHz。Q如果做到3000，就只有64GHz上下，离90GHz差一大截。所以设计上必须压低Q值，通常靠加强直波导与环的耦合、优化环半径和弯曲损耗来做到。

但压低Q又会牺牲调制效率。微环的优势本来是用高Q增强环内光场，达到低驱动电压、小尺寸的效果。Q值一低，光场增强效应减弱，同样电压下产生的调制深度就变小。因此90GHz带宽的MRM一定走的是“高速优先，效率用其他方式补”的路线：比如优化PN结的掺杂分布，让耗尽区更薄，既降低渡越时间又控制电容；比如引入行波电极，让微波和光波在传播方向上尽量保持同步，避免高频信号在电极上衰减过快。

另外封装和测试环节也得跟着升级。裸芯片上直接射频探针测到的带宽，和封装到模块里之后的带宽可能差出20GHz甚至更多。金丝键合的寄生电感、焊盘的寄生电容、基板走线的损耗都会把带宽往下拉。如果论文是在芯片级测试得到的90GHz，说明电学设计本身余量留得足够大；真要做到模块级交付，还得在封装互连上下功夫，这也是后面工程化章节要展开聊的部分。

2.3 几条调制器路线的横向对比

把MRM放进调制器坐标系里看会更清楚。目前主流的高速调制器路线有硅光马赫-曾德调制器（MZM）、硅光微环调制器、薄膜铌酸锂（TFLN）以及InP基电吸收调制器（EML）。

硅光MRM一旦把带宽做起来，就同时拥有了MZM的CMOS工艺兼容性和EML的小尺寸优势。微环的面积通常只有几百平方微米，一颗晶圆上可以排布大量器件；多波长场景下，微环阵列比MZM阵列更容易做到紧凑布局。这也是为什么90GHz MRM的意义不仅是“器件更快了”，而是让硅光平台在高速多波长系统中首次具备了完整竞争力。

3. 8波长×600Gbps的系统架构与容量分析

3.1 单波600Gbps是怎么算出来的，带宽和调制格式的匹配关系

单波600Gbps，放在相干光通信里最直接的推法是DP-16QAM。双偏振16QAM每个符号可以携带8个比特（2偏振×4比特），线路速率600Gbps对应的符号率是75Gbaud。加上前向纠错（FEC）等协议开销之后，线路速率往往要上浮15%到25%，符号率会拉到86Gbaud上下。按1.05到1.1的滚降系数算，通道带宽需要90GHz左右，所以90GHz调制器刚好兜住这一档。

这里有个容易混淆的地方：600Gbps到底是客户侧净速率还是线路侧速率。如果是客户侧净速率，加上FEC编码开销和协议开销之后，线路侧的符号率会更高，对调制器带宽的要求会更苛刻。这篇PDP能在90GHz带宽内跑通，说明系统侧链路预算是有冗余的。另一个可能的组合是采用概率整形的高阶QAM，比如PS-64QAM，在更低符号率下达到同样容量，但对OSNR更敏感。两种路线各有取舍，但无论哪一种，90GHz都是那道“门槛”。

从系统角度看，单波600G不是简单把波特率翻倍就可以的。调制器带宽要够，驱动电路的带宽和摆幅要匹配，接收端ADC采样率和DSP算力也得跟着升级。整个链路里任何一环短板都会反映到误码率上。所以PDP论文通常会把眼图、误码率、OSNR裕量这些数据一起亮出来，才能真正说服人。

3.2 8波长WDM系统怎么组织，MRM阵列的优势在哪里

8个波长放在C波段里，通道间隔通常按100GHz或75GHz规划。每个波长通过MRM调制到600Gbps，总容量4.8Tbps。如果算上偏振复用和波分复用，这个容量在数据中心骨干互联里已经属于第二代或第三代方案的水平。

MRM阵列做WDM的天然好处是“每个环一个波长”。因为环形谐振器本身就是波长选择元件，只要把环半径或加热器状态调到对应谐振波长，它就直接完成了调制与信道选择的功能，不需要额外的波分复用器和解复用器。相比之下，MZM阵列需要额外一套无源波分器件，系统复杂度和插损都会增加。一颗硅光芯片上排布8个MRM，加上驱动电极和温控加热器，芯片面积依然可控，这对高密度光模块非常友好。

当然，多波长并行也会带来新的管理问题。每个MRM的谐振点都要独立锁定，受温度波动和工艺偏差影响，各通道的状态不完全一致。系统里需要闭环控制回路，通过光电探测器采样慢速信号，反馈到微环加热器上，把谐振波长实时拉回工作点。这套机制在做硅光多波长产品时已经是标配，但8通道同时稳定工作，对芯片上的热隔离和功耗设计提出了更高要求。

3.3 从器件指标到系统演示：为什么“端到端跑通”含金量更高

单独一个90GHz MRM演示只能说明器件行，但把8个波长、每波600G、再穿过2km空芯光纤跑通，说明的是系统级可行性。这里至少验证了三个层面的问题：第一，MRM阵列的各通道一致性足以支撑多路并行；第二，调制后的高速信号与空芯光纤的传输特性匹配，链路色散和非线性没有把信号压垮；第三，接收端DSP能够在既定OSNR下恢复出低于FEC门限的误码率。

真正做光模块的人都知道，器件和系统之间隔着一道“工程深渊”。实验室里单脉冲测试和真实调制信号传输完全是两回事。这篇PDP把端到端数据补齐，等于是在说这套方案不只是仿真好看，而是已经能在真实链路上跑出可纠错的信号。我个人的判断是，接下来会有更多厂商跟进MRM加空芯光纤的组合，因为两者叠加带来的时延和功耗收益，在AI集群互联这种极端场景里特别有吸引力。

4. 空芯光纤与硅光平台的组合，为什么值得单独分析

4.1 空芯光纤的原理与核心优势

空芯光纤顾名思义，光主要在空气中传输，而不是在玻璃芯里。它的导光机制有两类：一类是光子带隙型，通过周期性微结构把光束缚在空气芯里；另一类是反谐振无节点型，利用管壁的反谐振效应把光限制在中心。无论哪种，核心特点都是“让光尽量走空气”。

空气的折射率接近1，这带来几个实芯光纤给不了的收益。第一是时延低，光在空气里的速度比在玻璃里快大约31%，2km的空芯链路比常规单模光纤能节省约3.2微秒，对于高频率交易、分布式存储同步这种对时延敏感的场景，这个差距是实打实的。第二是非线性低，空气的非线性系数比二氧化硅低几个数量级，相同功率下信号损伤明显更小。第三是损耗窗口宽，理论上可以在更宽的光谱范围内保持低损耗，这给未来的超大容量波分复用留出了空间。

空芯光纤也不是没有代价。它的端面是空气孔结构，和常规单模光纤连接时存在模式失配，耦合损耗往往比实芯光纤对接高一些。弯曲损耗、横向应变容忍度以及长期可靠性都还需要更多工程验证。不过这不妨碍它成为未来几年光互连领域最值得关注的新变量。

4.2 2km传输验证了什么，空芯与硅光如何配合

2km这个距离在数据中心里对应的是楼栋间或大型园区内的互联需求。传统方案用多模光纤或单模光纤都能做，但空芯光纤在这个距离上的价值主要在时延和功耗两个维度：时延节省已经算过，功耗则体现在相同OSNR预算下，由于非线性更低，发射功率可以调低，或者系统可以用更简化的DSP配置。

空芯光纤与硅光芯片的配合，还存在一个工程上的正向互动。MRM这类谐振器件对反射非常敏感，空芯光纤如果端面处理不好，回波反射可能会扰动微环的工作点。PDP能跑通，至少说明他们解决了耦合和端面处理问题，这是实际部署时要重点参考的信号。未来如果要做一个完整的空芯光纤光模块，耦合器设计、端面清洁、反射抑制这三样都得纳入模块级的测试规范。

从技术演进的角度看，硅光提供“高密度调制”，空芯光纤提供“低时延低损伤传输”，两者加在一起正好补足了传统数据中心光互连在功耗和时延上的短板。虽然眼下空芯光纤的成本还偏高，但随着制造工艺成熟，它很可能先在高性能计算集群、AI训练网络这类对时延极度敏感的领域完成落地。

5. 从PDP到量产：MRM工程化绕不开的几个坑

5.1 温度稳定性与谐振锁定，微微环的“阿喀琉斯之踵”

微环谐振波长对温度极其敏感。硅的热光系数大约是1.86×10^-4/K量级，温度每变化1℃，1550nm附近的谐振峰可能漂移几十皮米到上百皮米。对于通道间隔75GHz或100GHz的系统，这点漂移足以让信号落到信道边缘甚至邻道里去。

工程上常见的做法是片上集成微型加热器，通过闭环反馈把微环锁定在工作波长。锁定的过程就是用慢速光电探头监测输出光功率，再用PID算法控制加热功率。这样做的问题是会额外增加功耗，8个微环就是8套加热闭环，模块整体功耗和热串扰都要重新评估。另一个思路是采用宽谱设计或温度不敏感波导，但会牺牲部分性能。这个坑不是论文里看不见，而是量产时必须拿出成本可接受的方案。

5.2 高带宽封装与射频互连，芯片指标不等于模块指标

前面提过，90GHz在芯片探针台上测到，和装进光模块后还有距离。射频封装要控制金丝长度、焊盘电容和共面波导阻抗连续性。频率越高，对封装寄生参数越敏感，稍有失配高频响应就掉下来。业界较成熟的方向是flip-chip倒装焊配合扇出封装，尽量减少键合金丝的电感。但要驯服90GHz这种等级的信号，基板材料、走线弧度、接地过孔密度都得重新设计。

此外，驱动芯片和调制器芯片之间的协同设计也要提前做。MRM需要的驱动电压低，但高速驱动芯片输出的高频摆幅、上升沿质量直接影响调制眼图。系统集成商通常会把TIA、驱动器和MRM放到同一个封装里做联合仿真，光域和电域一起优化，而不是各测各的。

5.3 良率、可靠性与批量测试

微环的性能对工艺偏差很敏感。波导宽度变化10nm，谐振波长可能就偏移一个不小的量。晶圆制造的一致性、刻蚀和掺杂工艺的控制精度，直接决定了批量产品中微环的初始失配程度。产线上通常会用“出厂调谐”的方式，先测试每个微环的谐振位置，再用加热器把它们统一校准到目标波长网格上。这个过程增加了测试时间和成本，但对于MRM产品几乎是必需的。

可靠性方面，需要重点关注微环在长期高功率工作下的性能稳定性。虽然MRM功耗低，但8通道同时工作带来的局部热累积会让芯片温度缓慢爬升，谐振点跟随漂移。老化测试、温度循环测试、高温高湿测试等，都是量产前必须过的关卡。这个环节最容易被实验室demo团队忽略，但恰恰是决定产品能否规模部署的关键。

6. 从这篇PDP延展开的几个常见问题，以及我的实操体会

6.1 常见问题速查表

6.2 关于“器件快”和“系统赢”，我的几点个人体会

看完这篇PDP，最大的感受倒不是90GHz这个带宽数字本身，而是他们拿出来的那一整套组合拳：高带宽MRM打通了硅光的速率天花板，多波长阵列体现了集成优势，空芯光纤则把传输介质的红利一起拉进来了。单拆任何一个环节，都能找到对应的论文和产品，但把三者结合起来当做一个方案来做，才是真正面向应用场景的思维。

我在实际项目中踩过的坑是，过于关注器件峰值带宽，却忽略谐振点的长期稳定性和封装寄生参数。芯片探针台数据很漂亮，一到模块级就“见光死”的情况太常见了。所以做这类方案评估时，我一般会给论文指标打一个折扣，再叠加温控和封装的影响，最后才是模块整体可实现的性能。90GHz的MRM如果要进产品，模块级大概率能稳定跑60到70GHz，这已经足够支撑单波400G到600G的系统设计。

另外一个值得留意的趋势是MRM和空芯光纤组合起来对系统时延的贡献。低时延对于AI训练集群这类分布式场景不是锦上添花，而是直接关乎训练效率。把调制器功耗降下来、把光纤时延省下来，这两个变量合在一起会推动下一代光模块在架构上重新做权衡。手里有系统级项目评估需求的朋友，建议把“调制器带宽翻倍”和“传输介质切换”这两件事当成一个整体来算账，而不是只盯着某个零部件的规格表。

这组方案后续还可以往两个方向扩展：一是把波长数从8路往上抬，往16或32路做多波扩展，进一步拉高单纤容量；二是把空芯光纤的传输距离往更长的场景推，比如几十公里的城域核心链路。如果这两步都跑通，硅光MRM加空芯光纤的组合就不会只是PDP里的一个新纪录，而会成为下一代光互联基础设施里绕不开的选项。