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不少做模拟IC设计的朋友第一次在Cadence Virtuoso里跑差动放大器仿真时，都会卡在同一个地方：原理图搭好了，DC仿真也过了，但AC分析出来的曲线要么增益低得离谱，要么相位曲线直接飘掉，完全不知道问题出在哪。这篇文章就围绕“差动放大器仿真”这个核心场景，把从DC扫描到AC分析的完整流程拆开讲透。

如果你正在学习Cadence Virtuoso，或者工作中需要验证一个差动放大器的基本性能，这篇文章会带你避过最常见的几个坑，同时把操作背后的原理讲明白。我会按照实际仿真时的操作顺序，从搭建测试平台开始，到DC工作点检查，再到AC小信号分析，最后整理一份踩坑记录，全部是基于真实项目经验总结的实操内容。

1. 仿真前的准备工作与测试平台搭建

1.1 工艺库与PDK环境的确认

开始之前，先确认Cadence Virtuoso的启动环境是正常的。很多新手在仿真时报错“器件未定义”或“模型缺失”，十有八九不是电路画错了，而是工艺库没加载，或者model library没有关联到仿真器的配置里。

在Virtuoso里，打开原理图前要确认用的工艺库（比如tsmc、smic、华虹的PDK）确实在Library Manager中可见。如果看不到，需要在Library Path文件里添加路径。项目里常见的一个错误是，明明库是存在的，但是打开仿真时ADE显示没有模型，这时候去Setup -> Simulator Directory或Model Libraries里重新加载模型的.scs或.lib文件就行。

我在实际项目中习惯在仿真前做一个快速核对：画完原理图，先用Check and Save过一遍，确认没有连线错误或器件悬空。这一步能省掉后面排查“仿真结果诡异”的大量时间。

1.2 差动放大器的基本测试电路结构

差动放大器说白了就是一对输入管加上尾电流源，再搭配负载。做仿真验证时，测试电路通常包含以下几个部分：

• 尾电流源：提供直流偏置电流，决定差分对的跨导和功耗。我经常用NMOS电流镜实现尾电流源。
• 输入对管：一对尺寸相同的NMOS或PMOS，作为差动输入级。
• 负载：可以是电阻、二极管接法的MOS管或电流源负载。不同的负载决定了增益和输出摆幅。
• 输出端：单端输出或差分输出，取决于你后续要怎么处理信号。

仿真时我会先把输入共模电平设置到合理范围。对NMOS输入对来说，输入共模电压要确保输入管和尾电流源都工作在饱和区。这个没有固定公式，但可以根据电源电压和过驱动电压大致推算。比如电源3.3V，尾电流源过驱动0.2V，输入管过驱动0.2V，那输入共模至少要比地高0.4V以上，同时不能太高导致输入管进入线性区。

1.3 符号库与仿真模型映射

画完测试电路还要注意symbol是否映射正确。使用PDK自带的器件会省事很多，因为它们的CDF参数（比如宽长比、指教、模型名）都是做好了的，直接填数值就能用。

如果使用analogLib里的理想开关、理想电流源做辅助，记得确认它们的仿真模型也能被Spectre识别。遇到过有人混用了hspice模型和spectre模型，结果仿真直接报“Model not found”。尽量整套环境用同一个PDK的模型文件，不要混搭。

2. DC扫描与直流工作点分析

2.1 为什么要先做DC扫描

差动放大器是一个模拟电路，所有的特性都建立在正确的直流工作点上。工作点不对，AC分析出来的增益、带宽全都是废数据。所以我的习惯是：任何仿真开始前，先把DC工作点看清楚，再做DC扫描确认静态传输特性，最后才做AC。

很多教材直接跳到AC分析，导致学生看到一条奇怪的增益曲线不知道怎么调。实际上只要你理解了DC工作点，AC分析就顺理成章。

差动放大器最基础的DC特性就是“输出电平随输入差模电压的变化”。理想情况下，输入差模为0时，两个输出端电平应该相等，尾电流在两个支路均分。实际因为失配会有小的偏差，这在仿真理想模型里可能看不出来，但在真实工艺下要关注。

2.2 在ADE L中设置DC扫描

打开ADE L（或者新版Virtuoso里的ADE Explorer，习惯用哪个随你，操作是类似的），选择Analyses -> dc，然后设置扫描变量。这里要扫描的是输入共模电压或者输入差模电压。

举个例子，我要扫描输入差模电压从-1V到+1V，就把变量设为vid，在testbench里用两个直流源产生vid和-vid分别接到正负输入端。扫描类型选linear或automatic，精度够就行，不用太细。

关键点在于，输出节点要选对。我想看单端输出，就选VOUT_P或VOUT_N；想看差分输出，就在calculator里做VF("VOUT_P") - VF("VOUT_N")。

DC扫描跑完后，打开结果窗口，你应该能看到一条典型的差动传输曲线：中间有一段近似的线性区，两端进入饱和（也就是输出钳住了）。这一段线性区的斜率乘以负载电阻或负载阻抗，粗略对应了小信号增益的量级。

2.3 根据DC结果调整电路参数

实际项目里，第一次跑出来的DC曲线往往不理想。最常见的情况有两种：

第一种，输入差模为0时输出不在预期电平。比如设计目标是输出共模1.65V（电源3.3V的一半），结果实际只有0.8V。这说明尾电流偏大或负载电阻偏大，需要调整尾电流源的偏置电压或负载电阻阻值。

第二种，线性区范围太窄。说明输入管的过驱动电压太小，或者尾电流太小导致输入管进入亚阈值区域。可以尝试增大尾电流，或者加大输入管的宽长比。要注意，调输入管尺寸会影响整个环路的失调和噪声特性，不是随便拍的。

用DC扫描验证差动放大器的工作点变化范围，说到底是确认“电路在目标共模范围内都能正常工作”。我会把输入共模扫描范围设得比实际使用范围略大一些，留出设计裕量。

2.4 查看DC工作点：确认管子真的在工作区

DC扫描看的是宏观“传输曲线”，工作点查看则是微观检查每个管子状态。在ADE中运行DC分析后，用Results -> Print -> DC Operating Points可以打印所有管子的工作点信息。重点确认：

• 输入对管的region是否为2（饱和区）。
• 尾电流源管是否在饱和区。
• 负载管（如果是MOS管）是否在饱和区。
• 各支路电流是否与设计目标一致。

我见过很多次，AC增益比理论值低一个数量级，查来查去最后发现输入管压根不在饱和区。这种问题在DC工作点里一眼就能看出来，不需要猜。

注意：很多PDK模型里，region的数值含义不一样，有些用0表示截止、1表示线性、2表示饱和，但也有用其他数值的。打印出来之后对比一下手册，别用错判断标准。

3. AC分析：扫出真实的增益与相位

3.1 AC分析到底在做什么

AC分析的本质是在直流工作点的基础上，对电路做小信号线性化，然后计算系统在不同频率下的复频响应。所以AC分析的准确性完全依赖于DC工作点的准确性。

换句话讲，AC分析是“站在DC肩膀上”的。你DC都没对，AC就是空中楼阁。

对差动放大器来说，AC分析一般关心两个东西：低频增益和主极点位置。简单五管OTA结构里，主极点通常由输出节点的寄生电容和负载电容决定。增益和带宽的乘积（GBW）近似恒定，这个参数对反馈系统设计至关重要。

3.2 正确设置AC仿真参数

在ADE中选择Analyses -> ac，需要设置扫描类型、起始频率、终止频率和扫描点数。

实际操作中，我建议起始频率从1Hz或10Hz开始，终止频率至少到GBW的10倍以上。比如目标GBW是100MHz，扫到1GHz或2GHz比较稳妥。扫描类型选logarithmic，点数50到100足够看出曲线形状，没必要追求过多点数，否则仿真变慢，曲线也不会更准。

AC分析的输入信号，需要在测试平台上用ac magnitude参数来表示小信号幅度。通常设为1V的交流幅度，这样输出节点的AC电压值直接就是电压增益。用1V的好处是读数方便，后面做增益曲线时不用再换算。如果你是做差分输入，要确保两个ac source的相位相反，即一个设为0度，一个设为180度。

3.3 增益、带宽和相位裕度的判读方法

跑完AC分析后，在结果窗口画出输出节点的增益曲线和相位曲线。增益曲线用dB表示，相位曲线用度表示，两条曲线放在同一个图里方便观察。

低频增益就是曲线在平坦区的值。假设你在1kHz处看到40dB，这意味着低频电压增益是100倍。对五管OTA来讲，40到60dB是常见范围。如果你设计的是高性能运放，可能要到70dB以上，那是通过叠管或增益提升技术实现的。

主极点位置是增益曲线从平坦区开始下降3dB的那个频率点，也是相位曲线明显变化的起点。单位增益带宽是增益曲线穿越0dB时的频率。

相位裕度要在“增益为0dB”的那个频率点看，用180度减去该点的相位绝对值。比如在0dB频率点，相位曲线上读数是-120度，那相位裕度就是60度。这个值不是AC分析直接给出的，需要自己读图，或用calculator里的公式算。

提示：如果增益曲线出现峰值（peaking），说明电路在某个频率附近可能有负阻或Q值过高，这通常是反馈环路的稳定性隐患，不能忽略。

3.4 负载电容和输出电阻对AC结果的影响

同样的差动放大器结构，负载电容不同，AC曲线会明显变化。比如输出端接1pF和5pF的电容，主极点会往低频方向移动，GBW基本不变（因为GBW=gm/Cc，如果是内部密勒补偿的话另说，但对于五管OTA来说，GBW约等于尾电流跨导除以输出电容）。

所以AC仿真一定要带上你实际应用场景中的负载值，不要只仿真裸放大器。我通常会在输出端放一个“预估负载电容”，取值来自后级电路的输入电容和走线寄生电容之和。如果这个值不确定，就按典型值做组合扫描，看增益和相位余量的变化范围。

另外，输出电阻如果是电阻负载，值越大低频增益越大，但输出极点频率越低。这是经典的增益与速度的折衷。理解了这一层关系，你看到增益和带宽的曲线就不会觉得奇怪了。

4. 常见问题与排查技巧实录

4.1 仿真报错“器件未定义”或“模型未找到”

这是Cadence仿真最频繁的报错之一。原因基本锁定在：

• 器件库没加载或库路径错误。
• CDF参数里的模型名填错。
• Model Library设置里没有把PDK的模型文件添加进来。
• 工艺库的版本和仿真器版本不匹配。

排查顺序：先检查Library Manager里有没有这个库；再打开CDF参数看器件的model name；最后到ADE的Setup -> Model Libraries里确认模型文件路径。这里有个细节，不同PDK的模型文件后缀不一样，有的.scs，有的.lib，有的.l，必须选对格式。

4.2 DC扫描曲线异常“平”或者“跳变”

如果DC扫描出来的输出曲线几乎是平的，大概率是输入管没有正常导通，或者尾电流源没有正常工作。检查尾电流源的偏置电压是否太低，或者电流镜的参考电流是否被错误地设成0。

曲线出现跳变，则可能是有源器件进入了不希望的region，比如输入共模电压超出了允许范围，导致某一个管子瞬间从饱和区跌到线性区。这时候我通常会把 DC 扫描范围缩小，定位跳变点的确切电压，再和理论计算对比，确认是否合理。

4.3 AC增益远低于理论值

AC增益低于理论值最常见的元凶是工作点不对，其次就是仿真设置问题。

检查思路是这样的：

1. 先看工作点，确认输入管、负载管、尾电流源管都工作在饱和区。
2. 再看AC激励幅度和相位设置，确认差动输入信号没有接反。
3. 然后看输出节点选没选对，有时候你把单端输出当差分输出了，看到的结果自然不一样。
4. 最后确认负载电容是否太大，导致低频增益被压下来。

另外还有一个容易被忽视的点：在Spectre仿真里，如果某个节点没有直流通路到地（floating），仿真会自动在这个节点接一个巨电阻来保证收敛。但这个电阻会引入一个极低频率的极点，导致低频增益曲线异常。如果你的AC曲线在极低频是往下掉的，十有八九是节点悬浮问题。

4.4 仿真不收敛怎么办

Cadence瞬态仿真不收敛比DC和AC更常见，但在DC和AC分析中偶尔也会遇到收敛问题。主要的解决手段包括：

• 增加迭代次数限制，把gmin调大一点。
• 在可能有高阻节点的位置并联大电阻。
• 检查是否有节点没有DC路径。
• 将仿真精度从conservative改成moderate，有时能帮助收敛，但会牺牲一点精度。
• 给电源加ibias或gmin相关的选项。

DC不收敛时，我习惯先给电源电压从0开始做一段很短的瞬态或DC扫描，让电路逐步“爬”到工作点，而不是直接强制到目标值。这在很多电路里非常管用。

4.5 一个容易被忽略的细节：地和电源的标记

在原理图里，电源和地要用PDK或analogLib里的vdc电源符号来提供，不能只是画一个短接线符号或者用某个悬空的label。我在项目里见过有人直接在地上放了一个IPIN作为端口，结果原理图检查没报错，但仿真时所有电流都归零，最后发现是电源地的概念没搞对。

正确做法是：给电源和地都用明确的vdc源或gnd符号，并且在ADE里把这些源的名字标注清楚。这样一来，后续做参数扫描、蒙特卡洛分析时也能统一控制电源值。

5. 实操心得与工具箱扩展建议

5.1 把常用的计算器表达式存成模板

Cadence的calculator功能很强大，可以用来计算差分输出、相位裕度、3dB带宽等。我习惯把这些常用表达式存成模板，下次用的时候直接调出来，不用每次重新敲函数。

比如差分输出表达式：

V("VOUT_P") - V("VOUT_N")

单位增益带宽可以用cross(V("gain_dB") - 0, 0, "falling")之类的函数，不过不同版本写法有差异。我一般直接读图，或者用bandwidth函数。

5.2 用参数化设计快速扫尾电流和负载

在Cadence里把尾电流源的偏置电压设成变量，比如vtail，然后AC分析时同时扫描vtail和负载电容，能得到一组增益和带宽曲线。这个习惯帮助我快速找到“够用且不过设计”的参数组合。

具体操作就是在原理图中把尾电流源管栅极接一个vdc，电压值填变量名vtail。在ADE里用Variables窗口定义变量，在AC分析里也可以把变量设为扫描参数。跑完后把所有曲线叠加显示，你能很直观地看到电流增大时增益几乎不变（因为gm增大的同时输出电阻减小），但带宽会明显提升。

5.3 差动放大器仿真之后还可以做什么

做完DC扫描和AC分析，只算完成了差动放大器基本验证的第一步。实际设计中，后面一般还要继续做：

• 瞬态仿真：验证大信号摆率、建立时间、压摆率是否满足需求。
• 共模反馈环路验证：如果是全差分结构，必须验证共模反馈的稳定性。
• 噪声分析：低频1/f噪声和热噪声对精密放大器非常关键。
• 失调分析：用蒙特卡洛仿真看Vos的分布范围。
• PVT角分析：在不同工艺角、电压、温度下重复DC和AC仿真，确认设计裕量。

这些后续步骤需要的工具链仍然是Cadence Virtuoso里那套环境，但需要的设置更多。先把DC和AC这两个基础分析做扎实，后面再往上叠加其他分析就会顺手很多。

5.4 建议的仿真检查清单

我把自己平时做差动放大器仿真时的一份检查清单整理出来，供你参考：

• [ ] 原理图Check and Save通过，无悬空节点和未连接引脚。
• [ ] 工艺库和模型库已正确加载。
• [ ] DC工作点分析显示所有管子均在饱和区。
• [ ] DC扫描曲线线性区位置与设计预期一致。
• [ ] AC低频增益达到设计目标。
• [ ] 单位增益带宽和相位裕度满足要求。
• [ ] 在目标负载电容下重复AC分析。
• [ ] 全PVT角下重复以上步骤（如果有要求）。

这份清单看着简单，但每次做仿真前过一遍，能省下大量后续调试时间。很多看起来玄学的问题，最后都能在清单某一项里找到原因。

回到开头提到的那个场景：同样的差动放大器，DC和AC仿真结果能不能让你放心，取决于你有没有把工作点校准确。Cadence给出的曲线不会骗人，但前提是你得看得懂它告诉你的信息。我能给的最实在的建议就是，别一上来就指望一次性搭好整个仿真，先花半小时把DC工作点和DC扫描看懂，再打开AC分析，整个过程会顺畅得多。