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做硬件的基本都绕不开滤波器。RLC电路组成的高通、低通、带通、带阻滤波器，几乎是我这几年项目里用得最频繁的“看家电路”之一：音频系统里去开关噪声，传感器前端滤漂移，射频板子上做选频，甚至电源输出纹波抑制，都得靠它们。说实话，课本上这几张电路图看着简单，真正上手调的时候，频点偏了、带宽宽了、插损大了，全是坑。这篇文章我就把RLC四种滤波器从原理到参数计算，再到仿真和实测，完整梳理一遍。正在啃模拟电路的人可以参考，做硬件调试时被“选频”问题卡住的朋友，应该也能从中找到点思路。

1. 从“选频”说起：RLC电路凭什么能当滤波器

1.1 电感和电容对频率的“态度”

要真正理解RLC滤波器，绕不开电感和电容在频率面前截然相反的“性格”。

电感天生阻碍电流变化。交流电频率越高，电流方向变化越快，电感产生的反向电动势越大，表现出来就是阻碍作用越强。用感抗公式表述就是XL=2πfL，频率每升高一倍，感抗跟着升一倍。所以电感在信号路径里，本质上是一只“高频刹车器”。

电容则完全相反。它靠极板上的电荷积累和释放来传导交流信号，频率越高，充放电周期越短，容抗XC=1/(2πfC)就越小。高频分量几乎无阻碍地穿过电容，而低频分量被挡在门外。电容是一只“高频直通车”。

想快速记住这层关系，可以做个类比。把信号看成水流，频率就是水流的波动快慢。电感像河道里的水轮，水流越急它转得越快，形成的反向阻力也越大；电容像河边的蓄水池，涨水时先蓄一把，落水时再放出来，等于给高频波动开了一条“旁路”。电阻呢，它就相当于河道本身的粗糙度，对所有水流一视同仁地消耗。电感、电容、电阻这三个性格迥异的元件组合在一起，就构成了频率选择网络，也就是滤波器最底层的原理。

1.2 四种滤波器解决什么实际问题

• 低通：低于截止频率的信号畅通，高于截止频率的信号被衰减。我拿它处理过音频功放输出端的开关电源残留噪声，几十kHz的毛刺被滤得干干净净，20kHz以内的音频一点不受影响。
• 高通：高频通过，低频滤除。心电采集、振动测量这类传感器前端，电极或传感器会输出缓慢漂移的直流基线，串一个高通网络就能把基线拉掉。
• 带通：只放行中心频率附近一段信号。收音机选台、无线接收机中频选频，核心都是带通滤波器，把想听的频道挑出来，把旁边的频道压下去。
• 带阻：反过来，把某个频率附近的信号“挖掉”。实验室里最典型的就是50Hz工频陷波器，在微弱信号测量时把电网干扰干掉，同时尽量不动其他有用频率。

这四种需求听起来各不相同，但在我用RLC实现之后发现，它们其实是同一套基本功的两两组合。搞懂了谐振和阻尼，四张电路图能串成一条逻辑线。

2. 四种滤波器电路拓扑与原理拆解

2.1 低通与高通：一对镜像结构

二阶RLC低通的结构非常经典：信号先经过一个串联电感L，输出端并联一个电容C到地，电阻R作为负载。这个R可能是后级电路的输入阻抗，也可能是信号源内阻，很多时候不是我们主动“选”的，而是电路环境给定的。

为什么这样能低通？低频时感抗2πfL很小，信号几乎无损耗地流过电感，同时容抗1/(2πfC)很大，电容对地“漏”不掉多少电流，输出端电压基本等于输入。频率升高之后，感抗变大对信号形成阻碍，容抗变小又把输出端的高频分量大量分流到地，两个机制叠加，输出就快速掉下去了。理想情况下二阶响应衰减斜率是40dB/dec，也就是频率每升高10倍，输出幅度只有原来的1%。

高通就是低通的镜像，把电感和电容的位置交换：串联电容C进信号，输出端并联电感L到地，电阻R还是负载。低频时容抗极大，信号在电容上就被挡住了，同时感抗极小，即使漏过去的低频也被电感短路到地；高频时容抗变小、感抗变大，信号顺利到达负载。理解了一个，另一个直接“翻过去”就行。

这里有一个大家经常忽略的关键点：负载电阻R的取值很重要，它决定了二阶系统的阻尼比，直接影响截止频率附近曲线的形态。以RLC低通为例，二阶传递函数的标准形式是1/(LCs²+(L/R)s+1)，阻尼比ζ=(1/2R)·√(L/C)。我希望响应平缓、没有明显过冲，就尽量让ζ落在0.707附近，也就是R取0.707√(L/C)左右；如果R明显偏大，系统会变得欠阻尼，截止频率附近出现隆起峰值；R明显偏小，过渡带变宽，选择性变差。所以每次搭低通、高通之前，我都先拿计算器按一下√(L/C)，再对照实际负载电阻，心里就有数了。

2.2 带通与带阻：谐振特性的两种运用

带通和带阻是RLC电路最精华的部分，因为单靠RC或者RL都做不出真正的“带”类响应，必须借助LC谐振。

带通最常见的拓扑是串联RLC分压结构：信号源、电阻R、电感L、电容C首尾相连成一个串联回路，输出从电阻R两端取。谐振频率f0=1/(2π√(LC))处，感抗和容抗大小相等、方向相反，正好互相抵消，回路总阻抗只剩R，电流最大，R上的电压也最高。频率偏离f0之后，电感或电容的电抗开始占据主导，回路总阻抗变大，R上分到的电压变小。于是R两端得到一条“中间隆起、两边下降”的曲线，这就是带通。

带阻和带通可以用同一个串联RLC电路实现，只是把输出端改到LC串联支路两端。谐振时LC串联总阻抗等于0，相当于把输出节点对地短路，所以输出为0；偏离谐振点后，LC支路阻抗变大，输出慢慢恢复。当电阻R串联在信号路径中、LC并联谐振回路也串在信号路径里时，还能做出另一种带阻：谐振时并联LC的阻抗极大，信号几乎全部被阻挡在回路两端，输出接近0；偏离谐振点，并联LC阻抗迅速下降，信号正常通过。这种结构在音频陷波和射频杂散抑制里更常见。

我自己的体会是，这两种带阻选哪种，主要看电路阻抗环境。并联LC串联阻断的方式，适合源阻抗和负载阻抗都比较低的场景；串联RLC陷波到地，适合在并联节点上直接用，调试起来直观。确定方案前先用仿真扫一遍，比凭感觉拍脑袋稳得多。

2.3 四种电路对照速查表

把四种电路的特征汇总成一张表，我平时画图、调板子的时候经常对照着看。

表格里BW=R/(2πL)是针对串联RLC带通的。并联LC带阻的陷波带宽则取决于并联谐振回路的Q值，Q=R·√(C/L)，这里的R是并联在LC两端的总等效电阻。

3. 关键参数计算：截止频率、中心频率与Q值

3.1 从传递函数看幅频特性

滤波器说白了就是一张频响表格，而RLC电路的频响本质由一个二阶传递函数决定。以串联RLC带通为例，输出电压相对源电压的传递函数可以写成：

H(s) = (R/L)·s / (s² + (R/L)s + 1/(LC))

分母里s²项和1/(LC)项决定了固有谐振频率ω0=1/√(LC)；中间项(R/L)则是阻尼项，直接控制带宽。也就是说，谐振频率主要由L和C的乘积决定，而电阻R不改变中心频率，只改变曲线的“胖瘦”。在设计带通时，先把L和C按中心频率定好，再单独拿R来调带宽，这个解耦关系让工程调试非常方便。

低通和高通的分母同样包含LCs²和带R的中间项，所以它们的固有频率也都是1/√(LC)。很多人只背公式不记适用条件，最后仿真和实测对不上，问题往往就出在阻尼比不是理想值上。记住一条：只要公式里的R不是0，截止频率点就或多或少会偏离那个简洁的理想值，误差从百分之几到百分之几十都有可能。

3.2 Q值到底在说什么

Q值是个出现频率极高、也最容易绕晕的概念。换个方式理解：它衡量的是滤波器的“频率选择性”。Q值越高，带通曲线越尖，带阻陷坑越窄越深；Q值越低，曲线越扁平，过渡越平缓。

串联RLC带通的Q=(1/R)·√(L/C)，也可以写成Q=f0/BW。这两个表达式看起来差很多，其实是一回事。因为ω0=1/√(LC)，所以ω0L=√(L/C)。设计指标通常直接给中心频率和带宽，有了Q=f0/BW这个关系，就能反推回L、C、R之间的数量关系。

并联RLC的Q表达式正好倒过来，Q=R·√(C/L)。同样是电阻R，在串联回路里它消耗能量、让Q降低；在并联回路里它代表外部负载或并联泄放路径，会限制谐振阻抗、同样影响Q。我见过不止一个同事把这俩记反，结果调带宽的方向都是反的。建议记成：串联RLC里R串在谐振环路里，损耗大，Q低；并联RLC里R并得越大，谐振回路越“干净”，Q越高。

3.3 参数初选与元件取值方法

实际动手选元件的时候，L和C的标准值远不如电阻丰富，所以我习惯按“先选L，再反推C，最后定R”的顺序来。

已知目标频率f，C=1/((2πf)²L)。L取得小，C就需要很大；L取得大，C就小。电感体积大、成本高、还有损耗，能选小就选小；但L太小会把C推到几十微法以上，这时候电容的ESR就成了问题，整体性能反而变差。工程上L和C应该匹配得让两者都落在各自“舒服”的区间，一般L取几百μH到几十mH，C取几十nF到几μF，是比较稳妥的出发点。

算出来的C如果不是标准值，不用纠结，用两只电容并联凑一凑就行。比如2.2μF加0.33μF得到2.53μF，或者1μF加0.47μF加0.1μF。电容精度一般有5%到10%，凑到误差在5%以内对滤波器完全够用。

还要提前估算一下Q值。如果算出来的Q超过20，说明带宽非常窄，电路对元件误差会极度敏感，电感标称值偏5%就足以让中心频率跑偏好几倍带宽。无源RLC滤波器我建议Q控制在1到20之间，再高就考虑有源滤波器、晶体或者SAW滤波器，别在无源RLC上硬扛。

4. 完整实操：设计一个1kHz带通滤波器并验证

4.1 设计指标与拓扑选择

为了把前面这些原理落到实际，我给你完整走一遍流程。假设现在要做一个中心频率f0=1kHz、-3dB带宽BW=200Hz的带通滤波器。这个指标在音频解调、某些传感器特征提取里很典型：要把1kHz附近的信号分量留下来，同时把两侧200Hz以外的干扰压掉。

拓扑就选串联RLC分压电路，在电阻两端取输出。结构最简单，只有三个元件加一个信号源，调试直观，出问题也好定位。

4.2 元件参数计算过程

先定电感。10mH的固定电感非常常见，工字电感、色环电感都能买到，体积也不大。定L=10mH之后，中心频率公式反推电容：

C = 1/((2πf0)²L) = 1/((2π×1000)²×0.01) ≈ 2.533μF。

标准值我会用2.2μF并联0.33μF凑出2.53μF，误差不到1%。

然后看Q。BW=200Hz，f0=1kHz，Q=f0/BW=5。串联RLC的Q=(1/R)·√(L/C)，所以：

R = (1/Q)·√(L/C) = (1/5)×√(0.01/2.53e-6) ≈ 12.65Ω。

取标准电阻12Ω，重新核算带宽BW=R/(2πL)=12/(2π×0.01)≈191Hz，Q≈5.2，和200Hz的目标非常接近，没必要再精修。

这里我要重点提醒一个极容易踩的坑：信号发生器或者前级驱动电路本身有内阻。比如常见的信号源内阻是50Ω，如果你直接把上面算好的12Ω电阻串进去，实际串联在谐振回路里的总电阻其实是12+50=62Ω，带宽会膨胀到Rtotal/(2πL)=62/(0.0628)≈987Hz，完全不是设计的样子。解决办法有两个：一个是把源内阻也计入R，重新反推L和C；另一个是用缓冲放大器把前级内阻隔离开。做板子时我一般两种方案都会预留，调试灵活得多。

4.3 LTspice仿真与实测验证

搭仿真验证很简单，我用LTspice跑一遍AC扫描。网表大概是这样的：

V1 in 0 AC 1 R1 in out 12 L1 out lc 10m C1 lc 0 2.53u .ac dec 200 100 10k .plot ac v(in-out) v(lc)

带通输出取R1两端电压v(in)-v(out)，也就是12Ω电阻上的压降；同时也可以看一下LC支路电压v(lc)，那就是带阻（陷波）响应。仿真结果里，R1两端电压在1kHz附近最高，左右对称下降，-3dB点大约在905Hz和1096Hz；LC支路电压则在1kHz处深深凹陷。两种输出正好是“倒影”关系，这也再次验证了同一个串联RLC电路取输出位置不同，能得到带通和带阻两种功能。

实测的时候，我用信号发生器加毫伏表，从200Hz到5kHz每隔100Hz记录一次输出电压。这个过程确实有点费时，后来换成扫频仪一键出曲线效率才上来。没有扫频仪的话，用示波器FFT配合扫频信号源也能凑合，但精度会差一些。

4.4 实测数据与曲线特征

实测记录下来的数据，有几个规律你需要心里有数：

• 中心频率处输出电压最高，往两侧单调下降，但两侧下降速度不一定完全对称。原因主要是电感的DCR和电容的ESR给回路引入了额外损耗，低频侧通常跌得更快。
• 实测带宽比理论值略宽，因为12Ω电阻本身的精度、电感内阻的附加损失，以及信号源内阻的微小影响都叠加上去了。
• 在偏离中心频率的时候，输入输出之间会出现明显相移；越接近f0，相移变化越快，这是谐振电路最典型的相位特征。

对得上的部分可以说明设计方法没问题，对不上的部分反而更有价值。我自己的习惯是，先看中心频率和带宽这两个最容易量测的指标，如果偏差超过10%，第一步不是盲目改参数，而是用LCR表测一下电感和电容的实际值，多半问题出在元件容差上。

5. 常见问题与排障实录

5.1 电感不完美：DCR与寄生电容的影响

电感是RLC滤波器里最容易让设计“翻车”的元件，主要因为两个非理想特性。

第一是DCR，也就是电感绕组的直流电阻。手头10mH的工字电感，DCR从几欧到几十欧都很常见。在串联RLC带通里，DCR相当于给R“偷偷加码”，结果就是带宽变宽、Q值下降、中心频率处插损增加。在并联LC带阻里，DCR的危害更直接：理想的LC并联谐振阻抗是无穷大，DCR等于在电感支路上并联了一个“泄放电阻”，把谐振点的最大阻抗拉低，陷波深度从理论上的无限深变成二三十dB甚至更浅。

第二是寄生电容。电感线圈层与层之间有分布电容，频率高到一定值，电感会出现自谐振，表现为感抗不升反降。选电感的时候一定要看资料里的自谐振频率（SRF），务必让它高于工作频率3到5倍以上。如果工作频段在几MHz以上，普通工字电感基本就不合适了，得换高频绕线电感或者磁环电感。

5.2 频率偏差、带宽不对该怎么调

实测中心频率偏了，先别急着换元件。拿LCR表测一下实物电感电容，电感的标称偏差通常比电容还大，标10mH实测9.2mH太常见了。用实测值重新算一遍，如果偏差方向和大小对得上，说明电路工作正常，纯粹是元件容差。

带宽不对，优先怀疑电阻环路。前面说过的信号源内阻问题会在这里现身，还有一个容易被忽略的元凶是示波器探头电容。普通无源探头输入电容有十几皮法到几十皮法，看起来很微小，但测较高频率滤波器时，探头的输入电容会并联在电路节点上，改变谐振条件。测射频或高频RLC电路，尽量用低电容探头，或者把探头接在缓冲输出后面。

调带宽有个实用技巧：画板子或搭面包板时，在串联谐振回路里故意预留一个小电阻的位置，先焊0Ω短路。实测带宽偏窄，就把0Ω换成计算好的阻尼电阻；实测偏宽，就减小R。有了这个预留位，就不用反复拆换电感和电容了。

5.3 排查思路与调试工具

排查RLC滤波器问题，我习惯按三步走：

• 第一，断电用万用表量直流通路。确认电感没有开路、电容没有短路、电阻阻值正确。这一步能排除一半的“玄学故障”。
• 第二，上电扫频，看响应曲线形状。完全不选频，大概率是L或C坏；形状对但频点偏，基本是容差问题；形状对但插损大、带宽宽，重点查DCR和源内阻。
• 第三，用LCR表测元件实际参数，和设计值逐项对比，定位到具体元件。

工具方面，我强烈建议手头备一个几十块钱的便携LCR测试仪，测电感的L和DCR、电容的C和ESR非常方便，调试速度快一大截。再往上就是nanoVNA这类矢量网络分析仪，把滤波器当单端口或双端口网络扫一遍，S21曲线直接显示中心频率、带宽和插损，效率高很多。新手阶段没有这些仪器，信号发生器加示波器按频点扫，同样能验证设计，只是多花点时间。

做了这么多年模拟电路，我的体会是：RLC滤波器的公式真不难，难的是对元件非理想性的敬畏。每次看到仿真曲线觉得自己设计已经“完美”的时候，我都会提醒自己——还有电感的DCR、电容的ESR、信号源的内阻，以及探头那点电容在等着。先把理想电路算明白，再把工程误差一项一项叠加上去，这四种滤波器才能真正成为你顺手可用的工具。

最后再分享一个小技巧：设计指标允许的话，尽量让计算的Q值偏低一点。比如指标要求带宽200Hz，我经常按230到250Hz去设计。因为实际元件的损耗只会让带宽变宽，不会变窄。留这个余量，能帮你少出很多次差。