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做工业交换机的这几年，我切开过不少设备，也亲手画过好几版方案。今天这篇文章想把一套我比较满意的硬件设计思路完整拆开：以RTL8367S作为交换核心，用XS2184作为POE供电管理芯片，做一台5口千兆的工业级POE交换机。整机形态很常见——4个PoE电口加1个非PoE上联口，外加上联/级联扩展，放在导轨上，跑到-40到85℃的工业现场去带摄像头、无线AP和工业终端。

这类产品市面上方案很多，但真正把细节做对的并不多。POE交换机最容易被忽视的地方，恰恰不是交换芯片本身，而是供电链路、端口防护、信号与电源的耦合处理。这篇文章不打算讲空泛的选型对比，我会直接从系统架构拆到每一路电源、每一个电阻电容的取值思路，把为什么这样做讲透，再补上调试阶段遇到的真实问题和定位过程。不管你是刚开始接触硬件设计的学生，还是正在评估方案的工程师，这篇文章都能给你一条可以直接落地的设计路径。

1. 系统架构：一颗交换芯片加一颗PSE芯片怎么搭起整机

先看整机的核心构成。工业级POE交换机从功能上可以拆成三块：数据交换面、POE供电面、系统管理面。数据交换面负责以太网报文的线速转发；POE供电面负责通过网线给远端设备送48V直流电，同时不能干扰数据信号；系统管理面负责VLAN、QoS、端口状态监控这些二层管理功能。三块功能在硬件上并不是完全独立的，尤其POE供电链路和以太网信号链路在网口变压器处会交汇，这是整个设计中最需要小心处理的地方。

1.1 RTL8367S能干什么：交换芯片选型的关键权衡

RTL8367S在方案里承担的是数据交换核心。它是一颗5+2端口的千兆管理型交换芯片，内部集成了5个10/100/1000Mbps以太网PHY，对外还能扩展2个HSGMII/SGMII/RGMII接口。对我这个5口PoE加扩展上联的产品定位来说，这颗芯片的端口资源刚刚好：5个内置PHY直接对应5个前面板电口，剩下2个高速串行接口可以接光模块、外挂PHY做级联口，或者干脆留空降低BOM成本。

选型的时候我对比过好几颗方案。分立方案用独立的交换芯片加外置PHY，灵活度高，但BOM器件多、调试复杂、成本压不下来。消费级一体方案便宜，但工作温度范围通常只有0到70℃，在户外机柜和工厂车间里根本撑不住。RTL8367S折中得比较好：单芯片集成度高，官方资料和参考设计都比较完整，很多工业交换机和运营商设备都基于它做二次开发，渠道成熟度不用担心。功耗方面，这颗芯片全端口跑满时的典型功耗在2到3W这个量级，对整机电源设计来说压力不大。

另一个容易忽略的点是管理能力。RTL8367S内部有管理引擎，支持通过I2C、MDIO或者SPI接口访问全部寄存器，也支持外挂EEPROM做配置存储。这意味着同一套硬件既能做非管理型交换机，也能通过外接一颗MCU升级成网管型设备。我在这个项目里保留了管理接口，软件侧需要VLAN和QoS时可以直接在现有硬件上扩展，不用重新画板。

1.2 XS2184的实际角色：POE供电不是简单给48V

XS2184是一颗4通道的以太网供电PSE控制芯片，支持IEEE 802.3af和802.3at标准，也就是常说的PoE和PoE+。它在系统里的角色是POE供电面的核心：检测受电设备（PD）是否合法，判断PD的功率等级，然后控制对应端口的48V输出。

很多人第一次接触POE会以为POE交换机就是“网线里送电”，这个理解没错，但实现细节远比这复杂。PSE芯片不是简单的开关，它要完成一整套握手协议。以802.3af为例：PSE先在端口上施加一个低压探测信号，检测对端是否有一个25kΩ左右的特征电阻；确认是合法PD之后，PSE再通过分级信号判断PD属于哪个功率等级；分级完成后，PSE才会把48V电压完整送上。PD工作过程中PSE还要持续监测电流状态，出现过载、短路、PD拔出都要做出正确响应。XS2184把这些协议逻辑都集成在芯片内部，硬件工程师的工作就是把它外围的检测电阻、功率MOSFET、电流采样网络设计对，再通过I2C把状态读出来。

选XS2184看中的是它的外围简洁度和工业级可靠性。4个通道集成了大部分控制逻辑，每路外部只需配功率路径和检测网络，不像早期PSE方案那样需要一堆分立逻辑配合。芯片本身支持宽温工作，这对工业设备来说属于基本要求。

1.3 整机模块划分与接口定义

整机硬件按功能区块划分如下：

• 输入与保护：DC 48V输入、防反接、保险丝、浪涌防护、EMI滤波
• 电源转换：48V转各路低压，给交换芯片、PSE控制逻辑、MCU供电
• 交换核心：RTL8367S及其外围时钟、复位、EEPROM、管理接口
• POE供电：XS2184、四路功率MOSFET、检流网络、供电桥、变压器中心抽头电路
• 信号接口：网络变压器、RJ45座、ESD/TVS防护
• 管理扩展：预留MCU接口，实现VLAN/QoS配置和状态监控

接口定义方面，前面板4个电口支持PoE供电，单端口最大30W，第5个电口为上联口，不做POE供电。这样定义是贴合实际场景的：工业现场通常是4到8个摄像头或者AP需要供电，上行口接到核心交换机或者路由器，PoE口不够用时再通过千兆上联口级联下一台设备。

2. 交换核心电路设计：围绕RTL8367S的供电、时钟与端口

交换芯片能不能稳定工作，供电、时钟、复位、端口电路这四个方面缺一不可。下面把每一部分的关键设计决策和参数取值逻辑过一遍。

2.1 电源骨架设计：各路电压怎么来、时序怎么控

RTL8367S是一颗多电源域的芯片，内部有数字核心、IO接口、PHY模拟电路以及DDR等相关模块。按照数据手册要求，这个方案至少需要几路电源：核心数字电压1.0V、数字IO电压3.3V、PHY模拟电压1.0V（通常与核心电压同源或者单独滤波）、以及DDR/SerDes等模块的工作电压。不同模块对电源的纹波和瞬态响应要求不一样，不能全部用同一个电源轨直接拉过去。

我的做法是采用48V转5V的中间总线架构，再用5V生成各路低压。具体链路是这样的：

• 48V输入经过防反接和浪涌保护后，先进入一颗高效率的同步降压转换器，输出5V。这颗芯片选的是支持宽压输入的工业级型号，满载电流留了1.5倍裕量。
• 5V再通过一颗小封装DC-DC降压到1.0V，给RTL8367S核心和PHY模拟供电。这一路电流需求最大，直接LDO不可行，发热太严重，必须用开关电源。输出端用了低ESR的MLCC组合，配合合理的环路布局，把纹波控制在30mV以内。
• 3.3V直接从5V通过LDO获得，给IO、LED以及PSE芯片的逻辑部分供电。LDO虽然效率不高，但这路电流不大，换来的是干净的低纹波输出，有利于信号质量。

上电时序也要认真处理。RTL8367S虽然内部有上电复位电路，但外部供电顺序如果太随意，可能出现芯片内部闩锁风险。数据手册推荐的顺序是核心电压先建立，IO电压后建立。我在设计里用了一个简易的电源时序控制电路：核心电压DC-DC的PG（Power Good）信号控制3.3V LDO的使能脚，确保1V先起来、3.3V后到位。实际调测中这个时序安排很可靠，没出现过芯片启动异常的情况。

2.2 时钟、复位与配置：上电后芯片要稳定跑起来

交换芯片的时钟源用了25MHz无源晶体。这里有个工程细节：晶体旁边的负载电容不是随便选的，要根据晶体的负载电容参数来配。常见负载电容在18pF到20pF左右，两个电容串联后的等效值要等于晶体手册标称的负载电容。PCB走线时晶体的两条腿要尽量短，并且周围不要走高速信号，避免串扰导致时钟抖动。我在这版布局里把晶体放在了RTL8367S时钟脚附近，走线控制在5mm以内，实测时钟波形干净稳定。

复位电路用了带延时的复位芯片，上电后保持复位引脚低电平至少10ms，等各路电源完全稳定后才释放。这个延时对POE部分也很重要，因为XS2184也要在上电后完成初始化，如果交换芯片和PSE芯片的复位时序差太多，可能出现端口已经link上但POE还在初始化的怪问题。

配置方面，我在I2C总线上挂了一片EEPROM，用于存放交换芯片的默认配置和端口模式参数。芯片上电时会自动从EEPROM加载配置，这样非管理型应用不需要外接MCU也能按预定方式工作。如果你要做网管型，EEPROM就不是必需品了，MCU可以直接在启动后通过I2C把全套配置写进芯片。

2.3 MDI网络端口与变压器电路：信号和供电如何互不干扰

RTL8367S内置PHY的MDI端口是标准的差分信号对，四条线对应四对差分线：1/2、3/6、4/5、7/8。在以太网10/100M模式下只用1/2和3/6两对，千兆模式则四对全部使用。PCB布线上这四对差分线要严格控制100Ω差分阻抗，对内等长控制在10mil以内，对间等长控制在50mil以内。

网络变压器的选型要同时考虑信号和POE两个需求。信号方面，变压器起隔离和共模抑制的作用，初次级匝比1:1，隔离耐压至少1.5kV。POE方面，变压器必须支持中心抽头通过48V直流电流，所以不能用那种没有中心抽头引出或者功率余量不足的普通型号。我选的是支持POE/POE+应用的千兆变压器，初级中心抽头和次级中心抽头都引出来了，额定电流按350mA每端口设计，留了足够裕量。

到这里就能看出POE供电的物理路径了：48V直流电通过变压器中心抽头注入以太网链路，差分信号和直流供电在同一对线上共存。为什么互不干扰？因为差分信号是等幅反相的交流信号，在变压器初级线圈里大小相等、方向相反，产生的磁通相互抵消，而直流电流通过中心抽头时在线圈两端产生的是共模直流电压，不会在差分线上形成差分信号。反过来，差分信号在变压器次级中心抽头处也会因为磁通相消而不会引入到POE电源路径上。这就是POE能工作最基本的原理，理解了它，后面设计供电桥和防护电路就不会乱。

2.4 管理接口与LED指示：给上层软件留好接口

管理接口这部分，我在板上预留了一组I2C和一组UART接口。I2C用来接MCU或者调试工具，可以读写RTL8367S的全部寄存器；UART用来输出芯片内部调试信息，也可以在开发阶段配合SDK做协议调试。LED指示方面，每个端口至少需要两个状态：Link/Act和速度，POE端口还要有独立的POE供电指示。RTL8367S本身有LED驱动引脚，可以配置为不同显示模式，但通道数有限，POE状态我还是从XS2184的状态引脚单独拉过来控制LED，这样软件逻辑更清晰。

3. POE供电链路设计：XS2184外围与48V电源树

POE部分是整机最容易出问题的地方。很多初版方案画起来很快，一测试就暴露问题：要么检测不到PD，要么供电后掉电重启，要么端口雷击损坏。这一章的细节值得反复抠。

3.1 从宽压输入到各路电源的完整电源树

POE交换机的输入电源通常是工业现场的直流母线，最常见的是48V，但也有24V、36V甚至57V的情况。虽然POE标准规定PSE输出电压范围是44V到57V，但输入侧设计还是要按宽压处理，至少支持36V到57V，这样才能适配不同现场的供电环境。

电源树的顶层是三路并行：

1. 第一路直接进POE PSE功率链路。48V母线经过保险丝、浪涌保护后进入PSE的功率输入，这一路承载整机最大功率（4口满载约120W），走线必须足够宽，PCB铜厚和过孔数量都要单独核算。
2. 第二路经过前级的同步降压DC-DC转换成5V中间总线。这路给交换芯片、PHY、时钟、MCU等所有低压逻辑供电，输出电流按3A设计。
3. 第三路是5V转各路低压的子电源轨，按第二章里面说的方案生成1.0V和3.3V。

POE功率链路和低压逻辑电源之间要特别注意地平面的分割和单点连接。POE链路在供电瞬间会有一个很大的电流毛刺，如果和信号地没有处理好，这个毛刺会直接耦合到以太网信号和时钟上，导致丢包甚至端口link不稳。我这版采用在输入电源地接入点做单点星形接地，POE功率地、逻辑地、机壳地通过一个低阻抗连接点汇合，实测纹波表现良好。

3.2 XS2184的引脚规划与外围关键元件

XS2184作为4通道PSE控制器，外围电路的核心是每通道的功率路径和检测网络。这里把每通道的关键部分列一下：

• 功率输入：芯片的VPD（Power Device voltage）引脚接48V母线，每通道内部或者外部的功率开关控制输出。
• 电流采样：每个通道需要一颗精密检流电阻或者利用芯片内部检流机制，用来做限流和过载保护。电阻精度要求1%甚至0.5%，温漂系数要低，否则会影响电流判决精度。
• 检测与分级引脚：每个端口有一组检测引脚，外接电阻网络到RJ45对应线对。RTL8367S这类交换芯片和PSE芯片之间没有直接的电气连接，PSE通过检测引脚上的电压/电流变化完成PD检测。
• 工作电压：XS2184的逻辑部分用3.3V供电，芯片内部有独立的参考源，使用时参考手册配置去耦电容即可。
• I2C接口：四个通道的状态（检测中、分级中、供电中、过载、短路）都可以通过I2C寄存器读出来。这个接口在调试阶段非常重要，可以直接定位到某一端口处于哪个状态，不用盲猜。

外围元件的选型有几个容易踩的坑。检测引脚的电阻网络必须用精密电阻，这里如果用5%精度的普通贴片电阻，可能会导致检测阈值偏移，出现“明明连的是合法PD但芯片不识别”的问题。我在初版样板里就吃过这个亏，后来全部换成0.1%精度低温漂电阻，问题消失。另一个坑是检测引脚的旁路电容，电容值太大会拖慢检测信号的建立时间，导致PSE误判；太小又滤不掉干扰，容易误触发。我最终取的是手册推荐的典型值，实测在噪声环境下的误检率可以接受。

3.3 PoE端口供电桥与网络变压器的连接细节

每个PoE端口的外部电路连接顺序是：RJ45座 -> 网络变压器 -> 差分线对进入RTL8367S PHY；同时，从XS2184出来的48V正负极通过一个桥式整流电路，连接到网络变压器的中心抽头。

为什么需要桥式整流电路？因为以太网线缆有两种可能的线序约定。标准定义了一种叫Alternative B的供电方式，POE使用4/5和7/8这两对空闲线对供电；还有Alternative A方式，POE使用1/2和3/6数据线对供电，通过变压器中心抽头注入。不同PD设备可能采用不同的供电极性定义，加上现场网线可能不是标准直通线（比如交叉线），为了让电源极性适配到每个PD，PSE端就必须做极性自适应。

我在每路PoE端口上用4颗快恢复二极管组成全桥整流。48V经过全桥后极性统一，再接变压器中心抽头。这样无论网线对端是哪种接法，都能保证变压器次级送出的直流电压极性正确。二极管选型要特别注意反向耐压和正向压降：反向耐压至少要100V以上，正向压降越低越好，因为满载时每路电流约350mA，压降乘以电流就是发热，压降0.5V和1V之间的热耗差了一倍。

变压器中心抽头的直流通路和RJ45座之间，还串了一颗磁珠或者小电感，用来抑制高频噪声在POE电源路径上的传导。这个器件不能省，实测不加磁珠的情况下，千兆端口在POE满载时偶尔会出现FCS错误包，加上之后彻底消失。

3.4 功率预算、热设计与PCB铺铜策略

功率预算是POE交换机设计里必须前置考虑的问题。以4口PoE+计算，单口最大30W，4口满载就是120W。PSE功率链路本身的损耗包括桥式整流二极管压降、MOSFET导通损耗、线路和PCB铜箔损耗，整体效率大概在95%左右，也就是说POE部分会产生5到8W的热量。加上交换芯片的3W左右以及DC-DC转换损耗，整机在满载运行时的总发热量在10到15W之间。

这个热量在密闭工业外壳里必须认真处理，否则温升会直接降低电解电容和半导体器件的寿命。我的做法分三层：

1. PCB铜箔直接承载功率链路，48V母线和POE输出路径的走线宽度按1mm/A设计，并在顶层和底层都铺铜，通过过孔阵列连接增加散热路径。
2. DC-DC、功率MOSFET、桥式二极管等主要发热元件下方打密集过孔，把热量导到PCB背面的接地铜皮，再通过导热垫传导到金属外壳。
3. 整机采用铝制外壳，发热元件通过导热绝缘垫与外壳贴合。实测在45℃环境温度下满载运行，外壳最高温度大约在75℃左右，元件结温都在安全范围以内。

PCB铺铜的时候有个细节：POE功率地和大面积信号地要分开铺铜，再在输入电源地处单点汇接。如果整板一个完整地铜皮直接共用，POE电流的瞬态变化会在地平面产生噪声电压，千兆信号的眼图会变差。这个我在初版布局上试过，分开铺铜后信号质量明显改善。

4. 工业级可靠性与EMC：和消费级方案的本质区别

工业级产品和消费级产品最大的区别不只是温度范围标了多少，而是面对恶劣电磁环境和雷击浪涌时能不能扛得住。这一章把电源口、网口、PCB布局三个关键位置的设计方法讲清楚。

4.1 电源入口防护：防反接、浪涌与EMI滤波

工业现场的直流电源没有那么理想，接错线、电压波动、雷击耦合都能在电源入口制造麻烦。电源入口电路我按以下顺序排列：防反接 -> 保险丝 -> 共模电感 -> TVS/压敏 -> 输入电容。

防反接用的是一颗低导通压降的PMOS管，比串联肖特基二极管效率更高，压降只有几十毫伏，满载时损耗小。保险丝选的是慢断型，额定值按1.2倍最大输入电流选择，既能挡住短路故障，又不会被正常的浪涌电流打断。共模电感在这里的作用是抑制电源线上的共模干扰，一是防止外部干扰进来，二是防止内部开关电源的噪声传导出去。TVS管放在共模电感后面，把差模浪涌电压钳位在后级电路能承受的范围以内。

浪涌防护的测试标准主要参考IEC 61000-4-5，工业设备的常见要求是±2kV或者±4kV的浪涌抗扰度。TVS的钳位电压要选得比后级DC-DC的最大输入电压略高，同时比输入电容耐压略低，这样浪涌来了先被TVS吸收，不至于把DC-DC打坏。

4.2 网口防护：从变压器到TVS的系统化设计

以太网口的防护比电源口更讲究，因为要在保护电路的同时保持差分信号质量。网络变压器本身已经提供了隔离和一定的共模抑制能力，但面对雷击和ESD，光靠变压器是不够的。

我的网口防护设计分两级。第一级在RJ45侧，每对差分线上并联一对高压TVS管到机壳地，TVS的结电容要控制在几pF以下，否则会吃掉高速信号的上升沿。第二级在变压器初级和PHY之间，用共模电感加低压TVS的组合，抑制残余的共模电流进入PHY。这样两级防护配合，既保证信号质量，也把静电和雷击的能量泄放到机壳地而不是PHY芯片。

这里有个工程经验和大家分享：网口TVS的地要单独接到机壳地或者电源地的泄放点，不能直接大面积连到信号地上，否则ESD测试时泄放电流会在信号地上产生很大的瞬态电压，反而干扰PHY工作。我在测试中验证过，改成单独泄放路径之后，整机的ESD抗扰度提升明显。

4.3 宽温物料选型与工艺处理

-40到85℃的工作温度范围，对元器件的选型提出了硬性要求。普通民用级的MLCC电容在低温下容量会下降，高温下DC偏压特性也会变差。我在这版设计里要求所有电源路径上的电容都选X7R或者C0G介质，避免使用Z5U、Y5V这些温漂大的类型。电解电容在低温下ESR会变大，所以在需要大容值的输入输出滤波位置，我优先选用固态电容或者高分子电解电容，低温性能好很多。

DC-DC芯片和功率器件必须选工业级封装和温度等级。器件手册里给的结温范围，设计时要按降额使用，比如最高结温150℃的器件，我设计时控制实际最高结温不超过125℃。这样既保证寿命也保证在极端工况下的可靠性。

PCB工艺方面，板卡基材选TG170以上的高玻璃化转变温度板材，保证在高温下尺寸稳定；焊盘表面处理统一采用沉金工艺，防止裸露铜面在工业含硫环境中硫化变黑；整板在三防漆处理时，RJ95座、接口这些不需要涂敷的位置做遮挡，其余区域全部涂敷，有效防潮、防盐雾、防尘。

4.4 PCB布局布线的工程权衡

布局布线是硬件设计里最见功夫的地方。对这台交换机，布局的核心原则是"电源和高压区与信号和低压区物理隔离"。48V POE链路集中在板卡右侧，用一块独立的功率地铜皮承载；低压逻辑和交换芯片集中在板卡左侧；中间以变压器和光耦/隔离区过渡。这样布局的第一目标是缩短功率回路，第二目标是避免功率回路在信号区域形成干扰。

差分对布线的要求前面说过要控制100Ω阻抗和等长。另外还有几个容易被忽视的点：交换芯片PHY到网络变压器的距离尽量短，建议不超过800mil；变压器下方不能铺铜，否则会影响变压器的电气特性；差分对换层时需要注意回流路径，最好在旁边加地过孔。电源走线的载流能力可以用经验公式估算，必要的时候在顶层和底层并联走线降低电阻。

5. 调试流程、实测数据与典型故障

硬件设计画板只是开始，真正的问题都在调试阶段暴露。把调试过程中的顺序、方法和真实遇到过的坑记录下来，比任何理论分析都有参考价值。

5.1 样机调试顺序：先别急着插网线

样机焊好后我的调试顺序是这样的：先不加满功率，用可调电源调到48V限流200mA，空载上电。上电后第一时间检查各路电压是否正常、电流是否超标、板上有无明显发热点。空载电流异常大通常说明某路电源短路或者芯片焊接有问题，这时候要立刻断电排查。

电源没问题之后，用示波器检查25MHz晶振波形，确认交换芯片的时钟正常。然后检查复位释放时序，确认各路电源的PG信号按设计顺序到达。这几步通过后，芯片应该能正常加载EEPROM里的配置，连接到电脑的网口应该能link上。

我习惯先用单板自带的管理口（I2C转USB调试工具）读一遍RTL8367S的关键寄存器，确认芯片已经进入工作状态，再插网线做通信测试。如果直接插网线发现不通，不好判断是硬件问题还是芯片没初始化好，会把问题复杂化。

5.2 POE供电功能实测与PSE协议验证

POE功能的测试不能用普通网线直连电脑，必须用支持POE受电的设备（比如摄像头、AP）或者专用的POE测试仪。调试阶段我强烈建议准备一台支持802.3af/at协议分析的POE测试仪，它能看到PSE检测、分级、上电、断电的完整时序，比用真实PD盲测高效得多。

第一轮POE测试就发现了一个问题：第3个端口连接测试仪时检测不稳定，有时能识别PD，有时检测失败。用示波器抓XS2184的检测引脚波形，发现检测信号在到达阈值附近时会有几毫伏的噪声抖动，导致PSE判断结果不确定。排查原因是该端口的检测电阻网络离RJ95座太远，走线绕过了两个过孔，耦合到了DC-DC的开关噪声。我把该电阻网络就近改版后问题解决。这个案例说明：POE检测属于模拟小信号，对噪声非常敏感，Layout阶段就要想清楚路径。

功率测试方面，我用电子负载模拟PD，逐端口验证30W满载输出。满载上电时输入电压会有跌落，实测从48V跌到46.8V，在PSE允许的范围内。四口同时满载时测试输入功率，让整机连续运行两个小时，用热成像仪检查发热点，重点温度都在设计范围内。

5.3 性能与热实测数据

性能测试我用了标准的网络测试仪对交换芯片做吞吐和时延测试。5个千兆端口配置为双向线速转发时，丢包率为0，时延在正常范围内，说明交换核心设计没有问题。POE满载同时数据满负荷转发，也没有出现FCS错误包或者端口link down的情况，说明POE电源路径和信号路径的隔离设计是有效的。

热测试数据我记录了一组代表性数值：环境温度25℃时，整机满载运行稳定后，外壳底部约48℃，PoE桥式整流管附近PCB表面约70℃，DC-DC芯片表面约88℃，交换芯片表面约52℃。在45℃环境温度下做同样的满载测试，外壳大约到75℃，关键元件结温按热阻推算依然在降额范围内。这个热表现和之前计算的功率预算是吻合的。

5.4 踩坑案例与定位思路

再分享几个调试中比较典型的故障和定位思路。

第一个是某个PoE端口供电瞬间PD重启。现象是PD刚被识别并上电，几秒后自己断电重启。用示波器同时抓PSE输出电压和输入电源电压，发现PSE输出建立的瞬间，48V输入有比较大跌落。原因是POE大电容充电和PD启动电流叠加，在输入电源线上造成了过大的压降。解决方案是在PSE功率输入端增加大容量储能电容，同时适当调整软启动参数，让输出电压上升斜率变缓。

第二个问题是千兆端口link速率协商不到1000M，只能协商到100M。排查了网线、对手设备都没问题，最后用TDR时域反射计测了差分对阻抗，发现3/6线对在某个过孔附近阻抗突变到了约130Ω。原因是这一对差分线在换层时没有做完整的回流过孔设计，导致回流路径断裂。修正布线后问题消失。

第三个问题是ESD测试中，空气放电8kV时部分端口出现丢包甚至link down。定位发现网口TVS的泄放路径过长，且经过了一个狭窄的铜皮瓶颈。重新布局泄放路径，加宽铜皮，缩短到机壳地的连接，复测后通过。

6. 设计复盘：POE与交换协同的几个关键决策

最后把这版设计里几个关键决策复盘一下，这些决策决定了整个项目的走向和成本，也决定了后续迭代的灵活性。

第一个决策是选择了5+2口架构而不是8口纯交换架构。5个内置PHY直接对应前面板端口，不需要外挂PHY，BOM简单很多。XS2184提供4路PoE，对应主流的4+1端口形态；如果以后要扩展8口PoE，用两颗XS2184加外挂PHY就能变体，但主板布局上需要在交换芯片的HSGMII接口处预留出PHY的位置和功耗空间，这版已经没有余量。所以如果你明确定位是8口产品，前期架构就需要预留。

第二个决策是管理功能采用“内部管理引擎+外部EEPROM”作为基础，MCU作为可选。这样非管理型产品不需要额外MCU，管理和成本都占优；网管型则通过预留的I2C接口扩展。这个决策让一款板卡覆盖两个细分市场，对中小批量项目来说比较划算。

第三个决策是POE链路和低压逻辑电源严格分开布设，只在输入地单点连接。这虽然看似增加了地平面的分割复杂度，但它让信号质量和EMC性能都有了保障。初版画图时可以贪快把地平面做得一整片，后来测试发现POE满载时出现信号质量下降，回到分割地设计后才解决。工业交换机的数据可靠性，很多时候就是这些看似“不必要”的隔离带来的。

最后说一个我比较坚持的细节：所有对外接口、电源入口、关键控制引脚，在原理图阶段就加好测试点。调试阶段每当出现奇怪问题，这些测试点能让你快速用示波器抓波形，而不是拿着万用表在密密麻麻的器件里乱戳。这个习惯帮我省下的时间，远远超过画原理图时多花的那一点功夫。