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简介：这份高频电路基础PPT面向电子工程、通信类课程的学习者与授课教师，聚焦选频网络中的串联谐振回路这一核心知识点，适合用作课堂讲义、复习提纲或自学入门材料。压缩包内仅含1个PPT文件，体积约755KB，篇幅精炼，便于在投影授课或移动设备上直接翻阅。内容围绕谐振频率、品质因数Q、谐振曲线、通频带与相频特性展开，并延伸到信号源内阻及负载对回路Q值的影响，配有阻抗随频率变化的推导与结论总结。已有169人学习，可帮助读者快速建立串联谐振的物理图像，理解Q值与选择性和带宽之间的权衡，并留意电压谐振带来的元件耐压问题，为后续并联谐振与部分接入回路的学习打基础。

1. 谐振点上，电感和电容两端的电压为什么会比输入高出上百倍

学高频电路的人第一次撞见“电压谐振”这个说法，多半会愣一下：信号源明明只给了 1 V，电感和电容两端却能测到几十伏甚至上百伏，能量是凭空多出来的吗？并没有，只是储能元件之间来回倒手，电阻每周期只抽走很小一份。理解这件事的钥匙是品质因数 Q，而 Q 又同时决定了选频网络的选择性和通频带——这三个量在数学上被同一个式子绑死。高频电路里大量看起来像玄学的设计取舍，从中频滤波器到天线前端的选频网络，追到底都是这条绑带在起作用。把串联、并联两种谐振回路的阻抗、Q 值与带宽关系拆开走一遍，再回头看那些电路，公式就不再是需要硬背的东西了。

2. 串联谐振：阻抗为什么会在某个频率上塌陷成纯电阻

把电感线圈和电容器串起来，再接一个信号源，得到的这个单振荡回路，是高频电路里最基本的一种结构。它的关键特征是：在绝大多数频率上阻抗都比较大，但偏偏在某个频率上阻抗取最小值，而且这个最小值恰好就是电阻本身。这个频率就是谐振频率，这个现象就是谐振特性。下面从阻抗表达式一步步拆。

2.1 复阻抗里两个反向变化的量

串联回路的阻抗可以写成：

Z = R + j(ωL - 1/(ωC))

两个虚部项的行为完全相反。感抗 ωL 随频率线性上升，容抗 1/(ωC) 随频率反比下降。频率低的时候容抗占主导，频率高的时候感抗占主导，中间必然有某一个点两者大小相等。令 ωL = 1/(ωC)，解出：

ω0 = 1/√(LC) f0 = 1/(2π√(LC))

这就是谐振频率，它只由 L 和 C 决定，和 R 完全无关。R 不参与决定“在哪里谐振”，只决定“谐振得有多尖锐”。这个分工非常重要，后面讲 Q 值时还会反复用到。

谐振时虚部相互抵消，Z = R，阻抗变成纯电阻。此时电流 I = Vs/R 达到最大值，并且与电源电压同相。原文里那句“L 与 C 好像虚短，仅有 R 存在”，说的就是这个状态——不是真的短路，而是从端口看进去，电抗部分对外不表现。

需要澄清一个常见误解：虚部抵消不等于能量不经过 L 和 C。恰恰相反，谐振时 L 和 C 上的电压幅值都很大，能量在二者之间以两倍谐振频率来回振荡，只是每个周期里电场能和磁场能互相转换，从电源净吸收的只有电阻消耗的那部分。

2.2 谐振点两侧：容性与感性的翻转

偏离谐振点之后，情况按照一个很干净的规律翻转：

• ω < ω0 时，容抗大于感抗，净电抗 x < 0，回路呈容性，电流超前电压
• ω > ω0 时，感抗大于容抗，净电抗 x > 0，回路呈感性，电流滞后电压
• ω = ω0 时，x = 0，回路呈纯阻性，电流与电压同相

阻抗角 φz = arctan(x/R) 就是这条翻转规律的直接体现。而回路电流的相角 ψ 是阻抗角的负值，ψ = -φz。这是很多人画相频特性曲线时容易搞反的地方：电流相角曲线和阻抗角曲线关于横轴镜像，不是同一条。

Q 值不同的时候，相频特性曲线的陡峭程度也不同。Q 越大，相角在谐振点附近变化越剧烈，这意味着回路对频率偏移的“分辨力”越强，但同时也意味着相位失真在通带边缘会更明显。做调频或者相位敏感的系统时，这条曲线的影响不能忽略。

2.3 用一段代码把阻抗曲线扫出来

纸面上的公式看懂了，还是要让曲线跑一遍，才能对“塌陷”这个词有实感。

import numpy as np # 串联谐振回路参数：L=10uH, C=100pF, R=1ohm L = 10e-6 C = 100e-12 R = 1.0 f0 = 1 / (2 * np.pi * np.sqrt(L * C)) # 谐振频率 rho = np.sqrt(L / C) # 特性阻抗 Q = rho / R # 空载品质因数 # 在谐振频率上下各扫 50% 的区间，点数取奇数保证恰好落在 f0 上 f = np.linspace(f0 * 0.5, f0 * 1.5, 2001) w = 2 * np.pi * f X = w * L - 1 / (w * C) # 净电抗，谐振点处过零 Z = R + 1j * X # 复阻抗 magZ = np.abs(Z) # 阻抗幅值 phiZ = np.angle(Z, deg=True) # 阻抗角，单位度 idx = np.argmin(magZ) # 找到阻抗最小点 print(f"f0={f0/1e6:.3f} MHz, rho={rho:.1f} ohm, Q={Q:.1f}") print(f"扫频最小值出现在 {f[idx]/1e6:.3f} MHz, |Z|={magZ[idx]:.3f} ohm")

这段代码做了三件事：算谐振频率、算特性阻抗和 Q、扫频验证阻抗最小值落在哪里。rho = sqrt(L/C)这个量叫特性阻抗，谐振时它等于感抗也等于容抗，是后面定义 Q 的分母之外的另一个关键量。np.linspace取 2001 个点是为了让采样点精确覆盖 f0，否则打印出的最小值位置会带有采样误差，容易让人误以为公式算错了。

跑出来会看到：在 f0 处 |Z| 精确等于 1 Ω，向两侧迅速上升，同时阻抗角从 -90° 附近经 0° 翻到 +90° 附近。Q 越大，这条 V 形曲线越窄、两侧爬升越陡。把 R 从 1 Ω 改成 10 Ω 再跑一遍，f0 一动不动，只有曲线形状变钝——这就是前面说的“R 不决定谐振位置，只决定尖锐程度”。

有一点值得注意：真实的电感线圈不是理想电感，它自带绕线电阻和寄生电容，真实电容也带等效串联电感。所以实测的谐振点常常比 1/(2π√(LC)) 低几个百分点，这是高频电路里最常见的“纸上算得好好的，焊上去就不是那个数”的来源。

3. 品质因数 Q：一个无量纲数为什么同时锁死了选择性和带宽

3.1 Q 的定义与它的物理含义

原文给出的定义很直接：谐振时回路感抗值（或容抗值）与回路电阻 R 的比值。写成式子：

Q = ρ/R = ω0L/R = 1/(ω0CR)

三个表达式是等价的，因为谐振时 ω0L = 1/(ω0C) = ρ。用哪个取决于手上已知哪几个参数。

但 Q 真正有价值的不是这个比值形式，而是它的能量含义：Q 等于 2π 乘以回路储存的能量与每周期消耗能量之比。这个定义解释了为什么 Q 高的回路“振得住”——储能远大于每周期损耗，振荡能维持很多个周期才衰减下去。也正因为如此，Q 高必然意味着通带窄：一个对频率不敏感的回路，本质上就是损耗大的回路。

这里有一个天然的量级感受：一般 LC 回路的 Q 在几十到几百之间。空心线圈能做到一百上下，带磁芯的可能更低，而石英晶体这种压电谐振器能到上万甚至更高。Q 的量级直接决定了这个器件能用在什么场合。

3.2 归一化谐振曲线 N(f)

把回路电流写成谐振电流的倍数，得到一个只跟失谐程度有关的函数：

N(f) = I/I0 = 1 / (1 + jξ) ξ = Q(ω/ω0 - ω0/ω)

ξ 叫广义失谐。它的幅值 |N| = 1/√(1+ξ²)，就是归一化幅频特性。注意这个函数里已经没有 L、C、R 的具体数值了，只剩下 Q 和归一化频率 f/f0 两个变量。这意味着：Q 相同的两个回路，形状完全一样，不管它们工作在 1 MHz 还是 1 GHz。这是高频电路里做归一化设计的理论基础。

原文提到 Q 值大曲线尖锐、选择性好，Q 值小曲线钝、通带宽——这句话在这里就有了数学支撑。Q 出现在 ξ 的系数位置上，它放大的不是曲线的幅值，而是“同样的频率偏移下失谐有多严重”。

3.3 通频带：那个 0.707 是怎么来的

通频带的定义是电流幅值下降到谐振电流的 1/√2 时对应的频率范围。代入 |N| = 1/√2：

1/√(1+ξ²) = 1/√2 → ξ = ±1

在两个截止点上解出带宽：

B = f2 - f1 = f0/Q

这个式子是全篇最需要记的一条。它把 Q 和带宽直接锁死：Q 提高一倍，带宽缩一半，中间没有任何调节余地。工程上想同时要“高选择性”和“宽通带”，单靠一个 LC 回路是做不到的，只能走多级级联、耦合回路或者后面用数字滤波。

单谐振回路的矩形系数（B0.1/B0.7）按同样的归一化曲线推一遍大约是 9.95，距离理想值 1 差得很远。这个数字说明单回路的“选择性”其实很粗糙——它只能保证通带内平坦、通带外缓慢下降，做不到陡峭的裙边。这也是为什么实际的接收机前端几乎不会只用一级 LC 选频。

3.4 电压谐振：Q 值带来的第二个后果

谐振时电感和电容上的电压幅值：

VL = VC = Q · Vs

这就是开篇那个反直觉现象的来源。Q = 100、输入 1 V 的时候，L 和 C 两端各有 100 V。而且这两个电压相量大小相等、方向相反，加起来为零，所以从端口外部完全看不出来——这就是典型的黑匣子效应，仪器在端口上测不出异常，元件内部却承受着高压。

实际设计中这条必须前置考虑。选电容不能只看容量和精度，耐压要按 Q·Vs 估算再留裕量；选电感要考虑匝间绝缘和磁芯饱和。很多高频电路烧电容，不是功率不够，是耐压没算这一项。对于 Q 达到几百的回路，这个倍数足以让一个标称 50 V 的电容直接炸开。

有一点需要注意：这里的 Q 是空载 Q。接入信号源和负载后，实际承受的电压倍数要按有载 Q 计算，通常比空载 Q 低不少。但如果信号源内阻很小、负载又很轻，两者会非常接近。

3.5 有载 Q：真实电路里那个更小的数

上面所有推导都假设回路的损耗只有 R。真实电路里，信号源有内阻 Rs，负载有电阻 RL，它们串在回路里，一样消耗能量。于是：

Q0 = ω0L / R (无载 Q，空载 Q) QL = ω0L / (R + Rs + RL) (有载 Q)

显然 QL < Q0。有载 Q 才是决定实际通频带的那个数，带宽应该按 B = f0/QL 算。用空载 Q 算带宽，得到的永远是偏窄的乐观值。

这条结论还顺带给出了串联谐振回路的适用边界：它适合信号源内阻很小（接近恒压源）并且负载电阻也不大的场合。因为 Rs 和 RL 都是直接串进回路的，任何一个偏大都会把 QL 拉垮。如果源内阻很大，串联回路根本没法用，这时候该换并联结构。

3.6 把带宽和矩形系数一起算一遍

# 沿用上一段的参数 B = f0 / Q # 空载 3dB 通频带 Q_load = rho / (R + 5 + 50) # 假设 Rs=5ohm, RL=50ohm B_load = f0 / Q_load # 有载通频带 # 扫出 0.1 倍电流对应的带宽，验证矩形系数 xi = Q * (f / f0 - f0 / f) N = 1 / np.sqrt(1 + xi**2) f_01 = f[np.where(N >= 0.1)[0][0]] # 下边沿 f_02 = f[np.where(N >= 0.1)[0][-1]] # 上边沿 print(f"空载 B={B/1e3:.1f} kHz, 有载 B={B_load/1e3:.1f} kHz") print(f"B0.1/B0.7 = {(f_02-f_01)/B:.2f}")

关键参数是R + 5 + 50这一项：把源内阻和负载电阻直接加进串联回路的总电阻。改一下这两个数就能直观看到 QL 掉得多快——50 Ω 的负载接进一个 R 只有 1 Ω 的回路，QL 会掉到原来的五十分之一左右，带宽相应扩大五十倍。这个数量级的恶化，靠调 L 或 C 是救不回来的，只能改拓扑。

N >= 0.1那两行是在扫频结果里找 0.1 倍电流对应的两个频率点，用来核对矩形系数。扫频点密度不够的话这个值会有偏差，2001 点在窄带情况下可能不够细，实际验证时可以把点数加大。

4. 并联谐振：为什么谐振时阻抗最大、支路电流却是总电流的 Q 倍

4.1 换成导纳来看，一切都对偶

并联回路由电感线圈、电容 C 和外加信号源相互并联构成。它的分析和串联完全对偶，但要把阻抗换成导纳：

Y = G + j(ωC - 1/(ωL))

谐振条件依然是虚部为零，也就是 ωC = 1/(ωL)，解出来的频率还是 ω0 = 1/√(LC)。和串联一模一样，这不是巧合，是同一个能量平衡条件的两种写法。

谐振时 Y = G，阻抗取最大值 Z0 = 1/G = R0。这里 R0 是并联损耗电阻，代表回路自身的损耗。注意串联回路的标志是阻抗最小，并联回路的标志是阻抗最大，这是两者最根本的差别，也是最容易记混的一条。

工程上常用另一个形式表达谐振阻抗：

R0 = L/(CR) = Q·ρ

这个式子把 R0 和 Q 联系起来了：Q 越高，谐振阻抗越大。一个 Q=100、ρ=100 Ω 的并联回路，谐振阻抗就是 10 kΩ。这个高阻抗特性决定了并联回路的用法——它适合做高阻抗负载场合的选频，比如晶体管集电极负载。

阻抗的频率特性可以写成：

Z = R0 / (1 + jξ), |Z| = R0 / √(1+ξ²) ξ = Q·2Δf/f0

Q 越大，阻抗特性曲线越陡峭。这和串联回路“Q 越大电流曲线越尖锐”是同一件事的两种表述。

4.2 电流谐振：支路里的大电流从哪来

谐振时电感支路或电容支路的电流幅值是外加电流源 Is 的 Q 倍：

IL = IC = Q · Is

所以并联谐振又叫电流谐振。Q 是几十到几百的时候，信号源只给一点电流，支路内部却在跑几十上百倍的电流。这和串联的电压谐振完全对称：一个放大电压，一个放大电流。

实际影响也很实在。并联回路的电感线圈必须按 Q·Is 选线径，否则绕线发热甚至烧断；电容的纹波电流额定值也要对得上。很多人在小信号场合忽略这一点没事，一旦功率上去就会翻车。

原文给出的 Q 定义在这里是 Q = R0/(ω0L) = ω0CR0，和串联的 Q = ω0L/R 形式不同，因为 R 在串联里是串联电阻、在并联里是并联电阻，两者的地位正好互换。

4.3 三种失谐：绝对、相对、广义

原文明确区分了三个概念，这三个在实际计算里经常被混用：

广义失谐是唯一能直接进公式的那个。注意 ξ 的表达式里有一个近似：ω/ω0 - ω0/ω ≈ 2Δf/f0，这个近似只在 Δf/f0 很小的时候成立。窄带情况下误差可以忽略，但当失谐量达到中心频率的 20% 以上时，误差会迅速变大，用近似式算出来的衰减量会明显偏离真实值。做宽带或者大失谐分析时必须用完整表达式。

4.4 串并联的对偶关系

把两种回路的特性并排放，对偶关系一目了然：

最后两行是选型时的分水岭。信号源内阻小、负载也小，用串联；信号源内阻大、负载大，用并联。选错了不是不能工作，而是 QL 会难看到无法接受。

4.5 部分接入：为什么要把负载“抽头”接进来

实际电路里，负载电阻往往和回路谐振阻抗不在一个量级。一个 10 kΩ 的并联谐振回路直接并上 50 Ω 负载，等效 Q 会掉到几乎为零，选频功能直接消失。这时候的常见做法是部分接入——把负载接到电感或电容的抽头上，而不是接到回路两端。

设接入系数 p 为接入点电压与回路总电压之比，那么从回路两端看进去，负载的等效并联电阻变成 RL/p²。p 越小，等效电阻越大，对 QL 的拉低越少。代价是传送到负载的功率按 p² 比例下降。这就是一个典型的取舍：要选择性就得牺牲增益，要增益就得牺牲选择性。

这个思路在后面各种阻抗变换网络里反复出现，本质都是用变压比换取阻抗匹配，只不过实现方式从抽头变成了耦合电容或者变压器绕组。

5. 避坑与排查：谐振回路在仿真和实测里最容易翻车的五处

5.1 谐振频率对不上公式

现象：仿真或者实测的谐振点比 1/(2π√(LC)) 偏低几个百分点，Q 越高偏得越明显。

原因：用的是理想元件模型。真实电感有绕线电阻和分布电容，真实电容有等效串联电感，这些寄生参数在低频时可以忽略，到了高频就把等效的 L 和 C 改掉了。

解决：仿真时用带寄生的元件模型，至少给电感串一个电阻、并一个小电容；实测时先扫一遍宽频段定位真正的极小值点，再和理论值比对，而不是只在理论值附近扫。如果偏差在 5% 以内且随 Q 升高而增大，基本可以确认是寄生参数而非计算错误。

5.2 实测 Q 值远低于手算

现象：按 ω0L/R 算出来 Q 是 80，实测只有 15。

原因：算的是空载 Q，测的是有载 Q。信号源内阻和负载电阻都串在（或并在）回路里，它们消耗的能量一样要计入总损耗。

解决：先确认测试夹具和仪器端口阻抗有没有算进回路。串联回路按 QL = ω0L/(R+Rs+RL) 复算，并联回路按并联等效电阻复算。如果复算后仍然差距大，再怀疑元件本身的损耗（磁芯损耗、介质损耗），这些在高频下往往比直流电阻大得多。

5.3 电容在谐振时击穿

现象：小信号电路，输入不到 1 V，谐振时电容炸了。

原因：只按输入电压选了耐压。谐振时电容两端是 Q·Vs，Q=100 的时候就是 100 倍。

解决：选型时按 Q·Vs 估算峰值电压，再留 1.5 到 2 倍裕量。同时确认 Q 用的是空载值还是实测有载值——如果信号源内阻很小而负载很轻，实际承受的电压会接近空载 Q 对应的值。这条在功率电路里更要紧，因为还要叠加支路电流带来的发热。

5.4 广义失谐的近似式用超了范围

现象：按 ξ = 2QΔf/f0 算出来的衰减量和仿真对不上，偏差随失谐量增大而变大。

原因：这个近似来自 ω/ω0 - ω0/ω 在 ω ≈ ω0 时的一阶展开。失谐量超过中心频率 10% 之后，二阶以上的项就不能丢了。

解决：|Δf/f0| < 0.1 时用近似式，超出就老老实实代 ξ = Q(ω/ω0 - ω0/ω)。做宽带或者大失谐抑制分析时，直接扫频算完整表达式，不要图省事。

5.5 串联、并联的源类型选反

现象：按公式设计的并联回路，接上低内阻信号源后完全测不出选频效果，阻抗曲线几乎是平的。

原因：并联谐振回路要求高内阻的信号源。低内阻源并上去相当于在回路两端短接了一个很小的电阻，把 QL 压到接近零。

解决：要么换成串联结构，要么在源和回路之间加阻抗变换（抽头接入、变压器耦合），把源的等效并联电阻抬上去。反过来，串联回路接高内阻源也有同样的问题，只是表现成通带被拉宽而不是完全失效，更容易被忽略。

6. 设计取舍：Q 值、带宽和阻抗匹配之间的三方拉锯

走到这里可以发现，整个选频网络的设计其实只有一个核心矛盾：Q 值只有一个，它同时决定了三件事——选择性、通频带、以及谐振时元件承受的电压或电流倍数。这三个需求在方向上并不一致。

要高选择性，就得高 Q；要高 Q，带宽就按 B = f0/Q 缩窄；带宽窄了，温度漂移、元件容差、信号本身的频率稳定度都会变成问题。一个 f0 = 10 MHz、B = 10 kHz 的回路，Q 需要 1000，而元件的容差只要让 f0 偏 0.1%，通带就已经偏出了十分之一。这时候要么用更高精度的元件，要么引入调谐机制，要么降低指标。

第二个拉锯在阻抗匹配上。并联回路的谐振阻抗 R0 = Q·ρ，Q 高的时候 R0 也高，动辄几十千欧。而实际的源和负载往往是几十欧到几百欧的量级，直接并上去会把 QL 拉到没法用。部分接入就是为这个矛盾准备的：用接入系数 p 把负载的等效并联电阻抬高 1/p² 倍，代价是功率传输按 p² 下降。这里的取舍没有通解，只能按具体链路的增益预算和选择性要求来配。

第三个容易被忽略的是矩形系数。单回路的 B0.1/B0.7 大约 9.95，意味着在 0.1 倍电流点上的带宽是 3dB 带宽的十倍。如果系统对邻道抑制有硬要求，单级回路无论怎么调 Q 都满足不了——Q 调高只是把整个裙边等比压缩，形状不变。出路只有多级级联或者改变拓扑，而级联又会带来级间失配和增益下降。我在看一个选频方案时会先把这三条并排写下来：需要多少邻道抑制、允许多少插损、元件容差能做到多少。三个数一摆，Q 的取值区间基本就被夹出来了，剩下的只是选元件。

验证方法上，纸面算完之后至少要跑两遍扫频：一遍用理想元件确认公式推导没写错，一遍加上寄生参数和真实的源、负载阻抗，看有载 Q 落在哪个区间。两遍结果差得远，先查是不是漏算了 Rs 和 RL，再查寄生参数的量级是不是估错了。

从那以后我每次画完一个谐振回路，都会先把空载 Q 和有载 Q 并排写在图纸边上，再把 Q·Vs 的峰值电压标在电容旁边，两行数字不齐全就不动手选元件。这个习惯来自一次 50 V 耐压电容在 3 V 输入下炸开的经历，当时所有公式都算对了，唯独漏了 Q 这个乘数。希望帮到你。

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