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简介：数字逻辑实验报告.docx 面向电子工程、计算机等专业修读数字逻辑电路课程的学生，聚焦同步计数器设计与七段译码显示这一典型实验环节，提供可直接参考的完整实验记录范本。文件为单个 docx 文档，压缩包约 5.1MB，内含实验目的、设备器件清单（74LS47、74LS163、74LS74、7486 等）、标有引脚号的电路图、状态表与状态转换图、实测数据表格及结果分析，完整还原了移位寄存器型计数器分析、BCD 码与七段显示对应关系校验、可预置同步模 5 计数器设计这三段实验过程。其中对错误状态表的发现与修正、预置端置 0 置 1 的操作要点及计数验证记录尤具参考价值，读者可据此对照搭建电路、核对激励函数与次态表、排查接线与悬空端问题，也可作为课程实验报告的格式与组织思路借鉴。目前已有 2234 人学习下载，适合课前预习、实验课对照操作与期末复习使用。

1. 同步计数器与七段译码显示：这份实验报告要交出的是一条可复核的链路

模5计数器预置成 2，按一次单脉冲，数码管跳到 3，再按一次回到 0。数字逻辑实验里最容易卡住的往往就是这个瞬间：前面分析移位寄存器型计数器，照着电路图读一读反馈线就能推出状态表；到了模5这部分，得自己从状态图倒推次态方程，把方程变成 D 触发器和门电路的接线，再接上 74LS47 驱动 DL707，让计数结果真的显示出来。这份实验报告记录的是三件事：反推一个现成计数器的完整状态转换关系、验证 BCD 码到七段显示的映射、用 D 触发器加门电路设计一个可预置初值的同步模五计数器，最终交出一条从激励函数到实测记录的闭环。要交数字逻辑实验报告、做数字电路课程设计的人，都可以照着这套链路走一遍。

2. 器件与电路底座：四片芯片撑起的计数显示链路

2.1 器件清单与信号流向

先把链路画清楚，再动手接线。这套实验的信号是从时钟源向显示器单向流动的：单脉冲源给出上升沿，触发器或计数器在每个上升沿更新一次四位状态，四位状态作为 BCD 码送进译码驱动器，驱动器把四位码翻译成七段控制信号，最后点亮数码管对应的段。中间任何一级接错，现象都会表现为“数码管显示不对”，但根因可能在三步之外。

两片 74LS74 一共给出 4 个 D 触发器，这正好是做一位十六进制计数或四位移位寄存器的最小配置。选 74LS74 而不是 74LS174 这类六触发器，是因为它的置位端和清零端都引到了外部引脚，预置初值这个动作可以直接靠拨开关完成，不用额外搭置数电路——这也是这套实验能把“可预置”做出来的关键。360Ω 电阻准备 6 只，是因为实际只用到 a~g 七段中的六段，或者按实验箱的段位分组接，接线前先对着数码管引脚确认一遍，别默认七段都要。

实验箱在这套方案里承担的是电源和信号源两个角色，单脉冲输出必须确认是“按一次出一个完整脉冲”，不是电平开关。有些实验箱的单脉冲按键带消抖电路，有些没有，接上之后先用示波器或 LED 观察一次，确认按下只跳一个状态，后面记录数据才有意义。

2.2 三个电气约束：悬空端、限流电阻、共阳极

第一个约束是触发器的置 0 端和置 1 端不能悬空。74LS74 的 PRE' 和 CLR' 都是低电平有效，悬空时 TTL 输入在电气上偏向高电平，看起来是“没动作”，但抗干扰能力极差，手指靠近、电源波动、相邻导线串扰都可能让它瞬间被拉低，触发器就被异步置位或清零。血泪经验是：这类故障不会稳定复现，你查线查半天都是对的，一上电就乱跳。做法是用 1KΩ 电阻把这两个端上拉到 VCC，开关要拉低时再接地，保证任何一个时刻引脚都有明确的电平。

第二个约束是 74LS47 的输出结构。它的 a~g 是集电极开路输出，低电平有效，自己不会限制电流，必须外接限流电阻再到 LED 段。省掉电阻直接接，数码管某段瞬间电流可能到几十毫安，轻则亮度异常、段码错乱，重则烧段。按 VCC 取 5V、LED 正向压降约 1.8~2.0V、74LS47 低电平输出饱和压降约 0.3~0.5V 估算，360Ω 上的电流大约是 (5−2.0−0.4)/360 ≈ 7.2mA，亮度足够，也在器件承受范围内。这个值是估算起点，实际接线后如果某段偏暗，先查该段电阻有没有虚接，不要一上来就减小阻值。

第三个约束是共阳极接法。DL707 是共阳极显示器，公共端接 VCC，各段阴极经限流电阻接 74LS47 的输出。这意味着 74LS47 输出低电平时段才亮，高电平时段灭。很多人在读译码器真值表时习惯“1 表示亮”，接完发现显示的是反码图形，就是这一步没转过来。译码器的灯测试端 LT' 和消隐端 BI'/RBO' 在正常显示时都要接高电平，灭零输入 RBI' 按需要接高或接低，接错会出现“数码管全灭”或“全亮八”这两种典型现象。

3. 移位寄存器型计数器：从电路图反推激励函数与状态转换图

3.1 读图写激励函数的固定套路

这一步的目标是把一张只有连线的电路图，翻译成一组带下标的布尔表达式。方法是逐个触发器看：找到每个 D 触发器的 D 输入端，沿着线往回追，追到哪个触发器的输出、经过了哪个门，就把那段逻辑写成 y1~y4 的表达式。这套电路读出来的结果是：

D1 = y4' · (y1 + y3') D2 = y1 D3 = y2 D4 = y3

四个式子里有三个是纯移位关系（D2 接 y1、D3 接 y2、D4 接 y3），只有 D1 带反馈，反馈函数是 f = y4'·(y1 + y3')。判断电路性质就看这一点：如果四个 D 端都是上一级输出，那是纯移位寄存器；只有第一级带反馈，才是移位寄存器型计数器。反馈函数决定了状态序列，也决定了这个计数器能用到 16 个状态里的哪几个。

读图阶段还有两件事要同步做：一是按器件手册在图上标出每片芯片的引脚号，74LS74 里两个触发器分属不同引脚，标错一个就会把时钟接到另一个触发器上；二是把未用门的输入端处理掉，7408、74LS86 里没用到的门，输入端不能悬空，接地或接 VCC 都行，但必须固定。这两件事在图上做完再动手接线，比接完再查省一半时间。

3.2 逐拍推演状态表，定位漏掉的状态

有了激励函数就能逐拍推。次态的四位就是四个 D 端的当前值，即 (D1, D2, D3, D4) = (f, y1, y2, y3)。从全零开始推：

第一次实验只记到 1111→0111 就停了，得出“状态表有错”的结论，问题出在推演方式上：手工推的时候容易顺着“看起来会继续”的方向走，看到 1111 就以为下一拍还是全 1，实际上 y4=1 时 y4'=0，反馈项被直接掐断，D1 强制为 0，下一拍必然是 0111。修正后的表是 8 个状态的首尾相接循环，模 8 计数器，这才是完整结果。这里的关键动作是：每推一拍，都回到激励函数里代一次值，不要凭直觉续写。

推完 8 个状态还要问一句：剩下 8 个状态去哪了？答案是它们不在主循环上。电路如果因为干扰落进这些状态，能不能自己回来，决定了这个计数器有没有自启动能力。手工验算 8 个状态很枯燥，用一段小脚本枚举更稳：

def next_state(s): """s = (y1, y2, y3, y4)，返回次态""" y1, y2, y3, y4 = s d1 = (1 - y4) & (y1 | (1 - y3)) # D1 = y4'·(y1 + y3') return (d1, y1, y2, y3) # D2=y1, D3=y2, D4=y3 串行移位 # 主循环 8 个状态，按推演顺序排列 loop = [(0,0,0,0), (1,0,0,0), (1,1,0,0), (1,1,1,0), (1,1,1,1), (0,1,1,1), (0,0,1,1), (0,0,0,1)] for n in range(16): s = tuple((n >> i) & 1 for i in (3, 2, 1, 0)) path, steps = [s], 0 while s not in loop and steps < 16: # 最多走 16 拍防止死循环 s = next_state(s) path.append(s) steps += 1 print(''.join(map(str, path[0])), '->', ' -> '.join(''.join(map(str, p)) for p in path[1:]), '| 入圈步数:', steps)

脚本里的(n >> i) & 1负责把 0~15 展开成四位二进制，位序按 y1 为最高位排列，与上面的状态表一致；loop是从推演结果抄下来的主循环，作为收敛判据；steps上限设 16 是防止电路真有孤立环时死循环。跑完会发现所有 16 个状态都能进主循环，最多绕 5 拍，比如 1001→0100→1010→1101→0110→0011，第 5 拍落到主循环里的 0011。这个结论比“实验成功”四个字有分量得多，答辩被问到“万一跑飞了怎么办”，答的就是这段。

3.3 状态转换图与自启动校验

把表转成图，重点标三样东西：8 个主循环状态的环形连接、8 个非循环状态的入圈箭头、以及每个箭头上标注的现态。文字描述就是：0000→1000→1100→1110→1111→0111→0011→0001→0000 构成一个八状态环，其余状态每个都有唯一确定的次态，且都能在有限拍内落到环上，没有孤立环，也没有死状态。

自启动校验的判定标准可以写进报告：任意初始状态施加时钟后，经过有限个时钟周期必然进入主循环，且进入后不再离开。这套电路的校验结果满足该条件，因此可以认为它对上电初值不敏感，上电清不清零都不影响最终计数序列。这一条在报告里值得单独写一段，因为它解释了为什么实验时即使没做上电复位，电路也能正常跑起来。

4. 模5计数器的设计与显示闭环：状态编码、预置电路与七段映射

4.1 先用四个开关把 74LS47 与 DL707 的映射验一遍

在设计计数器之前，先把显示链路单独验通，否则后面计数对了、显示错了，你分不清是哪一级的问题。做法是用四个电平开关直接接 74LS47 的 A、B、C、D 四个 BCD 输入（A 为最低位），输出经 360Ω 接 DL707，逐个数验证：

0~9 一一对应，说明译码器和数码管都正常。输入 1010~1111 时显示的是不规则图形，这不是故障：74LS47 只保证 0000~1001 这十个码的译码正确，1010~1110 属于无效码，输出组合没有定义；1111 则被内部消隐逻辑强制全灭。这条性质对模5计数器是好消息——计数器只会在 0000~0100 之间循环，永远进不了无效区，所以不需要额外加纠错逻辑。

接线时注意 74LS47 的 LT'、BI'/RBO'、RBI' 三个控制端。正常显示时 LT' 和 BI'/RBO' 接高电平；如果发现数码管全亮显示“8”，检查 LT' 是不是被拉低了；如果全灭，检查 BI'/RBO' 是不是被拉低，或者 RBI' 在输入为 0000 时误动作把零灭掉了。这三个端在报告里要写清楚接法，答辩时经常被追问。

4.2 状态编码与次态方程：模5 的 5 个状态怎么排

模5计数器需要 5 个状态，用四位二进制编码，最自然的排法是 0000→0001→0010→0011→0100→0000，即十进制 0~4 循环。四位里 y1 为最低位（接译码器 A 端），y4 为最高位。按这个编码列次态表：

对每个次态位分别化简，得到四个激励方程：

D4 = 0 D3 = y1 · y2 D2 = y4' · y3' · (y1 ⊕ y2) D1 = y4' · y3' · y1'

这组方程可以直接代回状态表逐行验证。以 0011→0100 为例：y4=0、y3=0、y2=1、y1=1，则 D4=0、D3=1·1=1、D2=1·1·(1⊕1)=0、D1=1·1·0=0，次态为 0100，正确。再以 0100→0000 为例：y3=1，于是 y3'=0，D2 和 D1 同时被这个因子掐成 0，D3=y1y2=0，次态回到 0000，“模5”的截断就是靠 y4'·y3' 这一项实现的——它只在状态 0100 时失效，把计数器强行拉回起点。

这里有两点值得在报告里点明。其一，D4 恒为 0，说明最高位触发器其实可以不参与计数，实际只需要 3 个触发器就能实现模5；保留第 4 个触发器是为了和译码器的四位输入对齐，也方便直接套用前面的四触发器接线习惯。其二，D2 和 D1 都带 y4'·y3' 因子，这一项相当于一个“到 4 就归零”的门控信号，把它抽出来单独用与非门实现，再分发到两个与门，比每个方程各搭一遍省门。这是用 74LS00 和 7408 拼电路时最实际的优化点。

4.3 激励方程落地与预置电路的接法

把方程变成接线，顺序建议是：先接时钟，再接四个 D 端，最后接显示。时钟统一从实验箱单脉冲引出，接到两片 74LS74 的 CLK 端，74LS74 是上升沿触发，四个触发器必须共用同一个时钟源，这样才是真正的同步计数器——如果每个触发器各接一个开关，那就变成异步了，状态会在一个时钟周期内多次变化，显示结果根本没法记录。

预置初值靠的是 74LS74 的异步置位端 PRE' 和清零端 CLR'，不占用 D 端的逻辑资源。需要把某一位预置成 1，就把该触发器的 PRE' 拉低；需要预置成 0，就把 CLR' 拉低。操作流程必须是：拉低对应的置位/清零端 → 观察数码管确认已置入 → 释放该端回到高电平 → 再给一个上升沿让计数器开始走。顺序颠倒或者忘记释放，触发器会被异步端钉死，无论怎么打时钟都不动，现象就是“卡在预置值”。

还有一个容易忽略的动作：一次实验里如果需要多次改变预置值，每次预置前要先把上一次拉低过的异步端全部恢复，再拉低新的那一个。原文记录里专门提了一句“在数字变换的时候，可以将之前置 1 的再置 0，以防扰乱后面的实验”，说的就是这个。原因是异步端优先级高于时钟，只要有一个还处于有效电平，后面所有的计数动作都会被它覆盖。

预置功能验证可以设计成三步：预置 2，给一拍，应显示 3；再给一拍，显示 4；再给一拍，回 0。能把这条走通，说明“可预置”和“模5循环”两个要求同时满足了。记录时把每一步的预置值和脉冲次数都写进表里，比只写“实验成功”有说服力。

4.4 用 74LS163 做的替代方案与对比

同一道题还有一条更省芯片的路径：直接用清单里的 74LS163。它是同步可预置的 2-16 进制计数器，本身带同步置数端 PE'（低有效）和同步清零端 SR'，把状态检测接到 PE'，数据端 D3~D0 全接 0，就能实现模5：

PE' = Q2' // Q2 只在计到 4（0100）时为 1 D3 = D2 = D1 = D0 = 0

用 74LS00 的一个与非门把两个输入并接当反相器，Q2 取反后接 PE'。计数序列是 0→1→2→3→4，到 4 的下一拍同步置数回 0，中间不会出现毛刺状态，因为 74LS163 的置数是同步的，不会像异步清零那样产生瞬时错误码。预置初值更简单：数据端接四个开关，需要预置时把 PE' 拉低一拍，开关上的值就被装入。

两种方案的取舍很清楚。D 触发器加门电路方案器件多、接线密，但每一步都能对应到次态方程，能完整展示“状态图→次态表→化简→激励方程→电路”的设计过程，实验报告里这部分是得分点；74LS163 方案两片芯片解决问题，体现的是中规模集成器件的应用能力，报告里适合作为方案对比出现，说明同一功能在不同集成度下的实现差异。如果课时紧，主方案用 74LS163，把 D 触发器方案作为设计推演写在报告里；如果要求完整设计过程，反过来。两套都写也不是凑字数，答辩时“为什么选这个方案”是高频问题，有对比才答得实。

5. 避坑清单：五个最容易翻车的点

5.1 接线与电源阶段的两个坑

第一个坑：触发器上电后状态乱跳，或者一直停在某个值不动。现象是时钟照打，数码管纹丝不动，换一片芯片还是这样。原因基本都指向 PRE' 和 CLR' 悬空——TTL 输入悬空在电气上偏向高电平，看似“没动作”，但抗干扰极差，手一靠近、电源一波动就可能被拉低，把触发器异步置位或清零，而且这种触发不可复现，很难抓。解决方式是把所有异步端用 1KΩ 上拉到 VCC，需要动作时再用开关接地，接线图上把每个上拉电阻都画出来，别靠记忆。

第二个坑：数码管某段特别亮、发烫，或者显示的段码和预期差几段。现象是译码器输入明明正确，显示就是不对。原因是 74LS47 的 a~g 是集电极开路输出，没接限流电阻直接怼到 LED，电流不受控。解决方式是每段串一只 360Ω 电阻，接完用万用表量一遍每段对 VCC 的通断，确认没有虚接。顺带检查共阳极公共端是不是接到了 VCC 而不是 GND，接反的典型现象是全灭或全亮。

5.2 时序与逻辑阶段的两个坑

第三个坑：按一次单脉冲，计数器跳两个状态。现象是记录表整体错位，0 直接到 2。原因有两个可能：实验箱的单脉冲按键没有消抖，一次按下产生多个边沿；或者四个触发器没有共用一个时钟源，接成了各自的开关，成了异步计数。区分方法很简单，把示波器或逻辑笔搭在 CLK 上按一次，看是几个边沿。解决方式是统一用实验箱消抖后的单脉冲输出，四个 CLK 并接在同一点，别图方便一人一个开关。

第四个坑：预置完第一次脉冲正常，第二次就卡住或者乱走。现象是预置 2 之后跳到 3 正常，再按就不动了。原因是预置时拉低的异步端没有完全释放，某个 PRE' 还挂在低电平，触发器被钉死，时钟对它无效。解决方式是养成固定顺序：拉低异步端 → 确认显示 → 释放 → 再打脉冲，并且每换一个预置值之前，先把上一次动过的异步端全部复位一遍，再动新的。这个动作重复几次就成了肌肉记忆，但第一次做的时候十有八九会忘。

5.3 记录与状态表阶段的一个坑

第五个坑：状态表推演结果和实测对不上，而且错的往往是“少几个状态”。现象是记录里只有 5 个状态，理论上有 8 个。原因有两个层面：一是手推时顺着直觉续写，看到 1111 就以为下一拍还是全 1，没回到激励函数里代值，漏掉了 y4=1 时反馈项被掐断这个关键分支；二是位序混乱，移位寄存器实验里 y1 是第一级（串行输入那级），模5实验里 y1 是最低位（接译码器 A 端），两个“y1”含义完全不同，混着写必然对不上。

解决方式有三条：推演每一拍都写代入过程，不允许跳步；把位序在报告开头定义清楚，全篇统一，图上标注也统一；最后用第 3.2 节那段脚本把 16 个状态全枚举一遍，和手推表逐行核对。我一般会在报告里附一张位序对照表，明确 y1 在哪一部分对应哪一位，这个习惯救过不止一次。

6. 验收与答辩：怎么把这条链路讲成一条闭环

验收这一步，别急着把数码管亮起来就算完，先按下面的清单逐项过一遍，每项都要能当场复现：

答辩讲的时候，顺序比内容更重要。先讲链路：时钟 → 触发器 → 译码器 → 显示器，四级各自的职责一句话说清；再讲设计：状态图怎么来的、次态方程怎么化简、为什么 D1 里会出现 y4'·y3' 这个因子；最后讲一次翻车——移位型计数器那次状态表漏状态，是最值得讲的一段，因为它同时体现了“理论推演要回到公式代值”和“实测能纠正理论”这两件事，比讲十个顺利的步骤有说服力。被问到“为什么不用 74LS163”时，别答“没用过”，答两种方案的取舍：集成方案省器件但看不到设计过程，门电路方案器件多但每一步可追溯。

从那以后我每次带人做这类计数显示实验，都强制先单独验通译码显示这一段，再接计数器，最后才做预置。顺序颠倒一次，后面排查故障的时间往往是接线时间的三倍。希望帮到你。

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