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简介：这份四人智力竞赛抢答器完整课程设计文档，面向电子信息、自动化等专业学生及需要完成数字电路课程设计的读者，围绕抢答器从方案论证到系统联调的全过程展开。文档以一份857KB的doc文件交付，内容涵盖总体方案比较与选择、抢答器电路、计时器电路、计分器电路等单元模块设计，并附主要器件介绍、系统功能调试、总结体会与参考文献，形成较完整的课程设计说明书结构。设计以D触发器、锁存器配合逻辑门锁存首位抢答信号并阻断后续输入，用555定时器与减法计数器实现可预置倒计时，以十进制可逆计数器完成答对加10分、答错扣10分的计分逻辑，同时讨论了无线抢答的拓展方向。目前已有4730人学习，适合需要参考电路原理、模块划分与调试思路的读者对照使用。

1. 四人抢答器：几微秒的差距，为什么纯数字电路能咬得住

四个人同时按下去，谁先谁后？人眼分辨不出来，主持人喊“你抢得早”也没人服气。四人智力竞赛抢答器要解决的第一个问题，不是“记录谁按了”，而是“在几微秒的尺度上判定谁第一个按了，并且让后面三个人的按键彻底失效”。这件事用软件做很自然——中断加时间戳排序即可；但这份课程设计偏偏用纯硬件完成：D 触发器锁存、或非门互锁、三极管做开关、555 出时钟、JK 触发器倒计数、74190 可逆计数计分。它值得搞懂的地方在于，整套系统没有一行代码，却把“竞争”“锁存”“互斥”“倒计时”“加减分”这些概念全部落在电平与边沿上。搞懂它，等于把数字电路里最容易被当成玄学的那部分——触发器为什么能“记住”、互锁为什么不会翻车——一次性打通。

2. 抢答锁存：第一个上升沿怎么把另外三路彻底摁死

抢答器的核心矛盾只有一句话：四路输入同时可能到来，系统必须只认第一路，并且把结果保持到主持人复位。这份设计用“三极管开关 + D 触发器 + 或非门反馈”三层结构来完成，每一层解决一个具体问题。

2.1 三极管在这里不是放大器，是主持人手里的闸刀

很多初学者看到三极管就想到放大倍数 β，但在这个电路里，三极管工作在两个极端状态：截止和饱和导通，本质是一个受主持人控制的开关。主持人开关接地时，基极电流被拉走，三极管截止，集电极相当于断开，选手按键信号传不进去；主持人断开开关，集电极接高电平，三极管饱和导通，选手信号才能通过。

常见的实现思路是让三极管串在按键与触发器输入之间，用基极电平决定“通道开不开”。这里的关键不是放大，而是“用一个小控制信号切断一条信号通路”。踩过坑的人都清楚，三极管做开关时必须保证饱和足够深，否则集电极残压会让后级触发器收到一个不干净的中间电平，表现为“有时候能抢、有时候抢不到”。

提示：判断三极管是否可靠饱和，看的是基极电流是否远大于集电极电流除以 β，而不是只看基极有没有电压。

2.2 D 触发器的“维持—阻塞”结构，才是锁存的真正底牌

设计里用的是 74LS74 一类的边沿 D 触发器，文档把它拆成六个与非门，其中两个构成基本 RS 触发器，另外四个构成维持阻塞输入引导电路。它的工作过程可以按 CP 电平分三段理解：

CP=0 期间：输入门 c、g 被封锁，输出 c=e=1， 触发器状态不变，但同时接收 D，f=~D，g=D； CP 由 0 变 1：c、e 打开，c=~D，e=D， 基本 RS 触发器被置成 Q=D； CP=1 期间：c、e 输出互补，封锁 D 通往基本 RS 的路径， 同时反馈线维持当前状态、阻止翻转。

这段逻辑说明了一件事：D 触发器只在时钟上升沿“采样一次”，采样完成后输入再怎么变都进不去。抢答器正是利用这一点——选手按键产生一个上升沿，触发器把“这一路被按下”这件事锁成高电平，之后即使手还按着、信号抖动，状态也不再改变。文档里提到的“置 0 维持线、置 1 阻塞线”，就是保证 CP=1 期间不会被输入噪声翻盘的物理机制。

2.3 或非门互锁：四路反馈交叉，谁先到谁封路

单靠 D 触发器只能各自记住自己，不能阻止别人。真正让“只认第一个”成立的是或非门构成的互锁网络。假设选手 1 先按下，D1 输出高电平，这个高电平送进或非门，或非门输出低电平，接到其余三路 D 触发器的复位/封锁端，把它们的输入通路压死。等选手 2 再按，信号已经到不了自己的触发器，自然无法点亮指示灯。

这里有一个容易被忽略的时序细节：互锁必须比“第二个人按键”更快。D 触发器的翻转是纳秒到几十纳秒级，或非门传播延迟也在纳秒级，而人的按键间隔最少也是毫秒级，所以物理上留出了巨大余量。文档说“即使两组相差几微秒也可分辨”，靠的就是这个速度差，而不是什么精密测量。

2.4 主持人复位为什么必须存在

锁存和互锁一旦成立，系统就“卡”在第一个抢答者身上，这是设计意图，不是缺陷。但下一轮抢答必须能重新开始，所以主持人控制端同时承担“开闸”和“复位”两个职责。文档中主持人开关接通时三极管截止、抢答被锁定，断开时允许抢答；配合触发器的直接置位/清零端，就能在每轮开始前把四路状态清干净。没有这个复位路径，抢答器只能玩一局，这是血泪经验级别的必要设计。

3. 倒计时：555 出脉冲，JK 减法计数器怎么从 7 数到 0

计时器部分要解决的是“预定时间内无人抢答就自动停止”和“倒计数制造紧迫感”。它由三块拼成：555 多谐振荡器提供秒脉冲，三个 JK 触发器构成异步二进制减法计数器，CD4511 译码驱动数码管显示。

3.1 555 内部三个 5k 电阻，决定了它为什么能当振荡器

555 的内部结构可以简化成：三个 5kΩ 电阻串联分压，得到 2/3 Vcc 和 1/3 Vcc 两个比较阈值；两个比较器分别控制基本 RS 触发器的置位和复位；输出级和放电三极管负责对外驱动与放电。文档给出的功能表说明了它的核心行为：

VI1 > 2/3Vcc，VI2 > 1/3Vcc -> 比较器 C1 输出低，RS 置 0，输出低，放电管导通 VI1 < 2/3Vcc，VI2 < 1/3Vcc -> 比较器 C2 输出低，RS 置 1，输出高，放电管截止 VI1 < 2/3Vcc，VI2 > 1/3Vcc -> R=1、S=1，保持原状态

把放电管和阈值输入接上电阻电容，电容在 1/3 Vcc 与 2/3 Vcc 之间充放电循环，输出端就得到连续方波。这里的设计动机很直接：抢答器需要一个稳定的秒级节拍，555 加两个电阻一个电容就能给出，不需要晶振和分频链。常见的实现思路里，充电电阻取 0.6k、2.4k 这类组合，配合电容调出约 1 秒周期，文档电路图中正是这个量级。

注意：555 的复位端在正常工作时必须接高电平，悬空或误拉低会让输出一直为低，表现为“计时器完全不动”，这是排查时第一个要看的地方。

3.2 异步减法计数器：为什么把前一级的 Q 端接到下一级 CP

三个 JK 触发器都把 J、K 悬空，等效于 J=K=1，即每个触发器都工作在翻转模式。减法计数的连接方式是把前一级的输出端接到下一级的时钟端，形成异步级联。文档给出的状态表很能说明问题：

从 000 复位后第一个脉冲变成 111，是因为异步减法计数器利用的是“低位由 1 变 0 时产生借位下降沿”的机制。三个触发器全 1 再逐级借位，视觉上就是从 7 倒着数到 0。这里的设计取舍是：异步计数器结构简单、不需要统一时钟布线，代价是各级翻转有先后延迟，会在中间态产生短暂的错误编码。对数码管显示来说，这种毛刺人眼看不见；但如果后级还接了别的译码逻辑，就必须考虑用锁存或同步方案。

3.3 到 0 之后为什么要响一声

文档明确写了：当 JK 触发器输出为 000 时，输出端接的与非门翻转，驱动扬声器发声，提示抢答时间到。这个细节是倒计时器的“闭环”——它不只是显示数字，还要在归零瞬间给出一个可听信号，让主持人知道该停止本轮。实现上就是把三个触发器的输出做与非，只有全 0 时输出特定电平，再经三极管或直接驱动蜂鸣器。踩坑点在于：如果与非门输入接了触发器的不带缓冲输出，归零瞬间的竞争可能让蜂鸣器响一下又停，实际调试时要在门电路前加小电容或改用带施密特特性的输入。

3.4 CD4511 译码：为什么显示的是十进制而不是二进制

JK 触发器输出的是三位二进制码，人看不懂，所以要经过 CD4511 七段译码器转成数码管段码。CD4511 内部完成 8421 码到 a~g 段的映射，还带锁存和消隐控制。文档电路里把触发器输出直接送 4511 的 A、B、C、D 输入，数码管共阴极接法，显示 7 到 0。这里没有用单片机查表，是因为整个设计定位就是纯硬件课程设计，译码器本身就是教学重点之一。实际接线时最容易翻车的是共阴/共阳搞反，现象是“数码管全亮但显示乱码”，换管或改接法即可。

4. 计分器：74190 可逆计数，为什么个位要单独锁成 0

计分器的需求很具体：每组从 100 分起，答对加 10，答错扣 10，个位始终为 0。这意味着计分器不需要处理 1 分的粒度，只需要在十位和百位上做加减。设计用两片 SN74190 十进制可逆计数器加一个 D 触发器完成。

4.1 74190 的 U/D 引脚就是加法和减法的分界线

74190 是带预置数的同步十进制可逆计数器，第 5 脚 U/D 控制方向：高电平做减法，低电平做加法。文档里主持人把开关拨到加分端并送一个脉冲，U2 就加 1；拨到减分端送脉冲，就减 1。因为个位被固定为 0，U2 每计一个数实际代表 10 分，所以显示上从 100 变成 110、120，而不是 101、102。

U2（十位/个位组合计数）： 预置 0000，每来一个脉冲加 1； 计到 1010（十进制 10）时，与门检测 Q0、Q2， 反馈到 LD 置数端，重新置 0，同时 RCO 产生进位脉冲给 U1； U1（百位）： 接收 U2 的进位脉冲，在百位上加 1。

这段逻辑的关键是“十位计满 10 次，百位进 1”。个位显示为零不是靠计数器本身，而是靠 D 触发器把个位数码管的输入固定住，或者干脆不接个位计数。文档写的是“D 触发器主要是使个位显示 0”，我一般会理解为用触发器锁住个位译码输入，保证无论十位怎么变，个位段码始终是 0。

4.2 预置 100 分是怎么落地的

上电或每轮开始前，百位 74190 预置为 1，十位预置为 0，个位显示 0，合起来就是 100。预置靠的是 74190 的 LD 端和 P0~P3 数据输入：把百位的 P 端接成 0001，十位接 0000，给一个装载脉冲即可。这里的设计动机是避免用清零再手动加十次的方式初始化，直接预置更可靠，也符合“从预置的 100 分开始”的要求。

4.3 加减 10 分的边界：为什么到 200 会进位，到 90 会借位

加分时，十位计到 10 产生进位，百位加 1，显示 200；减分时，十位从 0 减到 9 会产生借位，百位减 1，显示 90。74190 的 RCO 和借位逻辑天然支持这种级联，只要把低位片的进位/借位输出接到高位片的时钟或使能端。实际调试时要注意加减方向切换瞬间不要同时给脉冲，否则可能出现“按一下加 10 又减 10”的抖动，常见做法是开关先稳定再送单脉冲。

4.4 个位锁 0 的代价与好处

把个位固定为 0，好处是计分粒度清晰、电路简单、不会出现 105 这种不符合规则的分数；代价是失去了 1 分粒度的扩展性。如果以后要改成加 5 分或加 1 分，这个结构就得改。这是典型的设计取舍：课程设计的需求边界明确，就用最省器件的方案；真实比赛系统则更可能用可编程逻辑或单片机来保留灵活性。

5. 避坑与排查：仿真能跑、实物翻车的几个典型现场

纯硬件抢答器在仿真软件里往往一次通过，焊到板子上却问题百出。下面几条是这类设计里反复出现的现象、原因和解决路径。

5.1 现象：主持人没按开始，选手一按就亮

原因通常是三极管没有真正截止。基极电阻取值偏大或主持人开关接地不彻底，导致基极仍有微小电流，三极管处于微导通，选手信号漏过去。解决方法是测量截止时集电极电压，确认接近电源电压；必要时减小基极电阻或改用更可靠的开关注入方式。

5.2 现象：两个人几乎同时按，两路灯都亮

这说明互锁反馈没有生效。常见原因是或非门输出接错了触发器的端——应该接复位/封锁端却接到了数据端，或者反馈路径上多串了一级门导致延迟过大。排查时用示波器看先按那一路的触发器输出到其余三路封锁端的电平变化，确认在第二路按键到来前已经变低。

5.3 现象：倒计时数字跳变乱、显示闪

异步减法计数器在级联翻转时会产生中间态，如果译码器没有锁存，数码管会短暂显示错误数字。解决方法是接受这种视觉毛刺（人眼通常看不出），或者在译码器前加锁存器，在稳定后再生效。另一个常见原因是 555 输出脉冲抖动，检查 5 脚控制电压端是否接了 0.01μF 去耦电容。

5.4 现象：计分器按一次加了好几分

多数是按键抖动或脉冲开关没有整形。74190 的时钟输入对边沿敏感，机械开关的抖动会被当成多个脉冲。解决方法是在时钟输入端加 RC 低通或施密特触发器整形，软件里叫消抖，硬件里同样要消抖。另一个可能是 U/D 方向切换和脉冲同时到达，先稳定方向再给脉冲。

5.5 现象：仿真里找不到某个型号的器件

文档自己也提到仿真软件存在元件库不全的问题。常见做法是找功能等效的替代型号，比如用通用 D 触发器替代特定型号、用理想开关替代机械开关，但替代后要重新核对引脚定义和电平极性，否则会出现“仿真通过、实物接错”的经典翻车。

6. 从纯硬件到可扩展：这套抢答器真正值得带走的设计思维

这套四人抢答器的价值不在于它用了多少芯片，而在于它把几个数字系统的基本问题用最少的器件讲清楚了：竞争怎么裁决、状态怎么保持、互斥怎么实现、计数怎么级联、人机边界怎么划分。抢答锁存用的是“边沿采样 + 反馈封锁”，倒计时用的是“振荡器 + 异步减法”，计分用的是“可逆计数 + 预置 + 进位级联”。每一块都可以单独拿出来验证，合起来就是一个完整系统。

如果要做扩展，最自然的路径是把互锁和锁存搬到可编程逻辑里：用同步时钟对四路输入采样，用优先级编码器选出第一个，用寄存器保持结果，倒计时和计分用计数器 IP 实现。这样做的代价是失去了纯硬件“纳秒级天然并行”的直观性，好处是改规则不用重新焊板子。文档提到的无线抢答拓展，本质上也是把“按键到锁存”这段通路从导线换成无线收发，但裁决逻辑仍然要回到“谁先到、怎么锁”这个核心问题上。

我自己的习惯是，每次碰这类“先到先得”的电路，都先把最坏情况下的时序余量算一遍：按键间隔、门延迟、触发器建立保持时间，三者对不上就一定会出现“偶尔两个人同时亮”的玄学故障。从那以后我每次做竞争类逻辑，都强制先画一张时序余量表再动手，希望帮到你。

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