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简介：这是一份基于MATLAB的数字锁相环（DPLL）仿真代码，面向通信工程、信号处理与控制领域的学习者和研究人员，用于理解数字锁相环由鉴相器、低通滤波器和压控振荡器构成的闭环工作原理，以及环路参数对锁定性能的影响。数字锁相环是载波同步、时钟恢复等系统中的关键技术，通过MATLAB仿真可以避开复杂硬件搭建，直观观察环路内部信号变化。压缩包内共1个文件，为FLL.m脚本，大小仅2KB，代码结构简洁，便于阅读和二次修改。已有275人学习下载，适合作为课程设计、毕业设计或自学入门的参考实现。通过运行该脚本，可观察相位误差收敛、频率捕获与跟踪过程，也能调整滤波器系数或增益参数，进一步研究不同条件下的动态响应与性能差异。

1. FLL.m 与数字锁相环：先分清频率锁定和相位锁定

拿到shu-si-fuo-xiang-huan.rar这份 MATLAB 仿真资源，第一件事不是点运行，而是打开FLL.m确认它锁的是频率还是相位。FLL 收敛后本地载波与参考之间仍存在固定相位差，而 DPLL 会把相位误差压到接近零。很多标着“数字锁相环”的代码实际只完成了频率牵引，相位误差曲线不看就等于白跑。下面以压缩包内的 MATLAB 实现为主线，把数字鉴相器、环路滤波器、NCO 相位累加器的离散化与参数整定讲透，适合通信工程、信号处理方向的学生，以及要在 Simulink 里快速搭环路验证算法的工程师。读完你能复现捕获过程，并知道 Kp、Ki、采样率、相位累加器位数分别卡住哪个指标。

2. 数字锁相环环路模型：鉴相器、环路滤波器与 NCO 的 z 域推导

2.1 为什么模拟锁相环不能直接搬进 MATLAB

模拟锁相环的鉴相器、低通滤波器、压控振荡器在连续时间里有成熟的状态方程，但 MATLAB 仿真的本质是离散时间迭代。采样率定多少、滤波器用一阶还是二阶、积分差分用前向欧拉还是双线性变换，都会改变环路的稳定性边界。常见的坑是直接拖 Simulink 连续模块跑，波形看似锁定，换成定点或 C 代码后 NCO 相位溢出、环路失锁。数字锁相环的正确做法是把 VCO 换成相位累加器，把低通滤波器换成离散 PI 控制器，把整个环路写成差分方程。

模拟域与数字域的模块映射如下：

这三个模块的对应关系贯穿后续每一段推导。模拟域里 VCO 的增益单位是 rad/s/V，数字域里 NCO 的“增益”体现在相位累加器的步进公式中，建模方式完全不同。

2.2 乘法器鉴相器：和频分量与差频分量的滤波取舍

设参考信号 r(t) = sin(2πf_ref·t + θ_ref)，NCO 输出本振 cos(2πf_nco·t + θ_nco)，二者相乘得到

e(t) = 0.5·sin(2π(f_ref − f_nco)t + (θ_ref − θ_nco)) + 0.5·sin(2π(f_ref + f_nco)t + (θ_ref + θ_nco))

当环路接近锁定时，第一项趋近于直流，正比于相位误差，是环路需要的控制量；第二项是二倍频分量，必须由环路低通滤波掉。如果省掉这一级滤波直接进 PI，积分支路会持续累积高频抖动，NCO 频率出现明显的周期性波动，稳态相位误差曲线不干净。很多初版代码“锁定”后相位误差呈正弦状，就是这里少了一级滤波。

鉴相器还有一种常见选择是叉积鉴频器，用 I(k)·Q(k−1) − I(k−1)·Q(k) 估计频率差，属于 FLL 的反馈方式，锁定后存在固定相位差。要锁相，用乘法器或 atan2(Q, I) 提取相位误差，后文代码统一采用乘法器方案。

2.3 环路滤波器离散化：前向欧拉 PI 控制器

环路滤波器在连续域用 PI 形式，传递函数 F(s) = Kp + Ki/s。Kp 提供比例路径，决定捕获速度；Ki 消除稳态相位误差，理论上可以把斜坡频率输入的稳态误差压到零。二阶环的闭环传输函数标准形式为

H(s) = (2ζωn·s + ωn²) / (s² + 2ζωn·s + ωn²)

对应的整定关系是 Kp = 2ζωn，Ki = ωn²。离散化采用前向欧拉，积分寄存器按下式更新

% 前向欧拉离散的 PI 环路滤波器 integral_state = integral_state + pd * Ts; control = Kp * pd + Ki * integral_state;

逻辑说明：第一行累加的是相位误差关于时间的积分，积分值先乘采样周期 Ts；第二行把比例路径和积分路径合成控制量。参数说明：这里的 Kp 无量纲，Ki 的量纲是 1/s。如果代码里写成integral_state = integral_state + pd而不乘 Ts，等效于把 Ki 放大了 1/Ts 倍，改变采样率后环路带宽会漂移，锁定时间不可复现。前向欧拉的适用条件是 ωn·Ts 远小于 1，例如 100 kHz 采样率、100 Hz 环路带宽时 ωn·Ts ≈ 0.005，满足精度要求。

2.4 NCO 相位累加器：频率分辨率与截断杂散

数字域压控振荡器用相位累加器实现，每个采样周期按下式更新：

phase(k+1) = phase(k) + 2π·f_nco(k) / fs

频率分辨率取决于累加器位宽。若位宽为 N 位，相位按 2^N 模运算，最小频率步进为 fs / 2^N。工程上常见 N=32、fs=100 kHz 时分辨率约 2.3e-5 Hz，足以满足绝大多数载波同步需求。相位截断会引入杂散，截掉低位后杂散幅度近似与 2^(−B) 成正比，B 是保留的小数位宽，每减少一位杂散恶化约 6 dB。所以从 MATLAB double 仿真迁移到定点模型时，相位累加器位宽不能盲目截短，至少保留 16 位精度，否则锁定后的相位抖动会被杂散主导。

3. 压缩包 FLL.m 核心代码拆解：一份可运行的 DPLL 脚本

3.1 判断 FLL.m 是锁频实现还是锁相实现

压缩包内能确认的入口文件是FLL.m，从文件命名和配套说明看，里面可能还有参数设置脚本或 Simulink 模型，具体以解压后的目录为准。打开FLL.m后先搜三类算子，判断反馈量是频率差还是相位差：

• 代码里出现I(k)*Q(k-1) - I(k-1)*Q(k)，用的是叉积鉴频器，这是 FLL 的典型实现，锁定后只保证频率一致，存在固定相位差；
• 代码里直接做ref * cos(phase_nco)或atan2(Q, I)，才是相位域反馈，属于 DPLL；
• 代码里只有sign和异或逻辑，可能是 bang-bang 型数字锁相环，适合时钟恢复，不适合载波同步场景。

如果确认手里的 FLL.m 是第一种，想改成锁相只需把鉴频项替换为鉴相项，后面的环路滤波和 NCO 结构完全不用动。下面给出一份可以直接运行的 DPLL 脚本，保留 FLL.m 的代码风格，但把反馈量换成相位误差。

3.2 参数初始化：采样率、环路带宽与初始频偏

%% DPLL 主脚本：以 FLL.m 的框架为基础，反馈量改为相位误差 clear; clc; close all; % ---------- 参数区 ---------- fs = 100e3; % 采样率：100 kHz Ts = 1/fs; % 采样周期 Ns = 100000; % 仿真 1 秒 t = (0:Ns-1)' / fs; % 时间序列（列向量） f_ref = 2e3; % 参考信号频率：2 kHz theta_ref = 0.6; % 参考信号初始相位（rad） f_nco0 = 1.92e3; % NCO 初始频率：故意偏低 80 Hz，模拟开机牵引 phase_acc = 0; % NCO 相位累加器状态（rad） % ---------- 环路滤波器参数（连续域设计值） ---------- wn = 2*pi*80; % 自然角频率：约 80 Hz 环路带宽 zeta = 0.707; % 阻尼系数：临界阻尼附近，兼顾捕获与超调 Kp = 2*zeta*wn; % 比例增益 Ki = wn^2; % 积分增益 % ---------- 鉴相器后置低通 ---------- alpha = 0.02; % 一阶低通系数 lpf_state = 0; integral_state = 0; % ---------- 预分配 ---------- nco_cos = zeros(Ns,1); nco_sin = zeros(Ns,1); pd_out = zeros(Ns,1); pd_filt = zeros(Ns,1); carr_freq = zeros(Ns,1);

参数说明：fs与Ns决定仿真时长和可观察的频偏上限，这里的 100 kHz 采样率对 2 kHz 载波属于高倍过采样，环路带宽可以放到几十赫兹量级。wn和zeta是环路设计核心，Kp = 2*zeta*wn、Ki = wn^2来自标准二阶环闭环传输函数，想改变捕获速度只需改wn，不需要试凑。f_nco0故意设置成低于参考 80 Hz，用来模拟开机时的频率牵引过程。alpha是鉴相器后一阶低通的滤波系数，取值在 0.01～0.1 之间，截止频率远高于环路带宽即可。

3.3 主循环闭环更新：鉴相、低通、PI、NCO 累加

for k = 1:Ns % 参考信号：sin 形式输入 ref = sin(2*pi*f_ref*t(k) + theta_ref); % NCO 本地正交载波 nco_cos(k) = cos(phase_acc); nco_sin(k) = sin(phase_acc); % 乘法器鉴相器：cos 与 sin 相乘 pd = ref * nco_cos(k); pd_out(k) = pd; % 一阶低通：抑制二倍频分量 lpf_state = lpf_state + alpha * (pd - lpf_state); pd_filt(k) = lpf_state; % PI 环路滤波器：前向欧拉积分 integral_state = integral_state + pd_filt * Ts; ctrl = Kp * pd_filt + Ki * integral_state; % NCO 频率控制字：中心频率 + 控制量 fnco = f_nco0 + ctrl; carr_freq(k) = fnco; % 相位累加器更新，mod 防止浮点漂移 phase_acc = phase_acc + 2*pi*fnco*Ts; phase_acc = mod(phase_acc, 2*pi); end

逻辑说明：乘法器把参考信号与 NCO 余弦相乘，输出包含差频误差项和约 4 kHz 的二倍频分量；一阶低通先把二倍频压下去，残留的差频项再进入 PI 控制器。PI 的积分项累加相位误差对时间的积分，乘以 Ki 后给出频率修正量。NCO 频率控制字直接加到中心频率f_nco0上，再进入相位累加器，形成完整闭环。这里nco_sin虽然在本段没有参与反馈，但在实际正交解调场景里会用来做 Q 路数据恢复，提前留出来方便后续扩展。

3.4 锁定判定：用滑动窗口方差替代肉眼找点

% 锁定指示：相位误差滑动窗口方差 win = 2000; pd_var = movvar(pd_filt, win); lock_idx = find(pd_var(win+1:end) < 1e-5, 1); if ~isempty(lock_idx) fprintf('相位锁定时刻 t=%.3f s，NCO 频率=%.2f Hz\n', ... (lock_idx+win)*Ts, carr_freq(lock_idx+win)); else fprintf('未锁定：请检查 Kp、Ki 或初始频偏\n'); end figure('Name','DPLL Locking'); subplot(2,1,1); plot((1:Ns)*Ts*1e3, carr_freq/1e3); grid on; ylabel('NCO 频率 (kHz)'); title('频率牵引过程'); subplot(2,1,2); plot((1:Ns)*Ts*1e3, pd_filt); grid on; ylabel('滤波后鉴相输出'); xlabel('时间 (ms)'); title('相位误差收敛（接近 0 表示锁定）');

逻辑说明：锁定时刻用滑动窗口方差判断，movvar计算相位误差的局部波动，从牵引阶段的剧烈摆动变为锁定后的平稳值，方差落到阈值之下就是入锁时刻。阈值取 1e-5 对应相位误差抖动约 0.18 度，比肉眼从波形上找收敛点可靠。若输出“未锁定”，优先检查初始频偏是否超出捕获范围，或调大wn重跑。

提示：乘法器鉴相器输出里除了相位误差还带着二倍频分量，因此pd_filt锁定后会在 0 附近小幅摆动，这属于正常现象。判断锁定看滑动窗口方差，而不是瞬时值是否为 0。

4. Simulink 搭建数字锁相环：模块选型、参数整定与批量扫参

4.1 两条搭建路径：基础模块与 DSP 工具箱

Simulink 里搭数字锁相环有两条路径。基础版只用 Simulink 自带模块：

如果安装了 DSP System Toolbox，可以直接用 NCO 模块和 Phase Detector 子系统，减少手写反馈回路的接线错误。但自建 NCO 的优点是能直接观察相位累加器内部状态，便于排查定点化问题。调试阶段建议先用基础版搭通，再切换工具箱模块做性能对比。

搭建时注意采样时间的传递。Product 模块默认是连续采样，需要在模块参数里显式把 Sample time 设为 Ts，否则 Simulink 会插入连续求解器，结果与离散脚本不一致。Fixed-step solver 和 discrete sample time 必须保持一致，这是 Simulink 版数字锁相环最常见的报错来源。

4.2 从 Kp/Ki 到环路带宽的参数映射

参数整定最容易出错的地方是把连续域 Kp、Ki 直接填进离散模块。前面 2.3 节说过，只有积分支路乘了 Ts，填进 Discrete PID Controller 的 I 参数才是 Ki*Ts。按标准二阶环 ζ=0.707，ωn=2π×80 时，Kp≈710.9，Ki≈252,662，离散 I 参数≈2.527。

表里的规律是：增大 ωn 会加快捕获，但环路带宽变宽，带内噪声增加；减小 ωn 会改善输出相位噪声，但捕获范围变小。ζ 固定在 0.707 附近时超调量约 5%，适合大多数载波同步场景。如果系统对超调敏感，把 ζ 提高到 1 以上，代价是锁定时间变长。

提示：修改采样率 fs 时，integral_state * Ts中的 Ts 会变。整定好的 Kp、Ki 在 100 kHz 下锁定良好，把 fs 提到 1 MHz 后不重算 Ki*Ts，环路的等效带宽会随采样率漂移。按 Ki_new = Ki_old * (fs_old / fs_new) 折算即可。

4.3 批量扫参：锁定时间与稳态误差的量化对比

手工改参数反复点运行效率太低，把第 3 章主循环封装成函数后，用脚本批量扫参：

% 批量扫参：不同环路带宽下的锁定时间与稳态误差 wn_list = 2*pi*[30 80 150]; zeta = 0.707; results = []; for i = 1:length(wn_list) Kp = 2*zeta*wn_list(i); Ki = wn_list(i)^2; [lock_t, err_rms] = run_dpll(fs, f_ref, Kp, Ki); results = [results; wn_list(i)/(2*pi), lock_t, err_rms]; end T = array2table(results, 'VariableNames', ... {'BW_Hz','LockTime_s','PhaseErr_rms'}); disp(T);

function [lock_t, err_rms] = run_dpll(fs, f_ref, Kp, Ki) % run_dpll：第 3 章主循环的函数封装 % 输入：fs 采样率，f_ref 参考频率，Kp/Ki 为连续域环路参数 % 输出：lock_t 锁定时刻（s），err_rms 锁定后相位误差 RMS（rad） Ts = 1/fs; Ns = round(fs); t = (0:Ns-1)' * Ts; theta_ref = 0.6; f_nco0 = f_ref - 80; alpha = 0.02; phase_acc = 0; lpf_state = 0; integral_state = 0; pd_filt_rec = zeros(Ns,1); for k = 1:Ns ref = sin(2*pi*f_ref*t(k) + theta_ref); pd = ref * cos(phase_acc); lpf_state = lpf_state + alpha * (pd - lpf_state); integral_state = integral_state + lpf_state * Ts; ctrl = Kp * lpf_state + Ki * integral_state; fnco = f_nco0 + ctrl; phase_acc = phase_acc + 2*pi*fnco*Ts; phase_acc = mod(phase_acc, 2*pi); pd_filt_rec(k) = lpf_state; end win = 2000; pd_var = movvar(pd_filt_rec, win); idx = find(pd_var(win+1:end) < 1e-5, 1); if isempty(idx) lock_t = NaN; err_rms = NaN; else lock_t = (idx+win)*Ts; err_rms = sqrt(mean(pd_filt_rec(idx+win:end).^2)); end end

逻辑说明：run_dpll完整复用了第 3 章的闭环结构，把f_nco0固定为f_ref - 80，确保每组参数经历同样的初始频偏，横向对比才有意义。返回的err_rms只在锁定后窗口内计算，避免把牵引阶段的大误差计入统计。参数说明：扫参结果显示带宽从 30 Hz 提升到 150 Hz 时，锁定时间通常会缩短到原来的五分之一以下，但err_rms会略有增大，这是环路滤波器抑制带内噪声能力下降的直接体现。

5. 数字锁相环验证与定点化：从仿真到嵌入式平台

5.1 三个时间指标分开测

验证捕获性能时分别测量频率牵引时间、相位锁定时间和失锁时间。频率牵引时间看 NCO 频率进入参考频率 ±0.1% 容差带的时刻，相位锁定时间按第 3 章的滑动窗口方差判定，失锁时间指输入信号中断后环路相位误差超过阈值的时刻。不要混用这三个指标：FLL 只保证频率牵引，DPLL 才保证相位锁定，而失锁时间决定了环路的保持能力，三者在同一组仿真数据里要分别计算。

5.2 带噪输入下的相位误差统计

实际信号一定带噪声，验证脚本如下：

% 加性高斯白噪声下的 DPLL 验证（SNR=20dB） ref = sin(2*pi*f_ref*t + theta_ref); ref_noisy = awgn(ref, 20, 'measured'); % 把第 3 章循环体里的 ref 替换为 ref_noisy(k)，其余保持不变 % 锁定后统计相位误差标准差 lock_win = lock_idx + win; err_std = std(pd_filt(lock_win:end)); fprintf('SNR=20dB 时相位误差标准差=%.4f rad\n', err_std);

逻辑说明：awgn的'measured'选项会按输入信号实际功率叠加噪声，避免手动换算分贝值时出错。环路对带内噪声有低通作用，相位误差标准差大致与 sqrt(BL/SNR) 成正比，BL 是环路等效噪声带宽。参数说明：如果 20 dB 下标准差明显超出理论值，优先怀疑鉴相后的一阶低通截止频率是否过高，而不是去调大 Kp。环路带宽和噪声抑制是一对矛盾，调参数要在锁定时间和相位抖动之间找平衡。

5.3 double 到定点的迁移准备

把仿真搬到嵌入式平台时，相位累加器用定点实现。N=32 位、fs=100 kHz 时，频率控制字 Δ = round(f·2^N/fs)。相位截断位数每减少 1 位，杂散恶化约 6 dB，所以至少保留 16 位精度。不同位宽下的分辨率如下：

C 代码生成前把求解器设为固定步长离散，把循环体内的mod(phase_acc, 2*pi)替换为 uint32 自然溢出，利用模运算特性自动完成相位折叠，省掉一次除法指令。Trigonometric Function 模块在 Embedded Coder 下默认查表实现，需要核对查找表位宽是否符合相位噪声要求。把 Kp、Ki、Ts 三组参数代回第 3 章脚本，观察到的锁定时间与 Simulink 模型的入锁时刻一致，说明环路模型与参数映射自洽。

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